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  • 基于CPLD的VGA时序彩色信号的实现
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    时间：2019.06.28
    上传者：xld0932
    采用可编程逻辑器件CPLD设计一个简易VGA视频信号产生模块，经过软硬件调试，最终在显示器上显示彩色方块或线条等正确图像。利用此原理，可以设计更多的彩色图像，且可将采集的图像进行实时显示，将此作为信号
  • 基于CPLD的TMS320C6727B外设重叠地址空间解析方法的研究与实现
    所需E币：1
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    大小：408.34KB
    时间：2019.06.28
    上传者：xld0932
    针对TMS320C6727B扩展外设无法基于其硬件资源直接访问的问题，提出了一种重叠地址解析的外设扩展方法，可满足多个外设、外设多个寄存器或端口地址的访问控制。对外设地址空间构成解析、地址映射CPLD
  • 基于CPLD的TFT-LCD控制器设计
    所需E币：1
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    大小：587.5KB
    时间：2019.06.28
    上传者：xld0932
    现阶段TFT-LCD的应用不断加强，为了能够更方便控制TFT-LCD的显示，以AT070TN92液晶屏为例，提出一种基于CPLD的通用TFT-LCD显示控制器设计方案，该方案能准确实现TFT-LCD的
  • 基于CPLD的TFT-LCD RGB接口设计
    所需E币：1
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    大小：278.13KB
    时间：2019.06.28
    上传者：xld0932
    本设计阐述一种通用的接口设计方法，它用于有RGB接口的液晶屏。设计将阐述如何把复合视频信号转化为TFT－LCD所需的RGB数据接口，最后在液晶屏上显示。由于没有视频解码芯片可以直接将复合视频信号转成液
  • 基于CPLD的SPI-GPIO接口模块的设计
    所需E币：1
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    大小：775.57KB
    时间：2019.06.28
    上传者：xld0932
    本文设计了一种基于CPLD的SPI-GPIO模块，使得主芯片通过SPI接口与CPLD通信，以实现系统IO扩展的功能。鉴于CPLD中的功能模块应该在满足使用要求的情况下尽可能地降低模块所占用的资源和运行
  • 基于CPLD的SGPIO总线实现及应用
    所需E币：1
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    大小：443.6KB
    时间：2019.06.28
    上传者：xld0932
    分析了SGPIO总线的数据传输机制，用CPLD模拟SGPIO总线协议来实现并行数据的串行传输，并将其与串并数据转换集成芯片进行对比，说明了前者的应用优势，并且指出了其应用场合。采用LatticeDia
  • 基于CPLD的PCI总线接口设计
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    时间：2019.06.28
    上传者：xld0932
    文章的主要内容就是应用可编程器件CPLD来做PCI总线接口设计，并提出了一种以目前流行的可编程器件开发工具、硬件描述语言VHDL作为开发手段，实现PCI总线接口功能的设计。
  • 基于CPLD的PCI数据采集系统设计
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    大小：354.19KB
    时间：2019.06.28
    上传者：xld0932
    对基于CPLD（ComplexProgrammableLogicDevice）的PCI（PeripheralComponentInterconnect）数据采集系统的技术进行了探讨和研究。包括硬件电路
  • 基于CPLD的HDB3编码通信模块设计
    所需E币：1
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    大小：914.15KB
    时间：2019.06.28
    上传者：xld0932
    HDB3码是一种线路传输码，使用相当广泛，其传输码型是基带传输系统中经常采用的。HDB3码具有无直流分量和低频分量小，干扰能力较好和方便提取时钟抗等优点。本文阐述了HDB3码编码电路的基本原理，在Qu
  • 基于CPLD的FSK调制解调电路及其测试
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    大小：520.73KB
    时间：2019.06.28
    上传者：xld0932
    根据数字式ＦＳＫ调制和解调的工作原理，对比分析了基于ＣＰＬＤ和单片机的２种电路实现方案．设计了基于ＣＰＬＤ的ＦＳＫ调制解调模块，利用ＱｕａｒｔｕｓⅡ开发平台对ＣＰＬＤ进行编程，实现了ＦＳＫ调制与解调功
  • 基于CPLD的DDS信号发生器设计
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    大小：1022.04KB
    时间：2019.06.28
    上传者：xld0932
    介绍了DDS信号发生器的总体设计，详细阐述了各部分电路设计和硬件控制程序设计，最后进行了测试分析。
  • 基于CPLD的64位乘法运算器的设计
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    大小：668.91KB
    时间：2019.06.28
    上传者：xld0932
    提出了一种由64位加法器构成的以时序逻辑方式设计的64位宽位乘法器，此乘法器比纯组合逻辑构成的乘法占用硬件资源少，结构简单，基于VHDL语音模块化的设计，有利于器件的升级与位数扩充具有一定的实用价值。
  • 基于CPLD/FPGA器件的自动增益控制的探讨
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    大小：208.7KB
    时间：2019.06.28
    上传者：xld0932
    基于CPLD/FPGA器件的自动增益控制的探讨
  • 基于CPLD/FPGA平台I2C总线IP核的设计
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    大小：731.26KB
    时间：2019.06.28
    上传者：xld0932
    本文通过对一个I2C总线IP核的设计，介绍了用VHDL语言设计和实现该IP核的过程。首先简要地介绍了I2C总线协议的标准及应用，分析了影响8位MPU的传输速率低的因素，继而提出了基于CPLD/FPGA
  • 基于A8T9C5131单片机和CPLD的USB接口用户专用键盘设计
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    大小：145.3KB
    时间：2019.06.28
    上传者：xld0932
    随着时代的发展,科技的进步,以及某些特殊场合情况下控制模块的深入研究和快速发展,我们需要研究出一种满足用户可自定义按键功能要求的用户专用键盘模块。本设计采用带有USB微控制器单片机芯片AT89C513
  • 基于ARM+CPLD全数字伺服驱动器的设计与实现
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    时间：2019.06.28
    上传者：xld0932
    随着伺服驱动技术的飞速发展，动态响应时间、过载能力、调速范围、稳定性等都已成为现代伺服驱动器的性能评价指标。简述了矢量控制原理，设计了一款基于AＲM+CPLD的全数字交流伺服驱动器。实验证明:该伺服驱
  • 基于4DSP+FPGA架构数据处理板设计
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    时间：2019.06.28
    上传者：xld0932
    为了满足超高性能数据处理以及低功耗、简单可编程性的应用，设计了一款基于TITMS320C6678芯片和Xilinx公司XC5VSX95T芯片的4DSP+FPGA架构的数据处理板，同时设计了高带宽的数据
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