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McGraw.Hill写的vhdl设计编程教材
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时间：2020.02.14
上传者：二不过三
McGraw.Hill写的vhdl设计编程教材,McGraw……
mcgraw
免费资料 Art of Writing TestBenche...
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大小：121.74KB
时间：2020.02.14
上传者：quw431979_163.com
ArtofWritingTestBenchesArtofWritingTestBencheshttp://www.asic-world.com/verilog/art_testbench_writin
writing
testbenches
两种FPGA开发板PCB图及下载线
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大小：1.74MB
时间：2020.02.14
上传者：wsu_w_hotmail.com
两种FPGA开发板PCB图及下载线,FPGA开发板及下载线……
开发
板及
下载
Altera JTAG 并口下载线原理图PCB
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大小：129.4KB
时间：2020.02.14
上传者：givh79_163.com
AlteraJTAG并口下载线原理图PCB,7128-ByteBlasterII[1]……
7128-byteblasterii
发一篇NC_VERILOG的教程
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大小：656.87KB
时间：2020.02.14
上传者：2iot
发一篇NC_VERILOG的教程,nclaunch……
nclaunch
ISE8.1官方使用指南
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大小：1.96MB
时间：2020.02.14
上传者：978461154_qq
ise8tutISEIn-DepthTutorial8.2RRXilinxisdisclosingthisDocumentandIntellectualProperty(hereinafter“the
ise8tut
基于Verilog语言的帧同步的实现
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下载：0
大小：471.07KB
时间：2020.02.14
上传者：quw431979_163.com
基于Verilog语言的帧同步的实现,基于Verilog语言的帧同步的实现……
基于
verilog
语言
quartus2_官方资料
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大小：3.81MB
时间：2020.02.14
上传者：二不过三
quartus2_官方资料QuartusII简介AlteraCorporation101InnovationDriveSanJose,CA95134USA(408)544-7000www.altera
quartus2
官方
资料
testbench中有关文本读取方法的好资料（vhdl语言）...
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大小：164.53KB
时间：2020.02.14
上传者：238112554_qq
testbench中有关文本读取方法的好资料（vhdl语言）...,texio的用法……
texio
的用
学verilog一篇不错的文章
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大小：30KB
时间：2020.02.14
上传者：wsu_w_hotmail.com
学verilog一篇不错的文章转一个学verilog很好的文章规范很重要 工作过的朋友肯定知道，公司里是很强调规范的，特别是对于大的设计（无论软件还是硬件），不按照规范走几乎是不可实现的。逻辑设计也
verilog
一篇
不错
EFA做的Mentor公司软件最新CRACK（2006）
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大小：325.42KB
时间：2020.02.14
上传者：978461154_qq
EFA做的Mentor公司软件最新CRACK（2006）,2006161053312586……
2006161053312586
中文异步fifo设计
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大小：64.27KB
时间：2020.02.14
上传者：2iot
中文异步fifo设计,异步FIFO的FPGA实现……
异步
实现
HDL 编码风格与编码指南
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时间：2020.02.14
上传者：rdg1993
hdl编码风格HDL编码风格与编码指南HDL编码风格与编码指南Rev.0.1June30，2002第一部分：说明1.准则的重要程度分三个层次：好的经验--表明这条规则是一般情况下比较好的经验，在大多数
编码
风格
verilog hdl从算法设计到硬件逻辑的实现
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时间：2020.02.14
上传者：二不过三
veriloghdl从算法设计到硬件逻辑的实现,5679……
Veilog三段式状态机
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时间：2020.02.14
上传者：rdg1993
Veilog三段式状态机时序电路的状态是一个状态变量集合，这些状态变量在任意时刻的值都包含了为确定电路的未来行为而必需考虑的所有历史信息。状态机采用VerilogHDL语言编码，建议分为三个alway
veilog
三段
式状
Virtex II proFPGA开发板原理图上传1
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时间：2020.02.14
上传者：238112554_qq
VirtexIIproFPGA开发板原理图上传1,VirtexIIproFPGA开发板原理图上传2……
virtex
profpga
开发
ps2 接口的IP CORE(完整的Verilog HDL)
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大小：26.94KB
时间：2020.02.14
上传者：238112554_qq
ps2接口的IPCORE(完整的VerilogHDL),一个PS2IPCORE……
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