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    时间:2020.02.14
    上传者:rdg1993
    Veilog三段式状态机时序电路的状态是一个状态变量集合,这些状态变量在任意时刻的值都包含了为确定电路的未来行为而必需考虑的所有历史信息。状态机采用VerilogHDL语言编码,建议分为三个alway
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    时间:2020.02.14
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    VirtexIIproFPGA开发板原理图上传1,VirtexIIproFPGA开发板原理图上传2……
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    时间:2020.02.14
    上传者:238112554_qq
    ps2接口的IPCORE(完整的VerilogHDL),一个PS2IPCORE……
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    时间:2020.02.14
    上传者:givh79_163.com
    基于FPGA的等占空比任意整数分频器的设计仪器与仪表汪虹等:基于FPGA的等占空比任意整数分频器的设计基于FPGA的等占空比任意整数分频器的设计汪虹,李宏(宁波大学信息科学与工程学院浙江宁波31521
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    时间:2020.02.14
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    CADENCEPSD14_newCADENCEPSD14.0入门教程!"#$%&'()*+,-,./012345678&9):;?@AB!"!"##$%&'()*+,-.$"'%$(%&/012)3$
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    时间:2020.02.14
    上传者:978461154_qq
    用VHDL语言的CPLD器件设计,用VHDL语言的CPLD器件设计……
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    时间:2020.02.14
    上传者:2iot
    利用FPGA进行高速可变周期脉冲发生器设计利用FPGA进行高速可变周期脉冲发生器设计1概括      要求改变脉冲周期和输出脉冲个数的脉冲输出电路模块在许多工业领域都有运用。采用数字器件设计周期和输出
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    时间:2020.02.14
    上传者:微风DS
    Vhdl04072004Jul.03-5773693ext.159swchen@cic.org.twDouglasJSmith,“HDLChipDesign,”1997.,“VHDL,”,1998.M
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    时间:2020.02.14
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    邢建平和曾繁太所著《VHDL程序设计教程》,e_teaching_vhdl……
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    Hspice实战手册,Hspice实战手册……
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    FPGA_CPLD设计工具XilinxISE5.X使用详...,FPGA_CPLD设计工具XilinxISE5……
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    NIOS6完全破解,nios6crack……
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    dsp-bookDSPPRODUCTS:ADVANCEDDESIGNGUIDEEDITION1.0DSP:DesigningforOptimalResultsHigh-PerformanceDSPUs
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    时间:2020.02.14
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    ALTERA器件中文选型手册,ALTERA器件选型手册……
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    时间:2020.02.14
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    FPGA参考板3,)-,),)"",)%/%/,)..,)#01)#$%&'($)*$%&+,-!!!!"!.!&22-,,&,/////////1>;(/'//4;*'80;/>/0716;9>?*
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    EPM3064A_wwwMAX3000AProgrammableLogicDeviceFamilyDataSheetDecember2002,ver.3.2Features...■■■■■■■■■■H
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    时间:2020.02.14
    上传者:16245458_qq.com
    CPLD应用教程(免费),cpldyingyong……