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  • 2006年全球半导体公司最新排名
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    大小：31.74KB
    时间：2020.02.17
    上传者：二不过三
    2006年12月全球半导体公司最新排名……
    月全 球半 导体
  • SPICE DOCS
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    大小：69.5KB
    时间：2020.02.17
    上传者：wsu_w_hotmail.com
    spice使用NECSpiceBasicsCopyrightbydingsg&lixm一、先source~dingsg/.cshrc；假定已有PSPICE等SPICE工具基础。建议把shell里面的内
    spice 使用
  • dac vhdl code
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    大小：514.72KB
    时间：2020.02.17
    上传者：2iot
    dacvhdlcode,dac……
  • telescopic-fold opamp design r...
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    大小：649.93KB
    时间：2020.02.17
    上传者：978461154_qq
    Telescopic_pptMixedSignalVLSIDesignforTelecommunicationSystem,2003/FallFullyDifferentialOperationalA
    telescopic
  • pll jitter simulation
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    大小：339.54KB
    时间：2020.02.17
    上传者：givh79_163.com
    modelingjitterinpll7KH'HVLJQHUV*XLGHGRZQORDGHGIURPZZZGHVLJQHUVJXLGHFRPModelingJitterinPLL-basedFrequ
    modelingjitterinpll
  • simulation of Sigma-Delta modu...
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    大小：263.95KB
    时间：2020.02.17
    上传者：2iot
    simulationofSigma-Deltamodu...,SDT……
  • 跨时钟域异步电路处理
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    大小：158.76KB
    时间：2020.02.17
    上传者：978461154_qq
    跨时钟域异步电路处理只有最初级的逻辑电路才使用单一的时钟。大多数与数据传输相关的应用都有与生俱来的挑战，即跨越多个时钟域的数据移动，例如磁盘控制器、CDROM/DVD控制器、调制解调器、网卡以及网络处
    跨时 钟域 异步
  • 综合工具教程
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    大小：928.42KB
    时间：2020.02.17
    上传者：givh79_163.com
    综合工具教程,Pro_intro_72……
    intro
  • clock tree synthesis
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    大小：1.14MB
    时间：2020.02.17
    上传者：2iot
    clocktreesynthesis,ICCompilers_ClockTreeSynthesis……
    compilers clocktreesynthesis
  • IC设计流程介绍
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    大小：486KB
    时间：2020.02.17
    上传者：wsu_w_hotmail.com
    IC设计流程介绍,IC_design_flow……
    Design
  • 版图设计
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    大小：119.13KB
    时间：2020.02.17
    上传者：二不过三
    版图设计,版图设计……
    版图 设计
  • 硬件人员必看经验总结
    所需E币：3
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    大小：5.63KB
    时间：2020.02.17
    上传者：quw431979_163.com
    硬件人员必看经验总结,硬件人员必看经验总结……
    硬件 人员 必看
  • 有关cadence 的一些资料大家共享
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    大小：1.6MB
    时间：2020.02.17
    上传者：quw431979_163.com
    有关cadence的一些资料大家共享,cadence教程……
    cadence 教程
  • cmos基准电压源的设计
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    大小：180.67KB
    时间：2020.02.17
    上传者：978461154_qq
    cmos基准电压源的设计,一种工作在亚阈值区的低功耗基准电压电路……
    一种 工作 在亚
  • systemverilog中文手册
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    大小：718.45KB
    时间：2020.02.17
    上传者：rdg1993
    systemverilog中文手册,SystemVerilog3[1]……
    systemverilog
  • smartspice
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    大小：700.94KB
    时间：2020.02.17
    上传者：rdg1993
    smartspice,smartspice……
    smartspice
  • verilog_parameter
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    大小：81.28KB
    时间：2020.02.17
    上传者：978461154_qq
    HDL_ParametersNewVerilog-2001TechniquesforCreatingParameterizedModels(orDownWith`defineandDeathofade
    parameters
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