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用CPLD设计自动检测的多路数据选择器的困扰!
2008-11-7 10:26
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分类:
FPGA/CPLD
用CPLD设计自动检测的多路数据选择器的困扰!
普通的多路数据选择器是通过地址线来选择哪一路输出的,我现在做的是要自动检测到那一路有脉冲来了,就自动锁定该路输出,等检测完数据后,通过复位脚重新开始扫描多路输入线,请
高手
指点迷津,谢谢。
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用户1017182
2009-3-10 10:13
THKS
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用户124183
2008-11-13 19:59
你把HDL语言里的关于状态机的那一节好好看看,自然会明白的~
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用户1017182
2008-11-11 15:30
大侠 能够给予详细的指导吗?
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ilove314_323192455
2008-11-9 08:24
LS有理,但是用状态机做这个事可能我相对多耗费一些资源
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用户124183
2008-11-7 22:31
你用状态机来做嘛,当任意一路信号输入的时候就进入处理状态,处理完了再跳到等待信号输入的状态。
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好...
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