用户1609127的文章-第2页-面包板社区

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用户1609127 2011-1-8 14:29: 他和它的故事 Verilog HDL 之仿真前的故事 & 刺激和激励过程; 目录第五章仿真前的故事 5.01 我眼中的仿真 5.02 激励的故事 5.03 仿真的虚拟环境 5.04 综合和仿真总结下载目录 ...; 2577 11 0 11

用户1609127 2011-1-5 18:19: 我眼中的仿真; 我眼中的仿真关于仿真这东西给笔者很纠结。在笔者的眼里，笔者把仿真看成是学习Verilog HDL语言之后的功课。网上常有的一套学习方法就是一边学习用Veril ...; 1756 10 2 12

用户1609127 2010-12-26 14:53: 他和它的故事之 Verilog HDL 模块的沟通; 目录第四章模块的沟通 4.01 探讨Start_Sig 和 Done_Sig 的协调性 4.02 同步FIFO 实验十七：同步FIFO ...; 2572 9 0 9

用户1609127 2010-12-15 10:34: 他和它的故事之 Verilog HDL 流水操作和建模; 目录前言目录第三章流水操作和建模 3.01 流水操作的概念 3.02 仿顺序操作向流水操作的转换实验十一：流 ...; 2272 10 0 10

用户1609127 2010-12-11 15:36: 他和它的故事之 VerilogHDL 整数除法器; 目录前言 02 目录 03 第二章整数除法器 04 2.01 传统的除法器 04 实验八：传统除法器 05 2.02 循环型除法器 09 实验九：传统乘 ...; 3189 9 0 9

用户1609127 2010-12-5 16:27: Verilog HDL 那些事儿 - 全. PDF ver3; 目录：书语 9 第一章前言 11 — — 我眼中的FPGA和Verilog HDL 11 第二章：低级建模 - 基 ...; 6559 9 7 16

用户1609127 2010-11-26 10:50: 他和它的故事之 Verilog HDL 整数乘法器; 目录：第一章整数乘法器 1.01 整数的概念 1.02 传统乘法的概念实验一：传统乘法器 1.03 传统乘法器的改进实验二：传统乘法 ...; 3071 9 2 11

用户1609127 2010-11-25 19:25: [预告] 个人学习笔记他和它的故事之 Verilog HDL 整数乘法器; 目录：第一章整数乘法器 1.01 整数的概念 1.02 传统乘法的概念 ? ? ? ? ?实验一：传统乘法器 1.0 ...; 1673 7 0 7

用户1609127 2010-8-29 19:50: CAN学习笔记全 - 补完; 哎终于在网上的各个地方补完了！不好意思~不知道自己的eeload空间已经完蛋了。果然还是大公司的网盘好！对于没有下载到笔记的朋友，来补完吧。下载 ...; 2639 9 1 10

用户1609127 2010-8-25 20:01: [Verilog HDL建模技巧] - 低级建模 · VGA全驱动; 原文是《Verilog HDL那些事儿》第3.3 章！但是这本笔记目前还没有写完！这一章笔记有关于VGA驱动，觉得有很大的参考和学习价值，所以就独立出来了！嗯！ ...; 3079 9 3 12

用户1609127 2010-8-12 10:38: 新一番的笔记; 从两个星期前，着手拿到来至 heijin 社区的 nios 开发板。想必自己已经有1个月的时间没有触碰Verilog HDL 语言了。在练习NIOS之前，先来热身热身Verilog ...; 2067 10 0 10

用户1609127 2010-6-5 17:54: [Verilog HDL 建模技巧：低级建模仿顺序操作 ? 思路篇] 完 - 总结+PDF+源码; 总结：实际上“低级建模”不是一个完美的东西，它本身就存在很多缺陷，如：建模量很大等 ... 除此之外，“低级建模”在“时序”上还是很弱 ...; 3479 7 8 15

用户1609127 2010-6-5 17:35: Verilog HDL 建模技巧：低级建模仿顺序操作·思路篇]12 - 再一次组织起来; 4. 4 : 再一次“组织”起来： ?xml:namespace prefix = o ns = "urn:schemas-microsoft-com:office:office" / 这一章，我们要讲 eff ...; 2697 7 0 7

用户1609127 2010-6-5 17:16: [Verilog HDL 建模技巧：低级建模仿顺序操作·思路篇]11 - 产生效果的低级功能模块; 4. 3 建立“产生效果”的 “低级功能模块” ?xml:namespace prefix = o ns = "urn:schemas-microsoft-com:office:office" / 首 ...; 2256 7 1 8

用户1609127 2010-6-5 17:01: [Verilog HDL 建模技巧：低级建模仿顺序操作·思路篇] 10 - 组织模块和两义性问题; 4.2 “低级功能模块”封装和“两义性”或者“多义性”的问题 ?xml:namespace prefix = o ns = "urn:schemas-microsoft-com:office:office" / ...; 2499 6 1 7

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