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基于单片机的可控时序发生器设计
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时间:2019.06.28
上传者:xld0932
文章根据脉冲中子氧活化测井的实际需要,利用单片机c8051F060为核心器件,配合CPLD的丰富资源设计了一种可控的中子爆发时序发生器,能够实现中子爆发时间和中子发生器高压的地面控制。
基于STM32和CPLD的手机测试控制系统
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时间:2019.06.28
上传者:xld0932
为了满足移动终端通信测试当中对终端手机的控制,要求机架中80部终端手机均可独立操作。设计了一个基于STM32和CPLD的终端手机测试控制系统,该系统支持80个独立带启动开关的定时器,并且通过以太网可以
基于MACHXL的CRC编码和校验电路的实现
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大小:267.46KB
时间:2019.06.28
上传者:xld0932
基于MACHXL的CRC编码和校验电路的实现
基于LPC1764的多道脉冲幅度分析器的电路设计
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大小:1.71MB
时间:2019.06.28
上传者:xld0932
为解决核辐射测量的实时性问题,设计了基于ARMCortex⁃M3内核的LPC1764处理器、CPLD和高速A/D转换等芯片构造多道脉冲幅度分析器的电路系统,该系统使用CPLD对高速A/D转换数据进行处
基于Linux的CPLD在系统升级驱动程序设计
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时间:2019.06.28
上传者:xld0932
论述了通过微控制器实现CPLD在系统升级的方法。以AT91SAM9260CPU为硬件平台,以Linux2.6.30内核为系统软件平台,基于Xilinx官方JTAG状态机实现源码,编写了CPLD在系统升
基于EPM240T100和TB6560的步进电机控制系统
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大小:501.39KB
时间:2019.06.28
上传者:xld0932
为解决常规步进电机集成功率驱动芯片的驱动电流不够、外围电路复杂等问题,提出以CPLD芯片EPM240T100作为核心控制芯片,以TB6560为步进电机的驱动芯片,实现了该基于EPM240T100和TB
基于DSP与CPLD的惯性器件数据采集与预处理系统设计
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大小:575.18KB
时间:2019.06.28
上传者:xld0932
在比较了MCU、DSP、FPGA等器件的特性后,设计了一种以DSP为核心控制器件,以CPLD为并行计数器件的惯性器件数据采集与预处理系统;实现了对惯性器件数据的实时采集与预处理,并通过串口完成与上位机
基于DSP和CPLD的掌纹图像采集系统设计
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大小:605.05KB
时间:2019.06.28
上传者:xld0932
针对掌纹识别系统中的图像采集问题,提出了一种基于DSP和CPLD的掌纹图像采集系统的设计方法。将DSP的特殊设计结构作为算法处理核心,对掌纹图像进行采集、存储和处理。采用OV7620作为掌纹传感器,并
基于DSP的电能谐波含量实时监测装置
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时间:2019.06.28
上传者:xld0932
设计了一种基于DSP的电能质量实时监测装置。该装置以霍尔传感器和并行A/D转换芯片组成前向采集电路,以数字信号处理器(DSP)作为数据处理电路,并以快速傅立叶变换为主要处理算法。利用微型计算机DSP强
基于DSP28335的飞控计算机DAC扩展电路设计
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时间:2019.06.28
上传者:xld0932
为了实现UAV的舵机和油门调节控制的需要,飞控计算机系统采用BURR-BROWM公司的D/A芯片DAC7725N来设计D/A扩展模块。使用CPLD实现接口逻辑,简化了电路设计,后续的系统调试验证表明,
基于DSP&CPLD的8kW电压型PWM整流器设计
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大小:826.87KB
时间:2019.06.28
上传者:xld0932
基于DSP和CPLD芯片,研究了8kW电压型PWM整流器的硬件电路和软件设计。硬件设计包括主电路设计、控制电路设计、驱动电路设计和信号调理电路设计等部分。软件部分引入电压矢量控制策略,并给出了基于DS
基于DM642和CPLD的图像采集处理系统设计
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时间:2019.06.28
上传者:xld0932
基于DM642和CPLD的图像采集处理系统设计
基于CPLD与单片机技术设计的DDS频率合成器电路
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时间:2019.06.28
上传者:xld0932
基于CPLD与单片机技术设计的DDS频率合成器电路
基于CPLD实现QPSK调制电路的设计与研究
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时间:2019.06.28
上传者:xld0932
设计是基于实现涨调制,选用肌即公司生产的山州产汉系列芯片。是一种数字调制方式。该调制方式具有须谱利用率高、抗干扰性强的特点。本设计还给出了硬件模块的设计思路,其组成由基带信号产生电路模块、调制电路模块
基于CPLD器件的智能交通灯控制系统设计
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时间:2019.06.28
上传者:xld0932
针对目前车辆流量的不断增加,交通灯指挥控制系统设置不合理引起的交通堵塞日益严重的现象,提出了一种基于复杂可编程逻辑器件(Complexprogrammablelogicdevice,CPLD)的智能型
基于CPLD内置UFM的嵌入式加速度采集系统
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大小:1.18MB
时间:2019.06.28
上传者:xld0932
介绍了一种基于CPLD内置UFM(userflashmemory)的嵌入式加速度数据采集系统,并给出了各个功能模块的实现方法。整个采集系统主要包括电荷放大器模块、信号调理模块、A/D转换模块、CPLD
基于CPLD技术的FPGA快速加载方案研究
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时间:2019.06.28
上传者:xld0932
因为FPGA具有可编程与可升级的具体特点,其已经被广泛地运用在现代化通信系统中。同时其存在着一定程度的易失性缺陷,每次进行上电之后都需要对FPGA进行重新加载。伴随着现代化通信系统复杂程度的不断提升,
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