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    时间:2019.06.28
    上传者:xld0932
    信号处理器是常规天气雷达数字化系统的关键部件.利用复杂可编程逻辑器件(CPLD)产生整个信号处理器时序控制逻辑信号,通过移位运算,直接进行硬件积分处理.实现雷达信号的采集、处理、质量控制、天线控制以及
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    时间:2019.06.28
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    介绍了一种基于CPLD的对转无刷直流电动机的换相逻辑方案,采用CPLD简化了系统结构,提高了系统工作的稳定性和可靠性。使用VHDL语言设计了对转无刷直流电动机的换相控制程序,在QuartusⅡ开发平台
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    时间:2019.06.28
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    运用可编程逻辑器件CPLD设计了一款并网光伏发电控制器。该控制器由CPLD开发平台、温度传感器、接口电路组成,充电采用PWM方式控制。该控制器具有自动运行、双向切换的功能,可杜绝孤岛效应,并可对蓄电池
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    时间:2019.06.28
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    存储测试技术是建立在超大规模集成电路和计算机技术基础之上的现代测试技术。存储测试系统是为完成存储测试目的而设计的物理系统,它工作在高温、高压、强冲击振动、高过载等恶劣环境和紧凑设计条件下,自动完成被测
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    时间:2019.06.28
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    CPLD是大规模集成电路技术发展的产物,是一种半定制的集成电路。结合计算机软件技术(EDA技术)可以快速、方便地构建数字系统。文章重点介绍了CPLD和PC机之间的异步串行接口间的通信。设计中采用多模块
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    时间:2019.06.28
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    随着社会的进步、人民生活水平的提高,人们对微型风扇的自动化、智能化和人性化控制系统的需求日益增加。本文基于CPLD开发平台,利用温度、湿度和光强传感器,采用自动和手工调节两种工作模式,设计并实现了一套
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    时间:2019.06.28
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    远程监控技术的应用随着日益发展的现代安防技术而变得越来越广泛。而由光纤作为传输介质的数字光端机,已经成为远程监控应用中的首选。本文详细介绍了数字光端机的架构与工作原理,完成基于CPLD的无压缩2路视频
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    时间:2019.06.28
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    基于编程逻辑器件CPLD进行数字示波器设计,系统硬件设计选用Altera公司的EPM240型芯片,软件系统使用QuartusⅡ进行设计,整个系统在一个芯片上实现。信号通过快速的ADC进行采集,采集的数
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    时间:2019.06.28
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    简述了一种基于CPLD的数字钟设计方案,文中所设计的数字钟是一种用数字电路技术实现时、分、秒计时的装置,与机械式时钟相比具有更高的准确性和直观性,且无机械装置,具有更长的使用寿命,因此得到了广泛的使用
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    时间:2019.06.28
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    针时自主研发的脉冲辐射剂量探测系统,首先介绍了其光纤远程实时传输链路的组成。然后在分析数据接收单元电路结构和主要信号特点的基础上,设计并实现了基于CPLD功的数据接收与上传的逻样控制。CPLD一方面要
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    时间:2019.06.28
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    电流源是各类设备的核心组件之一。设计了一种以CPLD为核心的数控电流源系统,所需电流值由键盘输入,CPLD控制DAC产生模拟电压控制VCCS,引入了功放电路,产生驱动能力充分的电流输出。结果表明,该系
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    时间:2019.06.28
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    针对固定部分的控制器与外部旋转执行机构之间的信号传输问题,对旋转联接部件信号传输控制系统的电路构成、控制模块与信号通信编解码等方面进行了研究,对旋转联接部件中的光通信过程进行了归纳,提出了一种以大规模
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    时间:2019.06.28
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    随着可编程逻辑器件的发展,EDA技术已成为硬件系统电路设计的重要手段。本文提出了一种基于EDA技术,采用自顶向下的设计方法,能够快速设计、开发智能密码锁的方案,并阐述了其工作原理和软硬结合的设计理念。
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    时间:2019.06.28
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    在进口某型空空导弹的测试修理中,导引头位标器故障率较高。为进一步降低故障分析难度,提高故障定位准确率,本文设计了基于CPLD的导引头位标器角度实时监测系统。经试验验证,该系统稳定可靠、功能完善、抗干扰
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    时间:2019.06.28
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    针对某型航管应答机串行控制接口电气特性、时序关系和数据定义的特殊要求,设计了以CPLD最小应用系统为核心,并扩展RS-232和三线控制接口电平转换的硬件电路,编制了基于计数器触发的输出接口信号状态转换
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    时间:2019.06.28
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    简述了磁通门传感器技术中二次谐波法的原理,用软磁材料坡莫合金制作传感器探头磁芯,设计了基于CPLD的正交磁通门传感器。传感器能够实现水平载体的航向角数值,在0°~360°范围内航向角的测量精度可达1°
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    时间:2019.06.28
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    介绍一种采用复杂可编程逻辑器件(CPLD)对正交编码信号采集和处理的设计。为提高光电增量编码器的解码精度,以CPLD为控制核心,设计信号采集、信号处理和硬件驱动3个模块。采用VHDL硬件描述语