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  • ROM 讀寫 soure code
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    时间：2020.02.14
    上传者：rdg1993
    ROM讀寫sourecode,Winbond_LD_code……
    winbond
  • 标准状态机书写
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    时间：2020.02.14
    上传者：微风DS
    标准状态机书写,标准状态机书写……
    标准 状态 机书
  • (同步电路)优秀设计的十条规律
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    大小：89.54KB
    时间：2020.02.14
    上传者：微风DS
    (同步电路)优秀设计的十条规律,(同步电路)优秀设计的十条规律……
    同步 电路 优秀
  • FPGA快速入门教程
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    大小：2.04MB
    时间：2020.02.14
    上传者：二不过三
    FPGA快速入门教程……
    快速 入门 教程
  • IP core 小组的HDL设计风格，有价值！
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    大小：178.67KB
    时间：2020.02.14
    上传者：978461154_qq
    HDL设计风格IPCore开发小组HDL编码风格与编码指导dr.xuxin@163.netHDL编码风格与编码指南草案初稿作者徐欣孙广富Rev.0.1June30，2002www.IPcore.com
    设计 风格
  • Verilog实例 产生正弦波
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    大小：103.18KB
    时间：2020.02.14
    上传者：238112554_qq
    Verilog实例产生正弦波,sine……
  • ＦＰＧＡ在软件无线电中的应用
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    时间：2020.02.14
    上传者：rdg1993
    FPGA在软件无线电中的应用作者：Altera公司技术市场经理JoelA.Seely来源：《今日电子》||||| ||FPGA在软件无线电中的应用||[pic]|| ||摘要：本文结合各种实际测试介绍
    在软 件无 线电
  • Synplify使用教程
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    时间：2020.02.14
    上传者：二不过三
    Synplify使用教程,synplicity使用……
    synplicity 使用
  • FPGA设计中的时序分析及异步设计注意事项
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    大小：128.7KB
    时间：2020.02.14
    上传者：2iot
    FPGA设计中的时序分析及异步设计注意事项FPGA设计中的时序分析及异步设计注意事项什么是建立和保持时间建立时间和保持时间：建立时间和保持时间：建立时间（建立时间（setuptime）：是指在触发器的
    设计 中的 时序
  • McGraw.Hill.VHDL.Programming.b...
    所需E币：5
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    大小：2.3MB
    时间：2020.02.14
    上传者：16245458_qq.com
    McGrawVHDL:ProgrammingbyExampleDouglasL.PerryFourthEditionMcGraw-HillNewYorkChicagoSanFranciscoLisbo
    mcgraw
  • VHDL中的信号与变量
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    大小：194.38KB
    时间：2020.02.14
    上传者：978461154_qq
    VHDL中的信号与变量维普资讯http://www.cqvip.com第３２卷第１１期２００６年１１月电字工暖师ＥＬＥＣＴＲＯＮＩＣＥＮＧＩＮＥＥＲＶ（）１．３２Ｎ０．１ｌＮＯＶ．２ｏ０６ＶＨＤＬ中的
    中的 信号 与变
  • 经验点滴－－QUARTUS及其FPGA的外围电路
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    大小：171.01KB
    时间：2020.02.14
    上传者：238112554_qq
    经验点滴－－QUARTUS及其FPGA的外围电路,经验点滴－－QUARTUS及其FPGA的外围电路……
    经验 点滴 --quartus
  • Power Management Design Guide ...
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    大小：1.16MB
    时间：2020.02.14
    上传者：238112554_qq
    NationalAlteraDesignGuidePowerManagementDesignGuideforAlteraFPGAsandCPLDsSpring2005Alteradevicescove
  • 用VHDL实现的开方运算
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    大小：115.92KB
    时间：2020.02.14
    上传者：2iot
    用VHDL实现的开方运算２００４年３月第２３卷第１期业学院学报沈阳工维普资讯http://www.cqvip.comｖ０１．２３Ｎ０．１ＪＯＵＲＮＡＬＯＦＳＨＥＮＹＡＮＧＩＮＳＴＩＴＵＴＥＯＦ１ＥＣＨ
    实现 的开 方运
  • 将kariday的“全数字FM接收机”转为全免费的。
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    时间：2020.02.14
    上传者：238112554_qq
    全数字FM接收机DesignofAllDigitalFMReceiverCircuitNursaniRahmatullahMarch2005TableofContentsTableofContents
    全数 接收
  • VHDL 帮助文件，供VHDL的学习和使用者查询
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    时间：2020.02.14
    上传者：givh79_163.com
    VHDL帮助文件，供VHDL的学习和使用者查询,VHDL帮助文件，供VHDL的学习和使用者查询……
    帮助 文件 的学
  • Verilog编码规范.doc
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    时间：2020.02.14
    上传者：2iot
    Verilog编码规范Verilog编码规范！|一.强调Verilog代码编写风格的必要性。||强调Verilog代码编写规范，经常是一个不太受欢迎的话题，但却是非常有||必要的。||每个代码编写者都
    verilog 编码 规范
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