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责任全在软件 2023-3-18 21:58: 【数字IC】高级IC程序设计（12）SoC 的卷积神经网络车牌识别系统设计; 随着 2018 年中兴制裁事件和 2019 年华为制裁事件的发生，一下子打破了中国芯片技术的“繁华”，引发了中国芯片市场的“危机”。是的，我们的核心技术 ...; 642 6 0 6

责任全在软件 2023-3-18 21:57: 【数字IC】高级数字 IC 设计（11）数字形态学设计; 在数学形态学中（Morphology），闭运算被定义为先膨胀后腐蚀，反之，开运算被定义为先腐蚀后膨胀。膨胀与腐蚀（Dilate and Erode）操作被 ...; 409 7 0 7

责任全在软件 2023-3-18 21:54: 【数字IC】高级数字 IC 设计（10）Sobel 设计; Sobel算法是做图像的必备技能，其设计流程如下： mif文件的制作→ 调用ip核生成rom以及仿真注意问题→ 灰度处理→ 均值滤波：重点是3*3 像素阵列 ...; 622 6 0 6

责任全在软件 2023-3-18 21:52: 【数字IC】高级数字 IC 设计（9）单口 RAM、同步 FIFO、异步 FIFO 的设计; 使用单口RAM实现FIFO，其实很简单，其中的重点就是区分出读写，读写如果同时启动，你肯定会思考单口RAM肯定会出问题，毕竟单口RAM只有一个口，肯定不能实现同时 ...; 707 10 0 10

责任全在软件 2023-3-18 21:49: 【数字IC】高级数字 IC 设计（8）有限状态机分割设计; 有限状态机分割设计，其实质就是一个状态机分割成多个状态机，或者说多个状态机的协同设计来实现一个较为复杂的状态跳转设计，例如说玩游戏的一个状态跳转，玩 ...; 831 9 0 9

责任全在软件 2023-3-18 21:47: 【数字IC】高级数字 IC 设计（7）基于 PE 的脉动阵列设计; 脉动阵列指的是多个相同的处理单元（简称 PE），按一定互联规则组成的网络，即称之为脉动阵列。脉动阵列可以是一维线形、二维矩形、二维二叉树型、三维长方体 ...; 1396 7 0 7

责任全在软件 2023-3-18 21:34: 【数字IC】高级数字 IC 设计（6）Booth 乘法器设计; 乘法器想必大家都知道是干什么用的，普通的乘法器的实现是基于乘法可以转换成加法这一事实。比如 3×4 实际上可以理解成 3 个 4 相加。笔者翻遍资料发现 ...; 870 10 0 10

责任全在软件 2023-3-18 21:32: 【数字IC】高级数字 IC 设计（5）Alpha 半透明图像叠加设计; Alpha 通道是一个 8 位的灰度通道，该通道采用 2^8 = 256 级灰度来记录图像中的透明度信息，定义全透明、半透明和不透明区域，其中黑色表示全透明， ...; 420 4 0 4

责任全在软件 2023-3-18 21:31: 【数字IC】高级数字 IC 设计（4）灰度转二值化设计; 这是一个能够成功上板实现的灰度转二值的 Verilog 程序设计，详细的数据延时与信号延时如下所示：首先是输入 RGB 数据信 ...; 522 5 0 5

责任全在软件 2023-3-18 21:29: 【数字IC】高级数字 IC 设计（3）VGA 彩色条显示设计（480P）; 本文分享一下 VGA 显示的代码范例，480P满足一般需求。通过代码注释可以快速了解到寄存器的使用和水平竖直像素定位的方式和方法，适合初学者入 ...; 759 6 0 6

责任全在软件 2023-3-18 21:28: 【数字IC】技能拓展（2）Xilinx_Vivado_SDK_2019.1 开发指导; 芯片设计是非常依赖于工具的，设想一下，如果没有 EDA 工具的支持，如何去勾勒出一个具有上亿个晶体管的海思麒麟 SoC 芯片呢？是的，学习一门技 ...; 802 5 0 5

责任全在软件 2023-3-18 21:26: 【数字IC】技能拓展（1）Xilinx_Vivado_SDK_2019.1 安装指导; 工欲善其事，必先利其器，君之“器”尚无，如何谈“事”呢？事不宜迟，数字 IC 设计工程师或者 FPGA 开发工程师需要赶紧下载和安装一个 Xilinx Vivado 软 ...; 850 6 0 6

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