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  • 中兴_滤波器指南
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    时间：2019.08.01
    上传者：eeNick
    滤波器是一种二端口网络。它具有选择频率的特性，即可以让某些频率顺利通过，而对其它频率则加以阻拦，目前由于在雷达、微波、通讯等部门，多频率工作越来越普遍，对分隔频率的要求也相应提高；所以需用大量的滤波器
    滤波器
  • 再谈DDR内存布线
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    时间：2019.08.01
    上传者：eeNick
    在现代高速数字电路的设计过程中，工程师总是不可避免的会与DDR或者DDR2，SDRAM打交道。DDR的工作频率很高，因此，DDR的布线（或者Layout）也就成为了一个十分关键的问题，很多时候，DDR
    ddr
  • SDRAM与DDR布线指南
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    时间：2019.08.01
    上传者：eeNick
    很多人对内存布线感到迷茫，找不到切入点，不知如何下手，其实高速硬件设计的主要任务就是与干扰做斗争，内存布线也不例外。可以这样考虑：内存是做什么用的呢？是用来存储数据的，写入1读出1，写入0读出0，即保
    SDRAM
  • SDRAM的原理和时序
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    时间：2019.08.01
    上传者：eeNick
    一、SDRAM内存模组与基本结构我们平时看到的SDRAM都是以模组形式出现，为什么要做成这种形式呢？这首先要接触到两个概念：物理Bank与芯片位宽。
    SDRAM
  • SDRAM的结构、时序与性能的关系
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    时间：2019.08.01
    上传者：eeNick
    仓库物语货物基地（主板）连接着物资（数据）的供求方。基地的货物调度厂房（北桥芯片）掌管着若干个用于临时供货/生产与存储的仓库基地（P-Bank），它们通常隶属于某一仓储集团（DIMM），这种基地与调度
    SDRAM
  • DDR内存条的设计
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    时间：2019.08.01
    上传者：eeNick
    UseSingleParallelTerminationResistorWithSeriesResistormLowersystemcostmEasiermotherboardroutemImprov
    ddr
  • DDR的原理和时序
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    时间：2019.08.01
    上传者：eeNick
    DDR的原理和时序DDRSDRAM全称为DoubleDataRateSDRAM，中文名为“双倍数据流SDRAM”。DDRSDRAM在原有的SDRAM的基础上改进而来。也正因为如此，DDR能够凭借着转产
    ddr
  • DDRII的PCB设计
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    时间：2019.08.01
    上传者：eeNick
    包括DDRII系列概述，PCB各种布线布局设计，及综合案例
    pcb设计
  • DDRII
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    时间：2019.08.01
    上传者：eeNick
    DDRII全英文书籍资料，供您参考
    ddr
  • DDR3走线及绕线规则
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    时间：2019.08.01
    上传者：328230725_895182095
    （二）绕线Clktofistsdram
    走线
  • 《高速数字设计》 第二章逻辑门电路的高速特性
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    时间：2019.08.01
    上传者：328230725_895182095
    主要内容功率速度封装三者是紧密相关的
    逻辑门电路
  • 数字电路工作原理
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    时间：2019.08.01
    上传者：328230725_895182095
    内容数字电路的分类基本结构和特点电路特性电路互连电路选型基本原则
    数字电路
  • 高速数字设计和信号完整性分析——电源分布系统设计
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    大小：823.68KB
    时间：2019.08.01
    上传者：328230725_895182095
    内容基本概念设计目标一般设计规则多层板叠层结构电流回路去耦电容及其应用噪声抑制
    电源
  • 高速数字设计和信号完整性分析-导论
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    时间：2019.08.01
    上传者：328230725_895182095
    高速数字设计（High-SpeedDigitalDesign）强调被动元件的特性及其对电气性能的影响，包括导线、印制电路板以及集成电路封装等等。高速数字设计研究被动元件如何影响信号传输（振铃和反射），
    高速数字设计
  • 系统设计中时钟、时序相关问题
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    时间：2019.08.01
    上传者：328230725_895182095
    1，跟时钟相关的参数概念与分析2，时钟树3，PLL与DLL4，基于Latch进行设计与TimeBorrow5，ASIC设计中的时钟使用的基本原则6，门控时钟设计的相关技术7，改善系统时钟性能以及提高性
    系统设计
  • 如何区分高速和低速
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    时间：2019.08.01
    上传者：328230725_895182095
    要判断一个信号是否为高速信号首先要区分几个误区。
    高速
  • 高速电路板布板指
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    时间：2019.08.01
    上传者：328230725_895182095
    引言随着器件引脚密度和系统频率的增大，印刷电路板(PCB)布板越来越复杂。成功的高速电路板应能够高效的集成器件和其他模块，避免出现与高速I/O标准相关的信号传输问题。Altera®器件具有高速I/O引
    电路板布板
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