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布局准则,最大限度地提高汽车电源的性能和减少排放
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时间:2020.03.06
上传者:238112554_qq
摘要:当使用高频开关稳压器,汽车电源将提供一个清洁的输出电源中的电磁干扰(EMI)室保存时间调试排放问题的一个很好的PCB布局。本应用笔记介绍如何布局MAX16903/MAX16904的开关稳压器,以
maxim
automotive
dcdc
Virtex-7 FPGA产品性能和容量优化
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大小:400.47KB
时间:2020.03.11
上传者:16245458_qq.com
Virtex-7FPGA产品的最高的系统性能和容量优化。7SERIESFPGAS;,/,1;9,57(;)3*$69LUWH[)3*$V2SWLPL]HGIRU+LJKHVW6\VWHP3HUIRUP
Xilinx
fpga
virtex-7
7系列FPGA的配置
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大小:3.32MB
时间:2020.03.11
上传者:238112554_qq
赛灵思7系列FPGA包括三个FPGA家族,都是统一最低的功耗设计,使整个家族共同的设计规模为最佳的功率,性能和成本。本指南作为技术参考讲述的7系列FPGA的配置。7SeriesFPGAsConfigu
Xilinx
fpga
基于单片机的GPS定位显示系统
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时间:2019.12.23
上传者:238112554_qq
基于单片机的GPS定位显示系统……
嵌入式
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mcu
7系列DSP48E1片
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时间:2020.03.11
上传者:238112554_qq
赛灵思7系列FPGA包括三个FPGA家族,都是统一最低的功耗设计,使整个家族共同的设计规模为最佳的功率,性能和成本。本指南作为技术参考讲述的7系列DSP48E1片。7SeriesDSP48E1Slic
Xilinx
fpga
dsp48e1
易于理解的解释校准触摸屏系统
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时间:2020.03.06
上传者:978461154_qq
摘要:机械错位和缩放因素导致的触摸屏面板(触摸屏控制器翻译)和(通常是一个液晶显示器)上安装触摸屏显示未来值之间的不匹配。本教程讨论如何校准触摸屏,以配合显示。Maxim>DesignSupport>
maxim
touch
screen
coding style
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时间:2020.03.06
上传者:微风DS
codingstyle海思高校合作——QA培训资料1.RTLCODE规范1.标准的文件头在每一个版块的开头一定要使用统一的文件头,其中包括作者名,模块名,创建日期,概要,更改记录,版权等必要信息。统一
coding
style
fpga
7系列FPGA的PCB设计和引脚规划指南
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大小:3.31MB
时间:2020.03.11
上传者:givh79_163.com
本指南提供7系列FPGA的PCB设计和引脚规划的信息,用在PCB和接口层的设计决策的战略重点。7SeriesFPGAsPCBDesignandPinPlanningGuideUG483(v1.3)De
Xilinx
fpga
pcb
华为FPGA设计流程指南
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时间:2020.01.07
上传者:rdg1993
华为FPGA设计流程指南FPGA设计流程指南前言本部门所承担的FPGA设计任务主要是两方面的作用:系统的原型实现和ASIC的原型验证。编写本流程的目的是:•在于规范整个设计流程,实现开发的合理性、一致
华为
Verilog典型电路设计 华为
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时间:2020.01.07
上传者:givh79_163.com
Verilog典型电路设计华为VerilogHDL&'($%!"#S%&QR……
verilog
典型电路设计
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Verilog HDL 华为入门教程
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时间:2020.01.07
上传者:978461154_qq
VerilogHDL华为入门教程文档编号版本密级文档中心1.0内部公开资源类别:HDL语言共41页VerilogHDL入门教程(仅供内部使用)拟制:中研基础日期:2004.8.3批准:中研基础日期:批
verilog
hdl
华为入门教程
7系列FPGA封装和管脚
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时间:2020.03.11
上传者:16245458_qq.com
赛灵思7系列FPGA包括三个FPGA家族,都是统一最低的功耗设计,使整个家族共同的设计规模为最佳的功率,性能和成本。本指南作为技术参考讲述7系列FPGA封装和管脚。7SeriesFPGAsPackag
Xilinx
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封装
7系列FPGA迁移
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时间:2020.03.11
上传者:二不过三
赛灵思7系列FPGA包括三个FPGA家族,都是统一最低的功耗设计,使整个家族共同的设计规模为最佳的功率,性能和成本。本指南作为技术参考讲述7系列FPGA迁移。7SeriesFPGAsMigration
Xilinx
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迁移
HuaWei Verilog 约束
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时间:2020.03.06
上传者:238112554_qq
HuaWeiVerilog约束第1部分:命令规则每个文件只包含一个module,module名要小写,并且与文件名保持一致除parameter外,信号名全部小写,名字中的两个词之间用下划线连接由par
huawei
verilog
约束
赛灵思7系列FPGA HDL设计库指南
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大小:4.58MB
时间:2020.03.11
上传者:wsu_w_hotmail.com
这是HDL指南的ISE文档集的一部分。如果你喜欢工作与原理图,本指南的一个单独的版本是可用的。Xilinx7SeriesFPGALibrariesGuideforHDLDesignsUG768(v13
Xilinx
fpga
hdl
新手的verilog学习经验
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时间:2020.01.03
上传者:givh79_163.com
新手的verilog学习经验我学verilog语言进行FPGA设计也就半年时间,很多的东西就是在EDACN上学到的,现在想说说自己对使用verilog进行FPGA设计的一些体会,我水平不高,主要是为新
verilog
学习经验
低功耗28纳米赛灵思7系列FPGA
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大小:1.13MB
时间:2020.03.11
上传者:微风DS
本白皮书介绍了电力相关方面的几个有关Xilinx的包括台积电的28纳米高-k金属栅极(HKMG),高性能,低功耗(28纳米HPL或28HPL)28纳米7系列FPGA工艺的选择。WhitePaper:7
Xilinx
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