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别错过!一本CPU芯片逻辑设计经典书籍
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时间:2020.01.15
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别错过!一本CPU芯片逻辑设计经典书籍,MIPS型CPU芯片逻辑设计技术……
芯片
逻辑
设计
学习Verilog很好的入门教程,实例加讲解。
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时间:2020.01.15
上传者:2iot
VerilogHDL入门教程文档编号文档中心版本1.0密级内部公开资源类别:HDL语言共41页VerilogHDL入门教程(仅供内部使用)拟制:批准:批准:中研基础中研基础日期:日期:日期:2004.
verilog
入门
教程
Xilinx spartant6 核心板原理图
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时间:2020.01.15
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spartan6coreboare54321Spartan6CoreBoardDSDRAMCASRASCLKWEBAADDFPGASDRAMIFA[21:0]D[15:0]ENRWUSBDATAIFV
spartan6
boare
JPEG压缩的VHDL代码
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时间:2020.01.15
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JPEG压缩的VHDL代码,JPEG标准下图象压缩的VHDL实现工程……
标准
下图
象压
FPGA初学者应了解的五项基本功
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时间:2020.01.15
上传者:二不过三
fpga五个基本功对于FPGA设计者来说,练好这5项基本功,与用好相应的EDA工具是同一过程,对应关系如下:1.仿真:Modelsim,QuartusII(SimulatorTool)2.综合:Qua
五个
基本
fpga一点小经验
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时间:2020.01.15
上传者:2iot
fpga经验谈(相当好)FPGA/CPLD数字电路设计经验技术交流讲义FPGA/CPLD数字电路设计经验分享摘要:在数字电路的设计中,时序设计是一个系统性能的主要标志,在高层次设计方法中,对时序控制的
经验
相当
ISE13.1破解工具
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时间:2020.01.15
上传者:quw431979_163.com
ISE13.1破解工具,licgen_ise_13……
licgen
Altera FPGA_CPLD设计 (基础篇)
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上传者:givh79_163.com
AlteraFPGA_CPLD设计(基础篇),AlteraFPGA_CPLD设计基础篇……
altera
设计
基础
对USB 协议层的深层分析
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时间:2020.01.15
上传者:16245458_qq.com
对USB协议层的深层分析,对USB协议层的深层分析……
协议
层的
深层
十分钟学会Xilinx FPGA 设计
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十分钟学会XilinxFPGA设计1……
十分
钟学
Xilinx
动画语言教学verilog+vhdl
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动画语言教学verilog+vhdl,Evita……
evita
FPGA经验谈-牛人写
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FPGA经验谈-牛人写,fpga经验谈(西安大唐电信)……
经验
西安
大唐
时序分析经典之作
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时间:2020.01.15
上传者:quw431979_163.com
Timing+AnalysisTimingAnalysis作者:袁荣盛关于高速信号的时序分析,主要针对两种最常见的同步时序系统:共同时钟同步系统与源同步系统。共同时钟同步原理及时序分析所谓共同时钟,就
timing+analysis
信号完整性资料
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上传者:rdg1993
signal_integrationwww.eetchina.com信号完整性中的反射问题原理作者:靳冶2008年06月摘要:信号完整性,即信号在信号线上的质量,指的是因数字信号的模拟特性而产生的任何
signal
integration
VerilogHDL_数字设计与综合第二版, 美国Samir...
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上传者:16245458_qq.com
VerilogHDL_数字设计与综合第二版,美国Samir...,VerilogHDL_数字设计与综合第二版……
VerilogHDL
数字
设计
最低功耗,最低价格,最高可靠性与安全性FPGA产品选型手册
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actel产品选型手册ProductCatalogMay2010Now,morethanever,powermatters.Whetheryou’redesigningattheboardorsyst
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精华内容汇总
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上传者:rdg1993
精华内容汇总,精华内容汇总……
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