FPGA和CPLD-可编程逻辑器件-第497页-面包板社区

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用户554547 2009-9-9 23:25: latch和FF异同; 行为级描述中 latch 一般是由于 if 货 case 逻辑表述不完全产生的。异同： 1 、 latch 由电平触发，非同步控制。在使能信号有效时 latch 相 ...; 3394 4 0 4

用户554547 2009-9-9 22:55: 状态机设计; 状态机设计 ?xml:namespace prefix = o ns = "urn:schemas-microsoft-com:office:office" / FSM 简介： FSM 分两大类：米里型 ...; 6322 3 1 4

用户547892 2009-9-9 19:19: FPGA培训-Xilinx第二十九期FPGA技术研修班（xilinx初级）; 一、课程简介: 这是一个为期四天的课程，包括逻辑设计部分、数字信号处理部分和嵌入式部分。课程定位于FPGA设计技术初学者，课程内容 ...; 1809 1 0 1

用户554547 2009-9-9 14:29: 用verilog编写的多功能数字钟; /* 信号定义： clk：标准时钟信号，本例中，其频率为4Hz； clk_1k：产生闹铃音、报时音的时钟信号，本例中其频率为1024Hz； mode：功能控制信号；为0：计时 ...; 4809 3 0 3

用户534970 2009-9-8 16:07: Altera系列FPGA的命名规则; Altera系列FPGA的命名规则如下：工艺+版本+型号+LE数量+封装+器件速度。举例： EP2C20F484C6 EP 工艺 2C cyclone2 （S代表stratix。A代表arria) ...; 3211 10 0 10

ash_riple_768180695 2009-9-6 08:26: 下载OPENCORES代码的CVS命令——升级到SVN; 今天 riple 尝试从 OPENCORES 上下载了一个创建VHDL testbench的Project: vhld_tb。 OPENCORES提供 ...; 6035 6 0 6

用户143696 2009-9-6 00:11: synplify9.62; http://rapidshare.com/files/138894553/Synplicity.Synplify.Premier.v9.4.with.Identify.v3.0-Lz0.part1.rar.html http://rapidshare.com/files/138896273 ...; 3687 6 1 7

ash_riple_768180695 2009-9-5 19:15: When PRBS meets Scilab; PRBS PRBS generator runs at 1.5 Gbps 给出了串行和并行实现方式。 PRBS code for Simulation 用于仿真的Verilog代码，我怀疑这一串行实现方式的时序性能 ...; 4371 4 0 4

ash_riple_768180695 2009-9-5 19:13: When TL1 meets Expect; TL1 Transaction Language 1 From Wikipedia, the free encyclopedia Beginner's guide to TL1 TL1 Tutorial Expect Expect From Wikipedia, the free ...; 3038 2 0 2

特权ilove314 2009-9-5 14:44: 基于FPGA的跨时钟域信号处理——借助存储器; 基于 FPGA 的跨时钟域信号处理——借助存储器 ?xml:namespace prefix = o ns = "urn:schemas-microsoft-com:office:office" / 为了 ...; 5524 7 4 11

ash_riple_768180695 2009-9-5 14:27: 《基于FPGA的快速系统原型开发》翻译计划; 《基于FPGA的快速系统原型开发》一书出版于2005年。我在一年前（2008年3月）从中科院计算所图书馆里第一次借到并复印了这本书。在这一年的时间里，我 ...; 5634 7 5 12

ash_riple_768180695 2009-9-5 13:48: 这不就是“可综合的断言监控器”么？！; 最早看到“可综合断言”是在VMM里。书中介绍的断言在设计验证中的强大功能我能够理解，并且在代码里也实际应用过。但是正因为断言具备强大的交互能力， ...; 6038 13 2 13

ash_riple_768180695 2009-9-5 09:07: FPGA设计者的5项基本功; 记得《佟林传》里，佟林练的基本功是“绕大树、解皮绳”，然后才练成了什么“鬼影随行、柳叶绵丝掌”。 riple 在我看来，成为一名说 ...; 5419 10 16 23

ash_riple_768180695 2009-9-5 09:06: 学然后知不足，教然后知困; “虽有嘉肴，弗食，不知其旨也；虽有至道，弗学，不知其善也。是故学然后知不足，教然后知困。知不足，然后能自反也；知困，然后能自强也。故曰：教学 ...; 5548 10 4 9

ash_riple_768180695 2009-9-5 07:35: To be an Architect; 一直以来，都觉得搭建一个SOPC系统很难。不是因为软件的使用存在问题——我可以阅读文档、咨询论坛上的高手、自己动手试试；而是因为搭建一个功能完备、 ...; 4102 2 0 2

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