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在第一节介绍过 XDC 与 UCF 的不同之处: Vivado 会分析所有 XDC 约束时钟间的时序路径。通过 set_clock_groups 约束不同的时钟 ...
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【博客大赛】3. Define Clocks(Timing Constraints in Vivado)
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2014-3-21 15:40
【博客大赛】2. Timing Basics(Timing Constraints in Vivado)
在深入讲解 XDC 约束前,先介绍一下基本的时序约束、分析的概念。 Timing Path: 图 1 中包含了主要的时序分析路径: 1. ...
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2014-3-19 09:03
【博客大赛】1. UCF to XDC (Timing Constraints in Vivado)
Vivado 软件相比于 ISE 的一大转变就是约束文件, ISE 软件支持的是 UCF(User Constraints File) ,而 Vivado 软件转换到了 XDC ...
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2014-3-17 14:43
【博客大赛】跨时钟域处理
时钟对于 FPGA 就像我们的心脏,时刻控制着“跳动”的频率以及“血液”的流速;时钟域好比通过心脏的血液血型,不同血型的血液会产生排斥 ...
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2014-3-13 09:11
【博客大赛】FPGA功耗的那些事儿
在项目设计初期,基于硬件电源模块的设计考虑,对 FPGA 设计中的功耗估计是必不可少的。笔者经历过一个项目,整个系统的功耗达到了 100w ...
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2014-3-7 15:49
【博客大赛】BRAM和DSP间的纠缠(二)
在“ BRAM 和 DSP 间的纠缠 ( 一 ) ”中介绍了 Xilinx FPGA 中 BRAM 和 DSP 的使用,可能大家会奇怪为什么博 ...
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2014-3-7 15:42
【博客大赛】BRAM和DSP间的纠缠(一)
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【博客大赛】u-boot
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