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热门搜索： python HarmonyOS 嵌入式 电源 C语言 华为 电子竞赛 单片机 PCB
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  • 基于神经网络的PCB焊点检测方法
    所需E币：2
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    大小：1003.75KB
    时间：2020.11.18
    上传者：丸子~
    基于神经网络的PCB焊点检测方法
    基于 神经网络 pcb 焊点 检测 方法
  • 基于Cadence_Allegr_省略_速PCB设计信号完整性分析与仿真
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    大小：391.14KB
    时间：2020.11.18
    上传者：丸子~
    基于Cadence_Allegr_省略_速PCB设计信号完整性分析与仿真
    基于 CadenceAllegr 略速 pcb 设计 信号完整性分析 仿真
  • 基于System C和UML的语音备忘器设计
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    大小：2.45MB
    时间：2020.11.18
    上传者：xgp416
    基于SystemC和UML的语音备忘器设计资源大小：2.45MB[摘要]随着VLSI的集成度越来越高，设计也越趋复杂。传统的设计方法如原理图输入、HDL语言描述在进行复杂系统设计时，设计效率往往比较低
    基于 system uml 语音 备忘 设计
  • DC2008—license 制作和启动配置文件
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    大小：791.52KB
    时间：2020.11.18
    上传者：xgp416
    DC2008—license制作和启动配置文件资源大小：791.52KB[摘要] DC2008—license制作和启动配置文件License制作是很最关键的，没有license软件肯定没法
    DC2008 license 制作 启动 配置 文件
  • Cadence_Tutoria
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    大小：1.1MB
    时间：2020.11.18
    上传者：xgp416
    Cadence_Tutoria资源大小：1.1MB[摘要]您将创建一个8位加法器多表原理图。你将在图1和图2上创建4位的示意图。1打开一个名为“adder8”的新示意图和库“adder8”2。在[制作
    CadenceTutoria
  • 一文了解综合与Design Compiler
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    大小：3.62MB
    时间：2020.11.18
    上传者：xgp416
    一文了解综合与DesignCompiler资源大小：3.62MB[摘要]综合是前端模块设计中的重要步骤之一，综合的过程是将行为描述的电路、RTL级的电路转换到门级的过程；DesignCompiler是
    一文 解综 Design compiler
  • Cadence NC Verilog仿真教程
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    大小：968.16KB
    时间：2020.11.18
    上传者：xgp416
    CadenceNCVerilog仿真教程资源大小：968.16KB[摘要]这个手册将向你介绍使用NC-Verilogsimulator和SimVision。本文使用的是一个用Veilog硬件编程语言编
    cadence nc verilog 仿真 教程
  • SOPC嵌入式系统实验教程 周立功
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    大小：4.77MB
    时间：2020.11.18
    上传者：xgp416
    SOPC嵌入式系统实验教程周立功资源大小：4.77MB[摘要]第4章SOPC软件编程基础实验1444.1PIO输出实验1——流水灯控制1454.2PIO输出实验2——步进电机控制1484.3PIO输入
    SOPC 嵌入式系统 实验 教程 周立功
  • Linux 设计SOC的一些基础知识分享
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    大小：2.37MB
    时间：2020.11.18
    上传者：xgp416
    Linux设计SOC的一些基础知识分享资源大小：2.37MB[摘要]事实上，大多数(如果不是所有)开源应用程序通常都是在诸如emacs(受人尊敬的用户环境和程序编辑器)、gcc(官方GNUC编译器)和
    linux 设计 SoC 一些 基础 知识分享
  • Encounter 用户指南PDF文档
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    大小：3.23MB
    时间：2020.11.18
    上传者：xgp416
    Encounter用户指南PDF文档资源大小：3.23MB[摘要]I/Oassignmentfile定义I/Opad单元和管脚的组成规则。文件基于规则指定exactlocation,globalspa
    encounter 用户指南 pdf 文档
  • AHB总线上CAN控制器的实现
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    大小：2.52MB
    时间：2020.11.18
    上传者：xgp416
    AHB总线上CAN控制器的实现资源大小：2.52MB[摘要]CAN总线是一种广泛应用于汽车自动化和工业过程控制领域的现场总线，AHB总线则是一种广泛应用于嵌入式系统的系统总线。本论文介绍了CAN规范和
    ahb 总线 can 控制器 实现
  • SoC设计中的验证技术有哪些
    所需E币：4
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    大小：183.06KB
    时间：2020.11.18
    上传者：xgp416
    SoC设计中的验证技术有哪些资源大小：183.06KB[摘要]系统复杂性继续按照摩尔定律增加而功能复杂性的增长速度则更加迅猛为解决这一问题行业提出了通过自动化来实现)设计抽象的概念设计生产率的提升速度
    SoC 设计 验证技术 哪些
  • PPP和HDLC协议
    所需E币：3
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    大小：1.14MB
    时间：2020.11.18
    上传者：xgp416
    PPP和HDLC协议资源大小：1.14MB[摘要]特性Low-VDD提单减少泄漏方法分开读端口由M10泄漏性能400mv@475khz3.28华盛顿大学320mVW/O读取错误@27℃380mVW/O
    ppp hdlc 协议
  • RS编解码器的SOC集成设计和验证
    所需E币：4
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    大小：2.11MB
    时间：2020.11.18
    上传者：xgp416
    RS编解码器的SOC集成设计和验证资源大小：2.11MB[摘要]现代社会已经进入数字信息化的时代，保证信息的准确性和可靠性异常重要。纠错码是提高信息传输可靠性的一种重要手段，Rs码是一种典型的纠错码，
    rs 编解码器 SoC 集成 设计和验证
  • 国外encounter7.1培训教程
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    大小：1.26MB
    时间：2020.11.18
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    国外encounter7.1培训教程资源大小：1.26MB[摘要]与VLSI课程中的其他练习不同，后端设计流要求您学习如何使用一个商业电子设计自动化(EDA)工具，在我们的案例中遇到了Cadence设
    国外 encounter71 培训教程
  • 关于Cadence 版图 Virtuoso Simulation
    所需E币：5
    下载：10
    大小：4.8MB
    时间：2020.11.18
    上传者：xgp416
    关于Cadence版图VirtuosoSimulation资源大小：4.8MB[摘要]接下来，选择刚才在库管理器中创建的库，并选择File->New->单元格视图…我们将创建一个逆变电池的
    关于 cadence 版图 virtuoso simulation
  • SC 2.2 Core.zip
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    大小：1.9MB
    时间：2020.11.18
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    SC2.2Core资源大小：1.9MB[摘要]SystemC是一个c++类库和一种方法，您可以使用它来有效地创建软件算法、硬件体系结构和SoC(芯片上的系统)的接口以及系统级设计的精确循环模型。您可以
    sc 22 Corezip
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