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共模电感应用说明
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时间:2019.08.05
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共模电感又名共模扼流线圈,顾名思义共模电感的主要功用即是抑制共模干扰。
共模电感
磁珠排珠应用说明
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时间:2019.08.05
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磁珠排又可称排珠,顾名思义磁珠排即几个磁珠成排列式封装使用。
磁珠
常用封装
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时间:2019.08.05
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常用封装标准说明,供您参考
封装
常用电子元件识别
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时间:2019.08.05
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碳质电阻和一些1/8瓦碳膜电阻的阻值和误差用色环表示。在电阻上有三道或者四道色环。靠近电阻端的是第一道色环,其余顺次是二、三、四道色环。第一道色环表示阻值的最大一位数字,第二道色环表示第二位数字,第三
电子元件
印刷电路板的抗干扰设计原则
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时间:2019.08.05
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一电源线布置:1、根据电流大小,尽量调宽导线布线。2、电源线、地线的走向应与资料的传递方向一致。3、在印制板的电源输入端应接上10~100μF的去耦电容。二地线布置:1、数字地与模拟地分开。2、接地线
电路板
为什么要掌握电磁兼容技术
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时间:2019.08.05
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为什么要掌握电磁兼容技术?电磁兼容相关介绍与技术解析
电磁兼容
如何设计符合电磁相容要求的印刷电路板
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时间:2019.08.05
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如何设计符合电磁相容要求的印刷电路板,供大家参考学习
电路板
有源晶振EMC设计标准电路
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时间:2019.08.01
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有源晶振EMC设计标准电路图,仅供参考
有源晶振
再谈DDR内存布线
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时间:2019.08.01
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在现代高速数字电路的设计过程中,工程师总是不可避免的会与DDR或者DDR2,SDRAM打交道。DDR的工作频率很高,因此,DDR的布线(或者Layout)也就成为了一个十分关键的问题,很多时候,DDR
ddr
SDRAM与DDR布线指南
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时间:2019.08.01
上传者:eeNick
很多人对内存布线感到迷茫,找不到切入点,不知如何下手,其实高速硬件设计的主要任务就是与干扰做斗争,内存布线也不例外。可以这样考虑:内存是做什么用的呢?是用来存储数据的,写入1读出1,写入0读出0,即保
SDRAM
SDRAM的原理和时序
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时间:2019.08.01
上传者:eeNick
一、SDRAM内存模组与基本结构我们平时看到的SDRAM都是以模组形式出现,为什么要做成这种形式呢?这首先要接触到两个概念:物理Bank与芯片位宽。
SDRAM
SDRAM的结构、时序与性能的关系
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时间:2019.08.01
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仓库物语货物基地(主板)连接着物资(数据)的供求方。基地的货物调度厂房(北桥芯片)掌管着若干个用于临时供货/生产与存储的仓库基地(P-Bank),它们通常隶属于某一仓储集团(DIMM),这种基地与调度
SDRAM
DDR的原理和时序
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时间:2019.08.01
上传者:eeNick
DDR的原理和时序DDRSDRAM全称为DoubleDataRateSDRAM,中文名为“双倍数据流SDRAM”。DDRSDRAM在原有的SDRAM的基础上改进而来。也正因为如此,DDR能够凭借着转产
ddr
DDR3走线及绕线规则
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时间:2019.08.01
上传者:328230725_895182095
(二)绕线Clktofistsdram
走线
数字电路工作原理
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时间:2019.08.01
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内容数字电路的分类基本结构和特点电路特性电路互连电路选型基本原则
数字电路
高速数字设计和信号完整性分析——电源分布系统设计
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时间:2019.08.01
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内容基本概念设计目标一般设计规则多层板叠层结构电流回路去耦电容及其应用噪声抑制
电源
系统设计中时钟、时序相关问题
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时间:2019.08.01
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1,跟时钟相关的参数概念与分析2,时钟树3,PLL与DLL4,基于Latch进行设计与TimeBorrow5,ASIC设计中的时钟使用的基本原则6,门控时钟设计的相关技术7,改善系统时钟性能以及提高性
系统设计
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