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使用 XC9500 JTAG 边界扫描接口
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时间：2020.03.06
上传者：givh79_163.com
使用XC9500JTAG边界扫描接口Appli
c
ationNote:XC9500/XL/XVFamilyRUsingtheXC9500/XL/XVJTAGBoundaryS
c
anInterfa
c
eXA
Xilinx
fpga
利用 CoolRunner-II CPLD 设计 16b/20b 编码器/解码器
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时间：2020.03.06
上传者：rdg1993
利用CoolRunner-IICPLD设计16b/20b编码器/解码器Appli
c
ationNote:CoolRunner-IICPLDRDesignofa16b/20bEn
c
oder/De
c
oder
Xilinx
cpld
Parameterizable 8b/10b De
c
oder
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上传者：2iot
Parameterizable8b/10bDe
c
oderAppli
c
ationNote:Virtex-5,Virtex-4,Virtex-II,Virtex-IIPro,Spartan-3,Spart
Xilinx
cpld
【应用手册】Dynami
c
Re
c
onfiguration of Trans
c
eiver Channels Using Multiple PLLs in Stratix IV Devi
c
es
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上传者：二不过三
【应用手册】Dynami
c
Re
c
onfigurationofTrans
c
eiverChannelsUsingMultiplePLLsinStratixIVDevi
c
esThisappli
c
ationn
altera
fpga
pll
【应用手册】AN 603: A
c
tive Serial Remote System Upgrade Referen
c
e Design
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时间：2020.03.06
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【应用手册】AN603:A
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edesig
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Arria
【应用手册】AN 596: Modeling and Design Considerations for 10 Gbps Conne
c
tors
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上传者：2iot
【应用手册】AN596:ModelingandDesignConsiderationsfor10GbpsConne
c
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ationnotedis
c
ussestheimpa
c
to
altera
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10gbps
【应用手册】AN 593: Anti-Tamper Prote
c
tion for Cy
c
lone III LS Devi
c
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【应用手册】AN593:Anti-TamperProte
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【应用手册】AN 589: Using the Design Se
c
urity Feature in Cy
c
lone III LS Devi
c
es
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时间：2020.03.06
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【应用手册】AN589:UsingtheDesignSe
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urityFeatureinCy
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loneIIILSDevi
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esThisappli
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ribesthedesigns
altera
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cyclone
【应用手册】A
c
hieving Timing Closure in Basi
c
(PMA Dire
c
t) Fun
c
tional Mode
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【应用手册】A
c
hievingTimingClosureinBasi
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(PMADire
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ribesthemethodtoa
altera
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timing
【应用手册】AN 554: How to Read HardCopy PrimeTime Timing Reports
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上传者：16245458_qq.com
【应用手册】AN554:HowtoReadHardCopyPrimeTimeTimingReportsTheAlteraHardCopyDesignCentergeneratestimingrepor
altera
ASIC
hardcopy
【应用手册】AN 547: Putting the MAX II CPLD in Hibernation Mode to A
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hieve Zero Standby Current
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【应用手册】AN547:PuttingtheMAXIICPLDinHibernationModetoA
c
hieveZeroStandbyCurrentTosavepower,theMAX®IICPLD
altera
cpld
max
A
c
c
elDSP IP 浏览器
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A
c
c
elDSPIP浏览器WhitePaper:XilinxFPGAsRWP242(v1.0)April19,2006A
c
c
elDSPIPExplorerBy:ThomasHillDeveloping
Xilinx
fpga
De
c
reasing Simulation Runtimes with System Generator for DSP Hardware Co-Simulation
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De
c
reasingSimulationRuntimeswithSystemGeneratorforDSPHardwareCo-SimulationAppli
c
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Xilinx
fpga
Serial-to-Parallel Converter - Obsolete
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Serial-to-ParallelConverter-ObsoleteAppli
c
ationNote:VirtexSeriesRSerial-to-ParallelConverterAuthor:P
Xilinx
fpga
High-Volume Spartan-6 FPGAs: Performan
c
e and Power Leadership by Design
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High-VolumeSpartan-6FPGAs:Performan
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eandPowerLeadershipbyDesignWhitePaper:Spartan-6FPGAsWP396(v1.0)M
Xilinx
fpga
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c
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elerating System Designs Requiring High-Bandwidth Conne
c
tivity with Targeted Referen
c
e Designs
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A
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eleratingSystemDesignsRequiringHigh-BandwidthConne
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tivitywithTargetedReferen
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eDesignsWhitePaper:S
Xilinx
fpga
参考设计：带有 OPB 中心 DMA 的 MCH OPB EMC
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参考设计：带有OPB中心DMA的MCHOPBEMCAppli
c
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eSystem:MCHOPBEMCwithOPBCentralD
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