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EMC试验和测量技术系列国家标准和静电放电抗扰度试验
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时间:2019.12.13
上传者:238112554_qq
EMC测试又叫做电磁兼容(EMC),指的是对电子产品在电磁场方面干扰大小(EMI)和抗干扰能力(EMS)的综合评定,是产品质量最重要的指标之一,电磁兼容的测量由测试场地和测试仪器组成。EMC测试目的是
emc
数字IC设计工程师笔试面试经典100题
所需E币:2
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大小:1.12MB
时间:2021.08.02
上传者:Nuyoah1
数字IC设计工程师笔试面试经典100题
数字
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设计工程师
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PCB如何设计?PCB设计规范详细资料
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时间:2019.12.16
上传者:978461154_qq
本文主要讲了PCB如何设计?PCB设计规范。
pcb
ATK-HC05蓝牙串口模块使用说明
所需E币:5
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大小:1.12MB
时间:2019.12.16
上传者:2iot
本文主要讲了ATK-HC05
物联网
有经验的硬件和SoC工程师编写的一本书
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大小:1.07MB
时间:2019.12.17
上传者:978461154_qq
本书是为有经验的硬件和SoC工程师编写的,他们可能有或没有ARM产品的经验。这些工程师通常具有编写Verilog和执行综合的经验。
arm
eda
BUCK型DC-DC的电流检测电路设计
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时间:2019.12.13
上传者:rdg1993
DC-DC电源管理芯片的高效率,低功耗等特性使得它在便携式电子设备市场中具有不可替代的地位,因此研究并改善DC.DC的性能具有很大的意义。(来源:西南交通大学研究生学位论文)
buck
dc-dc
EMC设计秘籍
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大小:1.06MB
时间:2020.06.18
上传者:Argent
智能时代,电子产品丰富多彩,设计方案多多。手头有些硬件、软件方面的设计资料,包括成熟的方案,分享出来仅供大家参考,欢迎下载。
emc
设计
秘籍
IPC-A-610G 中文版 组件的验收标准,电子PCB的检验
所需E币:5
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大小:1.01MB
时间:2019.12.16
上传者:quw431979_163.com
本章图示了几种在印刷电路组件(PCA)或其它类型组件上安装电子器件所用的机械零部件,这些组件要求采用下列任何零部件:螺钉、螺栓、螺母、垫片、紧固件、夹子、连接器插针等。
电源模块
物联网
PCB布局布线技巧100问
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时间:2019.11.04
上传者:pranoken
虽然比较基础,但是温故而知新,对于不是经常画板的人来说,没事翻一下,总是能有所收获的。
pcb layout
IC设计流程和方法复旦讲义
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时间:2019.12.16
上传者:quw431979_163.com
IC设计流程和方法复旦讲义
开关电源
电源模块
LLC 的工作原理(第 II 部分):LLC 变换器设计考量
所需E币:1
下载:6
大小:997.62KB
时间:2023.03.15
上传者:Argent
LLC的工作原理(第II部分):LLC变换器设计考量
llc
工作原理
ii
部分
llc
变换器
设计
考量
200W LLC的设计实例—电源技术研讨会演讲课题之讨论
所需E币:3
下载:2
大小:939.83KB
时间:2019.12.12
上传者:wsu_w_hotmail.com
200WLLC的设计实例—电源技术研讨会演讲课题之讨论
llc
三菱PLC的经典编程案例和基本电路
所需E币:5
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大小:911.5KB
时间:2019.12.13
上传者:quw431979_163.com
本文主要讲了PLC的有关内容:PLC设计过程及需完成的内容,电机延时启动控制,定时器做震荡电路,设计一个5昼夜计时器,利用堆栈指令控制电机正反转,利用SET置位、RST复位指令对电机连续运行控制,基本
plc
射频电路设计PCB审查
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大小:905.69KB
时间:2019.12.16
上传者:2iot
一、布局注意事项:(1)结构设计要求在PCB布局之前需要弄清楚产品的结构。结构需要在PCB板上体现出来。比如腔壳的外边厚度大小,中间隔腔的厚度大小,倒角半径大小和隔腔上的螺钉大小等等(换句话说,结构设
射频
pcb
生产PCB的专业工厂
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时间:2019.12.16
上传者:16245458_qq.com
如今,人们的生活已经离不开智能手机等数码产品,而PCB是这些数码产品的重要组成部分,而现在,有很多工厂专门生产PCB,对于一位专业的PCB采购来说,该从哪些方面来选择p
c
b工厂呢?
pcb
基于 DSP 和 CAN 总线的热功率模拟系统
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时间:2019.12.16
上传者:wsu_w_hotmail.com
热功率模拟系统用于测试整星热平衡试验时模拟星上各设备热量分布情况,以检测整星的热控系统性能。本系统采用数字信号处理(DSP)组成单元处理系统,采用控制器局部网(CAN)总线组成通信网络,通过计算机对每
DSP
DAC数字位宽对底噪影响测试
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时间:2019.09.11
上传者:1271048181_833989317
DAC的底噪收到采样时钟,自身热噪,数字躁底等共同作用。这里想通过实验查看数字躁底对DAC底噪的影响,特别是在LTE系统,系统指标要求没有GSM严苛的情况下,是不是可以降低数字链路的位宽,对下行链路处
DAC
数字位宽
底噪
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