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用户420394 2013-1-19 14:46: cadencePCB文件丝印层设置; 接下来几篇文章，大致说一下如何出光绘文件。先看看如何设置丝印层，按图操作，就行了。按着上图设置，点击silkscreen按钮，就 ...; 1872 8 0 8

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用户420394 2013-1-19 14:45: cadencePCB文件钻孔设置; 从PCB生成钻孔文件，看图操作，先看圆形钻孔文件如何生成。这是生成钻孔前的钻孔参数设置，接下来，开始生成钻孔文件。 ...; 1983 7 1 8

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用户420394 2013-1-19 14:44: cadence生成光绘文件; 我以为TOP为例，其他的层，按着这个步骤，操作就行了。我们在颜色设置里面设置top的东西，只显示TOP层的东西，丝印啊，阻焊层，阻焊层都不要，只要TOP ...; 1243 9 0 9

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用户420394 2013-1-19 14:42: cadence布线后如何查看线宽; 看图操作，就行了。这里说明一下，在find标签里面勾选Cline segs，而不是Cline，如果选择了Cline，弹出消息如下图， ...; 7797 11 0 11

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用户420394 2013-1-19 14:41: cadence15.7ROOM布局设置; 看图操作，使用PCB依然是上次的5个电阻。这里要注意一下，find标签里面要勾选comps选项，不然下面的property里面没有ROOM这个属性。 ...; 1173 11 0 11

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用户420394 2013-1-19 14:40: cadence15.7 阻抗约束规则设置; cadence软件最重要的就是约束规则的设置，这样可以给PCB板设计带来很大方面，也便于信号完整性的分析。下面说一下阻抗约束。原理图还是15个电阻 ...; 1202 8 0 8

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用户420394 2013-1-19 14:39: cadence布线拐角处断裂显示; cadence布线有时候，在拐角处出现断裂现象，看着很不爽。看图操作，将它们圆滑连接。; 708 7 0 7

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用户420394 2013-1-19 14:36: ENTRY HDL绘制原理图并导入PCB EDITOR; 我们利用上一篇文章做好的LM358元器件，绘制一个简单原理图图，并导入PCB editor，这样我们就算是完成了HDL原理图到PCB的流程，主要的操作都说了，剩 ...; 2322 6 0 6

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用户420394 2013-1-19 14:34: LM358元器件库制作(ENTRY HDL原理图使用); 上一篇文章说split元件库的制作，很简单，或者说临时凑合的，这次制作一个LM358的库。看图操作，不多说了。 ...; 887 8 0 8

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用户420394 2013-1-19 14:31: cadence布线前-线长约束仿真; 在cadence设计里面约束很重要，我觉得比较重要和常用就是线长约束，等长约束，还有那个差分约束。先看看线长约束，其实线长约束如何设置我不多说 ...; 1250 10 0 10

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用户420394 2013-1-19 14:29: cadence布线前-等长约束仿真; 这篇文章会很短，其实也可以在cadence布线前-线长约束仿真里面说，但是，这个和线长是2码事情，所以就单独拿出说了，等长约束就是要求几条信号线的线 ...; 902 7 0 7

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用户420394 2013-1-19 14:27: cadence布线后-反射仿真; PCB板布线完成以后，可以运行仿真，然后看看和我们在布线前的仿真有啥区别，或者说验证一下，我们的约束规则是否起作用。还是利用上一篇的文章里面的P ...; 1115 7 0 7

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用户420394 2013-1-18 16:25: cadence串扰仿真; 我们还是利用于博士的那个电路板，看一下cadence软件的串扰仿真，我们选取3跟信号线，见下图。 U6.N3-R36-U7.56 U6.P3-R36-U7.54 U ...; 862 5 0 5

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用户420394 2013-1-18 16:24: cadence约束管理器总体设置 2; 要给等长添加一个match group。到这里我们的ECSET建立和设置好了，接下来，我们把这个ECSET分配给CEBUS这个总线。 ...; 865 7 0 7

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用户420394 2013-1-18 16:23: cadence约束管理器总体设置 1; cadence约束管理器设置是布线过程中很重要的一步，相关的设置可以使得布线事半功倍，还可以提高走线信号的信号质量，下面具体说一下。这篇文章图片大约46张，读 ...; 1320 6 0 6

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