FPGA和CPLD-可编程逻辑器件-第312页-面包板社区

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用户1278632 2010-11-10 15:15: 全局时钟约束到普通管脚上的问题; 在做AC97音频时，没有考虑AC_LINK接口bit_clk是全局时钟的问题，将AC_LINK的5根线全部接到了FPGA的普通管脚上；后来在ISE综合后PALCEROUTE ，报如下错误： E ...; 7649 12 0 12

用户281801 2010-11-10 15:00: 在xps中使用XMD调试的一个问题; 在调试时launch XMD，结果打开XMD后一直连接不到处理器，总是提示：invaid XMD target。又是怀疑杀毒软件，又是重装ISE，结果依然不对。而下载以 ...; 1836 1 0 1

huotingtu_505472073 2010-11-10 13:15: 【转】SVPWM信号发生器的VHDL实现; 近年来，DSP在SVPWM(空间矢量脉宽调制)控制领域得到了广泛应用。但是使用DSP单核心的控制方法仍然存在一些缺陷：基于软件的：DSP在实现SVPWM触发信号时需要较 ...; 1007 1 0 1

huotingtu_505472073 2010-11-10 13:14: 【转】基于Nios软核CPU的uC/OS-II和LwIP移植; Altera公司推出的Nios软核CPU是一种可配置的通用精简指令集计算RISC(Reduced Instruction Set Computing)嵌入式处理器。它可以与各种外设相结合，构成一个定制 ...; 1232 3 0 3

huotingtu_505472073 2010-11-10 13:13: 【转】用CPLD实现基于PC104总线的429接口板; PC104总线系统是一种新型的计算机测控平台，作为嵌入式PC的一种，在软件与硬件上与标准的台式PC(PC/AT)体系结构完全兼容，它具有如下优点：体积小、十分紧凑 ...; 973 3 0 3

huotingtu_505472073 2010-11-10 13:11: 【转】用CPLD实现的数字钟控系统; 在系统编程(ISP)器件是在20世纪90年代出现的最先进的可编程器件,它无须编程,可通过PC机经下载电缆直接对安装在用户目标版上的ISP器件重复编程,实现系统重构,它给 ...; 1308 3 0 3

huotingtu_505472073 2010-11-10 13:10: 【转】VHDL设计MOORE型有限状态机时速度问题的探讨; 1 引言随着微电子技术的迅速发展，人们对数字系统的需求也在提高。不仅要有完善的功能，而且对速度也提出了很高的要求。对于大部分数字系统，都可以 ...; 1450 5 0 5

huotingtu_505472073 2010-11-10 13:08: 【转】基于CPLD的DSP人机接口模块设计; CPLD(Complex programmable Logic Device，复杂可编程逻辑器件)是在传统的PAL、GAL基础上发展而来的，具有多种工作方式和高集成、高速、高可靠性等明显的特点 ...; 982 4 0 4

huotingtu_505472073 2010-11-10 13:06: 【转】基于CPLD的一种容错状态机的设计; 状态机是一种十分重要的时序电路,常用于描述数字系统的控制单元,在数字系统有着广泛的应用,如步进电机、数据存储器的读写、总线控制器等。本文结合具体课题;采用 ...; 1121 2 0 2

huotingtu_505472073 2010-11-10 13:02: 【转】基于RTL综合策略的状态机优化方法; 有限状态机及其设计技术是数字系统设计中的重要组成部分,是实现高效率、高可靠性逻辑控制的重要途径。大部分数字系统都可以划分为控制单元和数据单元两个组成部 ...; 1086 1 0 1

huotingtu_505472073 2010-11-10 13:00: 【转】基于CPLD的LED显示控制板; LED点阵显示屏使用高亮度LED发光管构成点阵，通过编程控制可以显示中英文字符、图形及视频动态图形．LED显示以其组构方式灵活、亮度高、技术成熟、成本低廉等特 ...; 1276 2 0 2

huotingtu_505472073 2010-11-10 12:59: 【转】自动售货机控制系统VHDL有限状态机实现; 1 引言有限状态机FSM(Finite State Machine)及其设计技术是实用数字系统设计中实现高效率、高可靠逻辑控制的重要途径。传统的状态机设计方法需进行繁 ...; 1738 2 0 2

特权ilove314 2010-11-9 16:10: 特权和你一起学NIOS2 第五章实战演练之时序收敛 part5; IO接口约束之理论推导这一步要对SDRAM与FPGA连接的IO口进行约束，这些IO口包括了控制信号、地址信号、数据信号。除了数据信号是双向总线， ...; 3623 5 2 7

FPGADeveloper 2010-11-8 23:06: 成都FPGA培训; 课程描述本课程主要帮助学员对Xilinx的FPGA系统学习，以工程实践为例，深入探讨FPGA系统设计中的经验及技巧。将整个FPGA设计的规范流程、VERILOG语言、 ...; 1940 4 0 4

用户301320 2010-11-8 21:36: 我的FPGA路; 开始我的FPGA路，希望可以成长; 1092 0 0 0

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