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DESING CPU USING FPGA
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时间:2020.02.14
上传者:238112554_qq
DESINGCPUUSINGFPGAContentICwww.Chip123.comICDESIGNMAGAZINEVOLUME33ICDIY.COM-AlbertBilly-FPGACPU(1)CP
desing
using
Verilog中阻塞和非阻塞的区别
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大小:409.01KB
时间:2020.02.14
上传者:givh79_163.com
Verilog中阻塞和非阻塞的区别Verilog_NBA.docPRELIMINARY七八零一研究所Verilog非阻塞赋值的仿真/综合问题源文件作者:CliffordE.Cummings(Sunbu
verilog
中阻
塞和
MaxplusII(中文)快速入门--FIE培训资料
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大小:476.5KB
时间:2020.02.14
上传者:quw431979_163.com
MaxplusII(中文)快速入门--FIE培训资料,MaxplusII(中文)快速入门……
maxplusii
中文
快速
ASIC设计流程
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时间:2020.02.14
上传者:978461154_qq
ASIC设计流程,ASIC设计流程……
设计
流程
设计技巧
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大小:149.11KB
时间:2020.02.14
上传者:2iot
设计技巧,设计技巧……
设计
技巧
CPLD&fpga两种开发板区别
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大小:25.5KB
时间:2020.02.14
上传者:微风DS
CPLD&fpga两种开发板区别市面上尤其是学校里面可以看到Xilinx公司或者Altera公司各种不同的开发板,其实只有两个大类,CPLD开发板和FPGA开发板。尽管FPGA和CPLD都是可编程AS
两种
开发
板区
Verilog中文教材
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大小:79.71KB
时间:2020.02.14
上传者:quw431979_163.com
Verilog中文教材,Verilog中文教材……
verilog
中文
教材
关于时钟的讨论
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时间:2020.02.14
上传者:quw431979_163.com
关于时钟的讨论关于时钟的讨论无沦是用离散逻辑、可编程逻辑,还是用全定制硅器件实现的任何数字设计,为了成功地操作,可靠的时钟是非常关键的。设计不良的时钟在极限的温度、电压或制造工艺的偏差情况下将导致错误
关于
时钟
的讨
verilog 很好的学习资料
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时间:2020.02.14
上传者:2iot
verilog很好的学习资料,verilog实例……
verilog
实例
离散高精度除法器 查表方式
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时间:2020.02.14
上传者:rdg1993
在FPGA中实现高精度快速除法1995-2005TsinghuaTongfangOpticalDiscCo.,Ltd.Allrightsreserved.1995-2005TsinghuaTongfa
中实
现高
精度
VHDL用户quartus ll 开发使用说明
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时间:2020.02.14
上传者:16245458_qq.com
tutorial_quartusii_intro_vhdlQuartusIIIntroductionforVHDLUsersThistutorialpresentsanintroductiontoth
tutorial
quartusii
intro
《Writing Testbenches》电子书pdf版
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大小:1.88MB
时间:2020.02.14
上传者:微风DS
《WritingTestbenches》电子书pdf版,(Kluwer)WritingTestbenches--FunctionalVerificationofHDLModels[1]……
kluwer
writing
Verification
IP复用技术的研究
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时间:2020.02.14
上传者:微风DS
IP复用技术的研究,IP复用技术的研究……
复用
技术
的研
xilinx
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时间:2020.02.14
上传者:rdg1993
xilinx,xilinx-加速设计性能的HDL编码惯例……
Xilinx
加速
设计
华为fpga设计资料
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时间:2020.02.14
上传者:wsu_w_hotmail.com
华为fpga设计资料,华为FPGA的时钟设计……
华为
的时
钟设
短波跳频电台的fpga实现
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时间:2020.02.14
上传者:978461154_qq
短波跳频电台的fpga实现……
短波
跳频
电台
AAL-5 SAR芯片原型设计及实现
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时间:2020.02.14
上传者:二不过三
AAL-5SAR芯片原型设计及实现,AAL-5SARReassemble芯片原型设计及实现2……
aal-5sarreassemble
芯片
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