FPGA/CPLD
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用户281801 2010-8-30 12:05
关于PLB总线的问题
         在访问内存控制器中,当microblaze的缓存使能关闭后,XCL接口禁止使用。这时将通过PLB或者LMB总线进行访问。       PLB总线特点之一: ...
用户224985 2010-8-29 12:06
FPGA/CPLD数字电路设计经验分享
FPGA/CPLD数字电路设计经验分享   摘要: 在数字电路的设计中,时序设计是一个系统性能的主要标志,在高层次设计方法中,对时序控制的抽象度也相应提高 ...
用户259295 2010-8-28 23:01
SOPC技术的发展瓶颈
    如今Xilinx与Altera公司相应的SOPC技术发展已经比较完善,虽然NiosII和MicroBlaze内核的处理速度相对于传统的DSP来说还是比较弱的,但是SOPC技术特有的 ...
用户1560945 2010-8-28 18:35
【黑金动力社区】公开招聘校园代理
黑金动力社区: http://www.heijin.org 如题,在全国各大高校内公开招聘校园代理,先提几点要求吧: 1、在校大学生、研究生或者老师; ...
用户281801 2010-8-28 17:29
SDRAM+XCL
     最近调试的SDRAM,问题多多。归结一下。 mhs文件内容: PORT fpga_0_clk_1_sys_clk_pin = dcm_clk_s, DIR = I, SIGIS = CLK, CLK_FREQ = 66666667 ...
用户320900 2010-8-27 10:48
FPGA应用实例
用户222088 2010-8-27 00:12
FPGA DCM时钟管理单元简介及原理(转)
DCM概述     DCM内部是DLL(Delay Lock Loop(?)结构,对时钟偏移量的调节是通过长的延时线形成的。DCM的参数里有一个PHASESHIFT(相移),可以从0变到255。所 ...
用户222088 2010-8-26 23:41
基于FPGA的UART设计与实现
http://www.21ic.com/app/eda/201008/62973.htm
用户222088 2010-8-26 23:24
用FPGA替代DSP实现即使视频处理
                          用FPGA替代DSP实现即使视频处理 时间:2010-08-19 10:02:54 来源:与非网 作者:David Nicklin    ...
用户222088 2010-8-26 23:22
基于FPGA的可联网游戏平台实现
http://xilinx.eefocus.com/article/10-08/432031282096980.html?sort=316_409_929_0
特权ilove314 2010-8-26 10:50
硬件加速:用起来很美
硬件加速:用起来很美          其实在硬件加速方面,特权同学早想写一篇博文,只是苦于没有合适的对比题材。赶上最近的一个系统平台,整个SOPC, ...
用户1609127 2010-8-25 20:01
[Verilog HDL建模技巧] - 低级建模 · VGA全驱动
原文是《Verilog HDL那些事儿》第3.3 章!但是这本笔记目前还没有写完! 这一章笔记有关于VGA驱动,觉得有很大的参考和学习价值,所以就独立出来了! 嗯! ...
用户1566004 2010-8-24 18:23
ModelSim SE 6.2b 中文注释问题
    问题:如何解决ModelSim SE6.2b 中中文注释为乱码?   解答:在“view ”菜单下 “Encoding” 菜单中选择“ GB2312”。     ...
用户1566004 2010-8-24 18:23
datasheet下载网站整理(查IC芯片手册)【转载】
   作为电子工程师,芯片的datasheet肯定是每天都要接触的。记得在学校学习的时候,芯片手册都是印在书上的,于是以后做电子小制作时,都那课本来看。显 ...
用户294713 2010-8-24 16:26
SOPC中NiosII的LCD显示驱动IP设计
嵌入式/Linux/ARM/DSP/FPGA......海量资源下载,不断更新, 海科资源 http://www.haike-source.com/    引言   NioslI 嵌入式 处理器 ...
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