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科技云报到
2024-7-17 14:45
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原创
科技云报道:将技术普惠进行到底,百度智能云云原生数据库GaiaDB来啦!
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科技云报道原创。 OpenAI再度扔出重磅炸弹。 近期,OpenAI公司在社交平台上宣布,其收购了领先实时分析数据库公司Rockset。 OpenAI强调,OpenAI将在其产品中 ...
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coyoo
2024-7-14 12:25
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原创
ALTERA Cyclone 10器件的使用-6:LVDS差分ADC使用
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概述 SiPM测试系统的信号处理板使用了ADI的单片4通道的高速差分ADC信号,所以FPGA需要通过LVDS接口来收取差分高速ADC送出的差分串行数据。 本 ...
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Tronlong
2024-7-10 15:43
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原创
全国产RK3568J + FPGA的PCIe、FSPI通信实测数据分享!
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测试数据汇总 备注: (1)当TLP header size =16Byte时,PCIe理论传输速率为:782.50MB/s; (2)当TLP header size =12Byte时,PCIe理论传输速率为 ...
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Tronlong
2024-7-10 15:28
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原创
GPMC并口多通道AD采集案例,基于TI AM62x四核处理器平台!
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GPMC并口简介 GPMC(General Purpose Memory Controller)是TI处理器特有的通用存储器控制器接口,是AM62x、AM64x、AM437x、AM335x、AM57x等处理器专用于与外 ...
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coyoo
2024-7-7 13:28
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原创
使用ALTERA的DDIO而不是LVDS模块来设计高速串行ADC接口
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概述 我们知道了ALTERA器件的IOE里有DDR寄存器,而且ALTERA提供了DDIO模块供用户可以自动利用这些DDR寄存器。之前我们也探讨了不使用LVDS模块设计高 ...
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科技云报到
2024-7-6 11:21
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科技云报道:人工智能“顶流”齐聚WAIC 2024,他们都做了什么?
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科技云报道原创。 一个由智能驱动的未来世界长啥样? 从完成跨海跨城航线的“空中的士”、全无人驾驶汽车、实现奔跑功能的全尺寸通用人形机器人到百度文心 ...
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科技云报到
2024-6-27 17:31
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原创
科技云报道:XDR+GPT,高校安全运营建设的最优解
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科技云报道原创。 如今,安全运营已成为高校网络安全建设的必选项,但所创造的护城河似乎并不够宽广—— 二级单位业务与校园网的安全威胁 , 已成为悬在 ...
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科技见闻网
2024-6-25 09:55
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Moka Ascend 2024|势在·人为,技术创新,激发企业管理内在效能
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2024年6月19日,Moka 在深圳举办的 Moka Ascend 2024 产品发布会圆满落幕。此次大会以「势在·人为」为主题,汇聚了来自不同企业的管理者、人力资源专家和技术 ...
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雷龙发展
2024-6-21 18:03
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原创
Verilog:【8】基于FPGA实现SD NAND FLASH的SPI协议读写
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在此介绍的是使用FPGA实现SD NAND FLASH的读写操作,以雷龙发展提供的CS创世SD NAND FLASH样品为例,分别讲解电路连接、读写时序与仿真和实验结果。 目录 ...
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wonharvey
2024-6-19 10:06
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原创
[晒一波电源]+基于可编程逻辑器件的信号检测装置
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一、设计思想 设计一个交流信号的检测装置,对输入进行前期处理,经过A/D采样后数模转换,将测量结果显示出来,并具有一定的测量辅助及扩展功能。设计分别采 ...
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KRAKEN
2024-6-17 17:34
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应对汽车电气化和智能化,少不了它们!
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汽车生产的格局正悄然发生变化。近年来,现代汽车设计中的电子设备和传感器的使用数量呈指数级增长。而随着汽车行业持续向电动汽车和自动驾驶转型,这个 ...
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coyoo
2024-6-15 16:06
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原创
TimeQuest之false paths
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概述 FALSE PATH就是我们在进行综合分析时,不希望综合工具进行分析的那些路径。在ALTERA的一个关于TimeQu ...
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coyoo
2024-6-14 13:39
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原创
ECO那些事之ALM端口DATAF
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ECO那些事之ALM端口DATAF 概述 这里继续《ECO那些事之LE和ALM》一文,详细了解下ALM的端口DATAF,在前文中列举了ALM和LE的差异,其中之 ...
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科技云报到
2024-6-11 17:32
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原创
科技云报道:“元年”之后,生成式AI将走向何方?
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科技云报道原创。 近两年,以大模型为代表的生成式AI技术,成为引爆数字原生最重要的技术奇点,人们见证了各类文生应用的进展速度。Gartner预测,到2026年,超 ...
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蓝蓝的天
2024-6-10 13:00
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带异步高电平有效的置/复位端的D触发器
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代码; dff1.v module dff1( q, qb, d, clk, set , reset ); input d, clk, set , reset; output q, qb; / / 声明q和qb为reg类型,因为它需要在always ...
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