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2012-5-25 09:19
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Synplify通过verilog库(路径: install_dir /lib/xilinx/unisim.v)把Xilinx的Macro当作黑盒处理。 使用时直接在代码中实例化即可,注意与 unisim.v 中 ...
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用户1708388
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初始化register: 1. 推荐方式是直接在HDL代码中描述 reg error_reg = 1'b0; reg address_reg = 8'hff; ...
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用户1708388
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