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遇到LabVIEW应用程序中的性能瓶颈不用愁,这招教你搞定
所需E币:2
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大小:3.42MB
时间:2020.11.18
上传者:xgp416
遇到LabVIEW应用程序中的性能瓶颈不用愁,这招教你搞定资源大小:3.42MB[摘要]提高LabVIEW应用程序的性能 了解如何识别和解决LabVIEW应用程序中的性能瓶颈。使
LabVIEW
应用程序
性能
瓶颈
不用
这招
教你
搞定
一种内嵌LDO的电荷泵型DC-DC转换器
所需E币:4
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大小:6.47MB
时间:2020.11.18
上传者:xgp416
一种内嵌LDO的电荷泵型DC-DC转换器资源大小:6.47MB[摘要]在新一代的纳米级芯片的应用中,经常需要很低的电压去驱动低功耗的电路的运行,并且需要增加供电电池的寿命。但是传统的开关电容电路或者基
一种
内嵌
LDO
电荷泵型
dcdc
转换器
使用深度卷积神经网络进行ImageNet数据库的分类
所需E币:5
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大小:1.54MB
时间:2020.11.18
上传者:xgp416
教程:使用深度卷积神经网络进行ImageNet数据库的分类资源大小:1.54MB[摘要]我们训练了一个大型的深度卷积神经网络,来将在ImageNetLSVRC-2010大赛中的120万张高清图像分为1
使用
深度
卷积神经网络
进行
ImageNet
数据库
分类
LBS在嵌入式GIS中的应用研究
所需E币:4
下载:0
大小:1.11MB
时间:2020.11.18
上传者:xgp416
LBS在嵌入式GIS中的应用研究资源大小:1.11MB[摘要]智能交通系统(InelligentTransportSysTem,简称ITS)智能交通系统将先进的信息技术、数据通讯传输技术、电子传感技术
lbs
嵌入式
gis
应用
研究
一文看懂基于SIMD的媒体处理器
所需E币:4
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大小:2.51MB
时间:2020.11.18
上传者:xgp416
一文看懂基于SIMD的媒体处理器资源大小:2.51MB[摘要]基于SIMD技术的媒体处理器在多媒体处理领域凭借着其良好的可编程性和高性能而备受关注。但是其性能的进一步提高却受制于一些非运算的因素,也就
一文
看懂
基于
SIMD
媒体处理器
SP复杂度HE视频编码
所需E币:4
下载:0
大小:11.81MB
时间:2020.11.18
上传者:xgp416
SP复杂度HE视频编码资源大小:11.81MB[摘要]在过去的几十年里,由于半导体技术的快速发展,计算资源的不断增加和可靠的通信基础设施的可用性,促进了多媒体设备消费市场的大规模扩张。Digitalv
SP
复杂度
HE
视频编码
PPP和HDLC协议
所需E币:3
下载:0
大小:1.14MB
时间:2020.11.18
上传者:xgp416
PPP和HDLC协议资源大小:1.14MB[摘要]特性Low-VDD提单减少泄漏方法分开读端口由M10泄漏性能400mv@475khz3.28华盛顿大学320mVW/O读取错误@27℃380mVW/O
ppp
hdlc
协议
SoC设计中的验证技术有哪些
所需E币:4
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大小:183.06KB
时间:2020.11.18
上传者:xgp416
SoC设计中的验证技术有哪些资源大小:183.06KB[摘要]系统复杂性继续按照摩尔定律增加而功能复杂性的增长速度则更加迅猛为解决这一问题行业提出了通过自动化来实现)设计抽象的概念设计生产率的提升速度
SoC
设计
验证技术
哪些
AMBA总线协议关键模块设计与验证研究
所需E币:4
下载:0
大小:14.77MB
时间:2020.11.18
上传者:xgp416
AMBA总线协议关键模块设计与验证研究资源大小:14.77MB[摘要]集成电路技术近年来的迅速发展,电路的规模和设计的复杂度不断增加,市场的竞争程度也同趋激烈,产品投放时间越来越短,这些因素对设计者和
amba
总线协议
关键
模块
设计与验证
研究
AHB总线上CAN控制器的实现
所需E币:4
下载:0
大小:2.52MB
时间:2020.11.18
上传者:xgp416
AHB总线上CAN控制器的实现资源大小:2.52MB[摘要]CAN总线是一种广泛应用于汽车自动化和工业过程控制领域的现场总线,AHB总线则是一种广泛应用于嵌入式系统的系统总线。本论文介绍了CAN规范和
ahb
总线
can
控制器
实现
16位定点DSP“ES51D16”的可测性设计
所需E币:5
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大小:2.46MB
时间:2020.12.07
上传者:xgp416
16位定点DSP“ES51D16”的可测性设计资源大小:2.46MB[摘要]随着集成电路的设计规模不断扩大和设计周期的逐渐缩短,系统芯片(soC,systemon_a_C11ip)设计已成为芯片设计的
16位
定点
DSP
ES51D16
可测性设计
FPGA+IP核的设计
所需E币:4
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大小:3.24MB
时间:2020.11.18
上传者:xgp416
FPGA+IP核的设计资源大小:3.24MB[摘要] FPGA能够减少电子系统的开发风险和开发成本,缩短上市时间,降低维护升级成本,广泛地应用在电子系统中。随着集成电
FPGAIP
设计
JPEG2000算法的VLSI实现及系统集成
所需E币:4
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大小:4.11MB
时间:2020.11.18
上传者:xgp416
JPEG2000算法的VLSI实现及系统集成资源大小:4.11MB[摘要]随着多媒体技术和互联网的快速发展,信息爨越来越大,给有限的存储空间和传输带宽带来了豳难,鞠而需隳对数据进行有效的处理和压缩。J
jpeg2000
算法
vlsi
实现
系统集成
深入研究MPEG4 标准及其建议的视频解码模型
所需E币:4
下载:0
大小:1.38MB
时间:2020.11.18
上传者:xgp416
深入研究MPEG4标准及其建议的视频解码模型资源大小:1.38MB[摘要]如今信息技术飞速发展,人们对多媒体,特别是包含有大量信息的数字视频的需求也越来越大。同时,超大规模集成电路技术fvLSI)、可
深入
研究
mpeg4
标准
建议
视频解码
模型
DDR硬件设计要点
所需E币:4
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大小:284.5KB
时间:2020.11.18
上传者:xgp416
DDR硬件设计要点资源大小:284.5KB[摘要]DDR的电源可以分为三类:a>主电源VDD和VDDQ,主电源的要求是VDDQ=VDD,VDDQ是给IObuffer供电的电源,VDD是给但是一般
ddr
硬件
设计要点
一文了解综合与Design Compiler
所需E币:4
下载:0
大小:3.62MB
时间:2020.11.18
上传者:xgp416
一文了解综合与DesignCompiler资源大小:3.62MB[摘要]综合是前端模块设计中的重要步骤之一,综合的过程是将行为描述的电路、RTL级的电路转换到门级的过程;DesignCompiler是
一文
解综
Design
compiler
基于Cadence_Allegr_省略_速PCB设计信号完整性分析与仿真
所需E币:2
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大小:391.14KB
时间:2020.11.18
上传者:丸子~
基于Cadence_Allegr_省略_速PCB设计信号完整性分析与仿真
基于
CadenceAllegr
略速
pcb
设计
信号完整性分析
仿真
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