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用户585119
2010-7-6 18:19
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verilog学习笔记【分频器】
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转自： http://www.cnblogs.com/fpga/archive/2009/10/24/1589318.html 占空比为50%的分频 偶数分频比较简单 比如N分频，那么计数到N/2-1，然后时钟翻 ...
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用户585119
2010-7-6 15:45
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verilog学习笔记【casez赋值问题】
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转自： http://www.edufujitsu.org/myspace/blog/show.php?id=169132 在casez的赋值中，如果是都满足，是只进行第一个赋值吗？是每回只判断一个符合就结束 ...
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用户837343
2010-7-6 15:33
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高级篇：第3章 LogicLock 设计方法
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LogicLock是Quartus II内嵌的高级工具之一，通过FPGA物理位置的区域性约束完成提高设计性能、继承以往设计成果、增量编译和团队化设计等功能。 本章主要内 ...
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用户272378
2010-7-6 13:16
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第一次写博客，呵呵。
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用户300529
2010-7-6 10:33
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FPGA夏令营（北京）
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FPGA夏令营（北京） FPGA夏令营介绍 为了满足广大学生暑期FPGA技术性培训的各种需求，有效快速提升学生的fpga技能，使学员在电子竞赛和将来的就业获取竞争优势 ...
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用户142112
2010-7-5 22:32
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结构体，寄存器
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直接写例子 typedef struct { unsigned int a:3; unsigned int b:9; unsigned int c:12; unsigned int d:8; }CTRL_TAB; int main(int argc, char* ...
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特权ilove314
2010-7-5 22:05
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SDHC控制器代码移植日记一（SD_CRC_7）
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SDHC 控制器代码移植日记一（ SD_CRC_7 ） 题记： opencores 是个不可多得的开源好网站，虽然很多时候并不是 ...
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用户180508
2010-7-5 17:00
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dual-purpose管脚分配错误解决
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分配好管脚后，编译出现以下错误 Error: Can't place pins assigned to pin location Pin_AE24 (IOC_X65_Y2_N2) AE24管脚有第二功能nCEO，是多FPGA配置时 ...
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用户1702037
2010-7-4 22:04
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要做的事情
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学会 如何用verilog表示 两个同频率方波不同时刻输入 他们的上升沿到来时刻的时间差。
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用户237991
2010-7-4 17:34
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ZRtech教程--HDL基础语法篇（Verilog篇）【语法工具书】
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https://static.assets-stash.eet-china.com/album/old-resources/2010/7/4/9fca6dcb-3f9b-4195-9349-f6a71cb1c82a.rar https://static.assets-stash.eet-chi ...
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特权ilove314
2010-7-4 17:03
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DMA无处不在
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DMA 无处不在 在一次闲聊中，一位朋友就问其中几位物流专业的同学“你们是什么专业的”。答曰“物流”。那位朋友就调侃说 ...
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用户237991
2010-7-3 08:39
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ZRtech教程--HDL基础语法篇（VHDL篇）【语法工具书】
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学习FPGA，一本语法书是必不可少的 这里为大家推荐我们的 HDL基础语法篇（VHDL篇） 语法中比较关键的地方，都进行了批注，加上了【小提示】 而且电 ...
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用户180508
2010-7-2 16:14
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简单实用的按键去抖Verilog实现
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和单片机用软件实现消抖是一样的原理，这里有一个采样时钟，对按键输入信号进行采样，用两个计数器对高低信号持续时间进行计时，当达到阈值时，就认为信号稳定 ...
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用户180508
2010-7-2 10:01
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奇数分频——可综合
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module clk_odd_div(clk_in,rst_n,clk_out); parameter DIV_NUM = 3,CNT_BIT = 4; //可设置奇数分频数 input clk_in,rst_n; output clk_out; reg cnt1,c ...
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用户837343
2010-7-1 17:25
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高级篇：第2章 altera器件高级特性与应用
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主要内容： . 时钟管理； . 片内存储器； . 数字信号处理； . 片外高速存储器； . 高速差分接口和DPA； . 高速串行收发 ...
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