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用户232776 2009-11-3 20:35
- 占空比为1：1的2的幂次分频电路 VHDL
- library IEEE; use IEEE.STD_LOGIC_1164.ALL; use IEEE.STD_LOGIC_ARITH.ALL; use IEEE.STD_LOGIC_UNSIGNED.ALL; ENTITY CLK_DIV IS PORT(CLK:IN STD_ ...
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特权ilove314 2009-11-3 20:22
- 工程更改管理
- 工程更改管理 想写这篇文章有些日子了，只不过一直没抽空下手。俗话说“人非圣贤，孰能无过”，咱们这些成天和元器件打交道的硬件工程师们也能 ...
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用户1665683 2009-11-3 15:23
- 如何在检测方波上升沿时，输出一个窄脉冲
- 现有一方波输入信号，想在它每个上升沿出现时，就输出一个窄脉冲信号！ 求教：如何在检测方波上升沿时，输出一个窄脉冲 清风淡：这个简单： ...
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用户1122702 2009-11-3 14:42
- Spartan-3e的布线资源
- 术语解释 CLB：4 Slices； Tile：Switch Matrix + 功能单元（如CLB、IOB、DCM）；下图所示： 或者Multiple Switch Matrices + 功能单元（如BRAM、Multiplier ...
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用户105409 2009-11-3 11:25
- 有点转机鸟
- 一个星期里，到底做了啥，周一拿到打出来的板子，周二，周三发现出现MegaCore的time-limited情况，当时又加上tcl说不支持EPM1270T144当时，心情是凉了半截儿， ...
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用户94428 2009-11-1 23:49
- ISE使用说明
- ISE 的使用说明 ?xml:namespace prefix = o ns = "urn:schemas-microsoft-com:office:offic ...
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- 任意倍数的分频器的VHDL描述
- --1000分频器 LIBRARY IEEE; USE IEEE.STD_LOGIC_1164.ALL; USE IEEE.STD_LOGIC_UNSIGNED.ALL; USE IEEE.STD_LOGIC_ARITH.ALL; ENTITY clkdiv IS ...
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- Altera网站资源大搜罗
- Altera 网站资源大搜罗 ?xml:namespace prefix = o ns = "urn:schemas-microsoft-com:office:office" / 所有文档资料的索引在此： ...
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- 转载 FPGA按键模式的研究与设计
- FPGA按键模式的研究与设计 肖 看，朱光喜，刘文予 (华中科技大学 电子与信息工程系，湖北 武汉430074) 2009-03-19 摘 要： 对FPGA设 ...
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用户152969 2009-10-30 14:13
- FPGA流水灯之仿真波形
- 上一篇日志给出了关于流水灯的代码，这篇文章介绍一下如何对其进行仿真。 仿真工具：ModelSim 1、双击ModelSim图标，打开ModelSim； 2、点击File-New-Project ...
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- SF-EP1C玩出新花样
- 利用2个20pin的扩展接口，给SF-EP1C加了个子板。夏普的一款3.5寸320*240的真彩屏，驱动电路在子板上。SF-EP1C上的FPGA读取SD卡中图片，循环显示 ...
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用户204616 2009-10-29 18:54
- 异步FIFO的深度计算....
- 在郁闷了将近半个月，每次笔试每次头疼的异步FIFO的题目，总算有点头绪了。仔细整理下： 分类： 1、USBHUB中的Elasticity Buffer。具体如下，输入时钟trans ...
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用户1317616 2009-10-29 17:05
- Quartus II使用常见问题
- 在Quartus II下进行编译和仿真的时候,会出现一堆warning,有的可以忽略,有的却需要注意,虽然按F1可以了解关于该警告的帮助,但有时候帮助解释的仍然不清楚,大家群 ...
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- FPGA验证技术
- 第一编 验证的重要性 验证，顾名思义就是通过仿真、时序分析、上板调试等手段检验设计正确性的过程，在FPGA/IC开发流程中，验证主要包括功能验证和 ...
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- SVN问题及解决方法
- Q1：当输入SVN命令时，出现如下信息“svnserve.conf:12: Option expected”？ A1：修改svnserve.conf时，去掉anon-access和auth-access的注释‘#’的同时也要把 ...
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