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用户1373959
2009-10-16 12:56
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HAL的不同方式访问字符器件的空间开销简单比较.(Nios II)
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Unix类型 #include "system.h" #include "fcntl.h" #include "unistd.h" int main(void) { int fd; // file descriptor char msg ...
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用户113770
2009-10-16 11:43
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ModelSim SE简明操作指南
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批处理模式仿真必须运行在DOS或UNIX提示符下。 1． 生成一个新目录，设置成当前工作目录。拷贝..\examples\counter.vhd到该目录下。 2． 生成一个新的设 ...
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用户181205
2009-10-16 10:07
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ram 建模
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synplify综合后RTL视图
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用户84013
2009-10-16 09:52
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zz如何学习FPGA verilog 学Quartus和Verilog三步走checklist
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转自 http://www.edacn.net/html/11/105411-78781.html 从网上看来的，发现自己才刚刚开始起步，唉，路漫漫其修远兮。。。 //*********** ...
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用户232569
2009-10-15 23:53
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关于SignalTap的问题
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刚刚看了一位师兄的关于SignalTap的日志，解决了以前的一些困惑，怕忘记在此记下来。曾经遇到过一个工程中加入SignalTap和去掉SignalTap编译后结果不相同 ...
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用户232569
2009-10-15 23:01
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使用QuartusII自带fifo时遇到的问题
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最近做Flash控制器，用到了缓存，为了方便直接使用QuartusII自带异步fifo，但是在使用过程中却出现这样一个问题，输入数据为递增计数器，但是用Signal ...
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特权ilove314
2009-10-15 22:51
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基于Quartus II的在线调试方法
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基于 Quartus II 的在线调试方法 ?xml:namespace prefix = o ns = "urn:schemas-microsoft-com:office:office" / ...
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用户131713
2009-10-15 20:24
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FPGA网站大全
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FPGA网站大全收集的不是很到位，不过希望对大家有帮助！ 1. OPENCORES.ORG 这里提供非常多，非常好的PLD了内核，8051内核就可以在里面找到。 进入后，选择proje ...
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用户146492
2009-10-14 22:56
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如何编写testbench的总结
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转自 quiye's Blog 如何编写testbench 如何编写testbench的总结 2008年11月19日 星期三 04:31 A.M. 如何编写testbench的总结（非 ...
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用户146492
2009-10-14 22:35
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FPGA双向端口inout的使用
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转载：verilog双向端口的使用 芯 片外部引脚很多都使用inout类型的，为的是节省管腿。一般信号线用做总线等双向数据传输的时候就要用到INOUT类型了。就 ...
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用户105881
2009-10-14 15:18
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FPGA设计流程
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FPGA开发流程和IC的开发流程相似，主要分为以下几个部分： 1） 设计输入 ，利用HDL输入工具、原理图输入工具或状态机输入工具等把所要设计的电路描述出来； ...
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用户105881
2009-10-14 15:16
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高速电路设计/信号完整性的一些基本概念
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1. 信号完整性（ Signal Integrity ）：就是指电路系统中信号的质量，如果在要求的时间内，信号能不失真地从源端传送到接收端，我们就称该信号是完整的。 ...
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用户512385
2009-10-14 14:41
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转载：verilog双向端口的使用
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芯 片外部引脚很多都使用inout类型的，为的是节省管腿。一般信号线用做总线等双向数据传输的时候就要用到INOUT类型了。就是一个端口同时做输入和输 出。 inout ...
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用户512385
2009-10-14 14:33
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如何编写testbench的总结(转)
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如何编写testbench的总结 2008年11月19日 星期三 04:31 A.M. 如何编写testbench的总结（非常实用的总结） 附件不能上传，我就捡几点重要 ...
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用户113770
2009-10-14 13:53
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FPGA学习面临的问题
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1.modelsim和signaltap的联合调试 如何将signaltap测试的参数自动作为modelsim的仿真条件？ 2.modelsim如何仿真图像处理算法 3.如何对时序对约束 在quartu ...
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