FPGA/CPLD
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用户152969 2009-11-9 19:54
FPGA之流水灯
学习FPGA有一段时间了,但不连续,很多知识都是看了忘,忘了看,而且也不动手实践,只知道抱着一本书死看,造成的后果就是自己在原地踏步,这也正应了那句话:FP ...
用户1321768 2009-11-9 17:52
关于用FPGA产生正弦(余弦)波形
  最近在做的项目要用到FPGA实现正弦余弦函数,当然了,想到的最快最好的方法就是查表法了(在NIOSII里用C语言实现正余弦函数比较简单,但比较慢,好像是MS ...
用户242274 2009-11-9 15:53
一种冷剂式家用中央空调系统
一种冷剂式 家用中央空调 系统 风管式系统:风管式系统以空气为输送介质,其原理与大型全空气中央家用中央空调系统的原理基本相同,是一个小型化的全空气中 ...
用户209396 2009-11-8 21:05
转载:FPGA的DDS设计
http://article.ednchina.com/Other/20090116090357.htm   这个文章不错,写的很好。好好学习下
用户209396 2009-11-8 20:58
转载:DDS中DAC选型
  转载自: http://blog.ednchina.com/tengjingshu/194337/message.aspx DDS 中 DAC 选型 (原创) ?xml:namespace prefix = o ...
用户1590851 2009-11-8 18:47
贴几个最近弄得东西
1 cypress 68013 与 spartarn 3e 的通讯 ../upload/2009/11/8/e5cd863a-6969-4a49-9a9a-8a8bc56ea176.rar cypress配置为slavefifo 自动收发模式 EP2为OUT EP6 ...
用户1366067 2009-11-8 16:10
嵌套式状态机的描述
      在上周,就有写这个日志的打算咯,今天终于完工。     附件中,用一个简单的例子,描述了嵌套状态机的描述方法,一段式、三段式描 ...
用户1337448 2009-11-8 16:09
Cyclone4的一些主要的技术参数
https://static.assets-stash.eet-china.com/album/old-resources/2009/11/8/1ab11c73-3247-4b53-97de-4accaf8574e9.rar
用户1337448 2009-11-8 11:47
关于上拉下拉电阻(zz)
weak pull up - 上拉电阻大,电流小 ==================================== 一、什么是上拉电阻?什么是下拉电阻? 上拉就是将不确定的信号通过一个电阻嵌 ...
用户146492 2009-11-8 10:43
转载 FIFO在FPGA中应用的一些知识
1.什么是FIFO? FIFO是英文First In First Out 的缩写,是一种先进先出的数据缓存器,他与普通存储器的区别是没有外部读写地址线,这样使用起来非常简单,但 ...
用户146077 2009-11-7 20:08
Pi 数值积分C语言算法
一个计算Pi的程序 用的是数值积分算法 #include math.h #include stdio.h double f(double x); main() { int     i="0"; int     a="0"; int   ...
用户186411 2009-11-7 17:31
分频
//偶数倍分频:偶数倍分频应该是大家都比较熟悉的分频,通过计数器计数是完全可以实现的。如进行N倍偶数分频,那么可以通过由待分频的 //时钟触发计数器计数 ...
用户235210 2009-11-7 13:51
有限状态机
要设计一个存储器控制模块,用状态机实现。 一般写法: module fsm(clk,rst,ready,rw,oe,we); output oe,we; input clk,ready,rw,rst; parameter idle="2"' ...
用户235210 2009-11-7 13:45
8bits全加器的pipeline实现
实验源程序如下: module pipelineadder(clk,cin,a,b,sum,cout); output sum; output cout; input clk,cin; input a,b; reg sum; reg c1,c2,c3,c4,cout; ...
用户235210 2009-11-7 13:31
宏模块altdpram验证
要求:数据8bits,地址总线8bits,用8bits计数器驱动读写地址,边读边写。 方法一:利用fifo使读地址滞后于写地址,同时利用三个不同相位时钟触发不同的模块,其 ...
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