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esad0
2009-10-10 07:57
基于CPLD的PWM信号发生器设计
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ash_riple_768180695
2009-10-9 11:59
TimeQuest就一定要搞定——时序分析基本公式
以下内容译自 Quartus II Version 7.0 Handbook , Volume 3 : Verification 的 6-28 : Clock Analysis 部分。 riple Tim ...
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用户167589
2009-10-9 10:07
FPGA跨时钟处理小结[转]
最近逛各个论坛加上以前学习FPGA和数字电路设计的书,跨时钟处理大概有以下三种,第一种是用来处理一位数据或信号的跨时钟处理,用D触发器而不用组合电路延时的 ...
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特权ilove314
2009-10-8 21:27
《基于FPGA的快速系统原型开发》CH3.2.1译
3.2.1 需求阶段 ?xml:namespace prefix = o ns = "urn:schemas-microsoft-com:office:office" / 为了以最 ...
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用户1337448
2009-10-7 15:36
Timing Closure Methodology for FPGA Design
https://static.assets-stash.eet-china.com/album/old-resources/2009/10/7/61b58ae7-95d5-4319-9746-af0acebb7605.rar" target=_blankEARLY COMP ...
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用户1337448
2009-10-7 14:22
Cyclone3 配置问题
1: Cyclone3在配置的时候(BANK1的电压是2.5V/3V/3.3V)需要在AS器件的DATA 以及JTAG的TDO,TDI上串接一个25ohm的电 阻,目的是为了防止电压过冲超过4.1V ...
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ash_riple_768180695
2009-10-7 11:51
Upgrading from .PTF-format to .SOPC-format
Upgrading from .PTF-format to .SOPC-format Recommendations Explanation Version 7.1 is a major new release for SOPC Builder. A key change is ...
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用户233139
2009-10-6 16:13
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用户534970
2009-10-6 10:59
modelsim se进行时序仿真遇到的问题
今天上午,用modelsim se作了以下简单的时序仿真,但是总是出不来正确的结果,在quartus 8.0下进行时序仿真,也能完全通过。没办法,只好翻出以前做过好使的例 ...
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用户534970
2009-10-6 08:49
使UltraEdit支持Verilog hdl语言(转)
UltraEdit是一款功能强大的文本编辑器,可以编辑文字、Hex、ASCII码,可以取代记事本,内建英文单字检查、C++ 及 VB 指令突显,可同时编辑多个文件,而且即使开 ...
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esad0
2009-10-5 18:47
cpld pwm
// 等脉宽pwm波。用pwm_dat控制占空比 module IntermediateFrequencyWeld( clk,rst_n, PWM_dat, IGBT_1,IGBT_2 ); input ...
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用户232098
2009-10-4 11:50
quartus Ip 仿真
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bitao1983_395643617
2009-10-4 08:55
「穷人ASIC」出世 PCB掰掰?
我们也许很快就能跟印刷电路板(PCB)道别,并能把裸晶(bare die)装配在一种晶圆级硅电路板上,并因此摆脱那些耗电量很大的封装焊接导线。 一家新创 ...
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用户236495
2009-9-30 10:24
Modelsim快捷键
Modelsim的快捷键在不同的窗口下有所不同: 1. 波形窗口(Wave) 鼠标操作: Ctrl+鼠标左键从左上向右下拖拉:放大(选 ...
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用户235811
2009-9-30 08:10
胆结石饮食预防的十种方法
胆结石饮食预防的十种方法 来源: http://www.dqqct.com 链接: 胆结石 , 胆囊炎 , 胆管炎 , 胆管结石 1.多喝水,少憋尿。 2.少喝啤酒。 3. ...
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