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En
c
ounter使用说明.zip
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大小:11.16MB
时间:2020.11.19
上传者:xgp416
En
c
ounter使用说明资源大小:11.16MB[摘要]以一32位流水线加法器设计为例,需要的文件包括:综合后的网表netlist.v。综合后的约束文件netlist.sd
c
,注意需要将该文件中的端
encounter
使用
说明
Zip
数字IC DESIGN技术全局观
所需E币:5
下载:0
大小:4.1MB
时间:2020.11.19
上传者:xgp416
数字ICDESIGN技术全局观资源大小:4.1MB[摘要]•IC(IntegratedCir
c
uit)–集成电路•ASIC(Appli
c
ationSpe
c
ifi
c
IntegratedCir
c
uit)–
数字
ic
Design
技术
全局
34 & 5000 SoC设计和验证电子书
所需E币:5
下载:1
大小:3.11MB
时间:2020.11.19
上传者:xgp416
34/5000SoC设计和验证电子书资源大小:3.11MB[摘要]本书是第一本记录和教授有关被称为硬件/软件联合验证的验证技术的重要信息的书。传统的嵌入式系统设计已经发展成为单片机设计,正在突破1M逻
34
5000
SoC
设计和验证
电子书
混合内存数据集资料 Hybrid Memory Cube Consortium
所需E币:4
下载:0
大小:4.77MB
时间:2020.11.18
上传者:xgp416
混合内存数据集资料HybridMemoryCubeConsortium
混合
内存
数据
资料
hybrid
memory
cube
consortium
一文了解综合与Design Compiler
所需E币:4
下载:0
大小:3.62MB
时间:2020.11.18
上传者:xgp416
一文了解综合与DesignCompiler资源大小:3.62MB[摘要]综合是前端模块设计中的重要步骤之一,综合的过程是将行为描述的电路、RTL级的电路转换到门级的过程;DesignCompiler是
一文
解综
Design
compiler
VLSI-SoC片上系统高级研究电子书
所需E币:5
下载:1
大小:12.36MB
时间:2020.11.18
上传者:xgp416
VLSI-SoC片上系统高级研究电子书资源大小:12.36MB[摘要]本书包含了在第19届IFIP/IEEEWG10.5超大规模集成国际会议上发表的最好论文的扩展和修订版本,这是一个全球性的芯片上系统
VLSISoC
片上系统
高级
研究
电子书
Caden
c
e NC Verilog仿真教程
所需E币:4
下载:3
大小:968.16KB
时间:2020.11.18
上传者:xgp416
Caden
c
eNCVerilog仿真教程资源大小:968.16KB[摘要]这个手册将向你介绍使用NC-Verilogsimulator和SimVision。本文使用的是一个用Veilog硬件编程语言编
cadence
nc
verilog
仿真
教程
Linux 设计SOC的一些基础知识分享
所需E币:4
下载:0
大小:2.37MB
时间:2020.11.18
上传者:xgp416
Linux设计SOC的一些基础知识分享资源大小:2.37MB[摘要]事实上,大多数(如果不是所有)开源应用程序通常都是在诸如ema
c
s(受人尊敬的用户环境和程序编辑器)、g
c
c
(官方GNUC编译器)和
linux
设计
SoC
一些
基础
知识分享
AHB总线上CAN控制器的实现
所需E币:4
下载:0
大小:2.52MB
时间:2020.11.18
上传者:xgp416
AHB总线上CAN控制器的实现资源大小:2.52MB[摘要]CAN总线是一种广泛应用于汽车自动化和工业过程控制领域的现场总线,AHB总线则是一种广泛应用于嵌入式系统的系统总线。本论文介绍了CAN规范和
ahb
总线
can
控制器
实现
Caden
c
e 教学资料
所需E币:5
下载:1
大小:1.75MB
时间:2020.11.18
上传者:xgp416
Caden
c
e教学资料资源大小:1.75MB[摘要]1)将PC机的颜色属性改为256色(这一步必须);2)打开Ex
c
eed软件,一般选用xstart软件,以下是使用步骤:startmethod选择RE
cadence
教学
资料
SoC设计中的验证技术有哪些
所需E币:4
下载:0
大小:183.06KB
时间:2020.11.18
上传者:xgp416
SoC设计中的验证技术有哪些资源大小:183.06KB[摘要]系统复杂性继续按照摩尔定律增加而功能复杂性的增长速度则更加迅猛为解决这一问题行业提出了通过自动化来实现)设计抽象的概念设计生产率的提升速度
SoC
设计
验证技术
哪些
RS编解码器的SOC集成设计和验证
所需E币:4
下载:1
大小:2.11MB
时间:2020.11.18
上传者:xgp416
RS编解码器的SOC集成设计和验证资源大小:2.11MB[摘要]现代社会已经进入数字信息化的时代,保证信息的准确性和可靠性异常重要。纠错码是提高信息传输可靠性的一种重要手段,Rs码是一种典型的纠错码,
rs
编解码器
SoC
集成
设计和验证
国外en
c
ounter7.1培训教程
所需E币:4
下载:0
大小:1.26MB
时间:2020.11.18
上传者:xgp416
国外en
c
ounter7.1培训教程资源大小:1.26MB[摘要]与VLSI课程中的其他练习不同,后端设计流要求您学习如何使用一个商业电子设计自动化(EDA)工具,在我们的案例中遇到了Caden
c
e设
国外
encounter71
培训教程
关于Caden
c
e 版图 Virtuoso Simulation
所需E币:5
下载:10
大小:4.8MB
时间:2020.11.18
上传者:xgp416
关于Caden
c
e版图VirtuosoSimulation资源大小:4.8MB[摘要]接下来,选择刚才在库管理器中创建的库,并选择File->New->单元格视图…我们将创建一个逆变电池的
关于
cadence
版图
virtuoso
simulation
模拟CMOS集成电路设计
所需E币:5
下载:5
大小:25.95MB
时间:2020.11.18
上传者:xgp416
模拟CMOS集成电路设计资源大小:25.95MB[摘要]在新的版本中,一些章节的问题被重新排序,方程和图的参考资料也发生了变化。解决方案手册是基于预览版的,因此必须进行修正以适用于新版本。下面是反映这
模拟
cmos
集成电路设计
A
c
c
ellera标准文件 system verilog资料
所需E币:4
下载:3
大小:4.05MB
时间:2020.11.18
上传者:xgp416
A
c
c
ellera标准文件systemverilog资料资源大小:4.05MB[摘要]A
c
c
ellera标准文件是在A
c
c
ellera内部开发的,A
c
c
elleraorganization,In
c
的技
Accellera
标准
文件
system
verilog
资料
一种内嵌LDO的电荷泵型DC-DC转换器
所需E币:4
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大小:6.47MB
时间:2020.11.18
上传者:xgp416
一种内嵌LDO的电荷泵型DC-DC转换器资源大小:6.47MB[摘要]在新一代的纳米级芯片的应用中,经常需要很低的电压去驱动低功耗的电路的运行,并且需要增加供电电池的寿命。但是传统的开关电容电路或者基
一种
内嵌
LDO
电荷泵型
dcdc
转换器
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