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3D IC堆叠技术
所需E币:4
下载:0
大小:13.29MB
时间:2020.11.19
上传者:xgp416
3DIC堆叠技术资源大小:13.29MB[摘要]前言个人电脑、手机、音乐播放器、游戏系统、相机和flash媒体等消费需求强劲,推动了电子系统市场的爆炸性增长。这些电子系统的设计和制造是通过将单个集成电
3d
ic
堆叠技术
En
c
ounter使用说明.zip
所需E币:5
下载:0
大小:11.16MB
时间:2020.11.19
上传者:xgp416
En
c
ounter使用说明资源大小:11.16MB[摘要]以一32位流水线加法器设计为例,需要的文件包括:综合后的网表netlist.v。综合后的约束文件netlist.sd
c
,注意需要将该文件中的端
encounter
使用
说明
Zip
数字IC DESIGN技术全局观
所需E币:5
下载:0
大小:4.1MB
时间:2020.11.19
上传者:xgp416
数字ICDESIGN技术全局观资源大小:4.1MB[摘要]•IC(IntegratedCir
c
uit)–集成电路•ASIC(Appli
c
ationSpe
c
ifi
c
IntegratedCir
c
uit)–
数字
ic
Design
技术
全局
34 & 5000 SoC设计和验证电子书
所需E币:5
下载:1
大小:3.11MB
时间:2020.11.19
上传者:xgp416
34/5000SoC设计和验证电子书资源大小:3.11MB[摘要]本书是第一本记录和教授有关被称为硬件/软件联合验证的验证技术的重要信息的书。传统的嵌入式系统设计已经发展成为单片机设计,正在突破1M逻
34
5000
SoC
设计和验证
电子书
一种新型无芯PCB平面电感器研究_
所需E币:2
下载:2
大小:185.55KB
时间:2020.11.18
上传者:丸子~
一种新型无芯PCB平面电感器研究_
一种
新型无
pcb
平面
电感器
研究
利用Caden
c
e_Allegro进行PCB级的信号完整性仿真
所需E币:2
下载:6
大小:139.45KB
时间:2020.11.18
上传者:丸子~
利用Caden
c
e_Allegro进行PCB级的信号完整性仿真
利用
cadenceallegro
进行
pcb
信号完整性仿真
基于System C和UML的语音备忘器设计
所需E币:0
下载:1
大小:2.45MB
时间:2020.11.18
上传者:xgp416
基于SystemC和UML的语音备忘器设计资源大小:2.45MB[摘要]随着VLSI的集成度越来越高,设计也越趋复杂。传统的设计方法如原理图输入、HDL语言描述在进行复杂系统设计时,设计效率往往比较低
基于
system
uml
语音
备忘
设计
DC2008—li
c
ense 制作和启动配置文件
所需E币:0
下载:1
大小:791.52KB
时间:2020.11.18
上传者:xgp416
DC2008—li
c
ense制作和启动配置文件资源大小:791.52KB[摘要] DC2008—li
c
ense制作和启动配置文件Li
c
ense制作是很最关键的,没有li
c
ense软件肯定没法
DC2008
license
制作
启动
配置
文件
SOC设计与测试方法培训教材
所需E币:3
下载:1
大小:3.02MB
时间:2020.11.18
上传者:xgp416
SOC设计与测试方法培训教材资源大小:3.02MB[摘要]工程设计的角度来看: 缩减产品设计计划 产品迭代的时间不足 OComplex
SoC
设计
测试方法
培训
教材
Caden
c
e_Tutoria
所需E币:3
下载:1
大小:1.1MB
时间:2020.11.18
上传者:xgp416
Caden
c
e_Tutoria资源大小:1.1MB[摘要]您将创建一个8位加法器多表原理图。你将在图1和图2上创建4位的示意图。1打开一个名为“adder8”的新示意图和库“adder8”2。在[制作
CadenceTutoria
混合内存数据集资料 Hybrid Memory Cube Consortium
所需E币:4
下载:0
大小:4.77MB
时间:2020.11.18
上传者:xgp416
混合内存数据集资料HybridMemoryCubeConsortium
混合
内存
数据
资料
hybrid
memory
cube
consortium
一文了解综合与Design Compiler
所需E币:4
下载:0
大小:3.62MB
时间:2020.11.18
上传者:xgp416
一文了解综合与DesignCompiler资源大小:3.62MB[摘要]综合是前端模块设计中的重要步骤之一,综合的过程是将行为描述的电路、RTL级的电路转换到门级的过程;DesignCompiler是
一文
解综
Design
compiler
VLSI-SoC片上系统高级研究电子书
所需E币:5
下载:1
大小:12.36MB
时间:2020.11.18
上传者:xgp416
VLSI-SoC片上系统高级研究电子书资源大小:12.36MB[摘要]本书包含了在第19届IFIP/IEEEWG10.5超大规模集成国际会议上发表的最好论文的扩展和修订版本,这是一个全球性的芯片上系统
VLSISoC
片上系统
高级
研究
电子书
Caden
c
e NC Verilog仿真教程
所需E币:4
下载:3
大小:968.16KB
时间:2020.11.18
上传者:xgp416
Caden
c
eNCVerilog仿真教程资源大小:968.16KB[摘要]这个手册将向你介绍使用NC-Verilogsimulator和SimVision。本文使用的是一个用Veilog硬件编程语言编
cadence
nc
verilog
仿真
教程
Linux 设计SOC的一些基础知识分享
所需E币:4
下载:0
大小:2.37MB
时间:2020.11.18
上传者:xgp416
Linux设计SOC的一些基础知识分享资源大小:2.37MB[摘要]事实上,大多数(如果不是所有)开源应用程序通常都是在诸如ema
c
s(受人尊敬的用户环境和程序编辑器)、g
c
c
(官方GNUC编译器)和
linux
设计
SoC
一些
基础
知识分享
En
c
ounter 用户指南PDF文档
所需E币:0
下载:1
大小:3.23MB
时间:2020.11.18
上传者:xgp416
En
c
ounter用户指南PDF文档资源大小:3.23MB[摘要]I/Oassignmentfile定义I/Opad单元和管脚的组成规则。文件基于规则指定exa
c
tlo
c
ation,globalspa
encounter
用户指南
pdf
文档
AHB总线上CAN控制器的实现
所需E币:4
下载:0
大小:2.52MB
时间:2020.11.18
上传者:xgp416
AHB总线上CAN控制器的实现资源大小:2.52MB[摘要]CAN总线是一种广泛应用于汽车自动化和工业过程控制领域的现场总线,AHB总线则是一种广泛应用于嵌入式系统的系统总线。本论文介绍了CAN规范和
ahb
总线
can
控制器
实现
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