FPGA/CPLD
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用户145710 2011-5-13 18:18
【原创】Inout的使用和仿真
        Inout类型在使用和仿真时需要将其理解为2个端口,每个时刻有且只有一个在使用状态。我们在处理时可以将其手动分为2个端口,一个输入,另一个是 ...
用户145710 2011-5-13 18:17
【原创】Cyclone III中LVDS的设计
一,概述        LVDS低压差分信号,最早由美国国家半导体公司 提出的一种高速串行信号传输电平,由于它传输速度快,功耗低,抗干扰能力强,传输距离 ...
用户145710 2011-5-13 17:47
【原创】Synplify 综合“黑匣子”的方法(一)
一, Synplify和“黑匣子”简介        Synplify是业界领先的基于FPGA的ASIC原型验证综合工具,通过提供诸如团队设计、自动re-timing、快速的编译以及 ...
用户145710 2011-5-13 17:47
【原创】Synplify 综合“黑匣子”的方法(二)
3,    运行Synplify,生成VQM文件。可能会出现一个警告,这是因为Synplify无法为黑匣子提供准确的时序模型,可以忽略。如下图所示:     4,  ...
用户145710 2011-5-13 17:46
【原创】使用Debussy调试HDL程序(一)
1.Debussy简介    Debussy是NOVAS Software, Inc(思源科技)(现在已经被Spring soft收购,Debussy更名为Verdi)发展的HDL Debug Analysis tool,这套软 ...
用户145710 2011-5-13 17:46
【原创】使用Debussy调试HDL程序(二)
3.Debussy使用   (1)开启界面,Fileàimport design加入源代码,选择“From File”如下图所示:         导入成功后可以看到以下的 ...
用户145710 2011-5-13 17:45
【原创】使用Debussy调试HDL程序(三)
4. nLint的使用   (1)开启图形介面的nLint nLint的图形界面必须使用脚本才能唤醒。如下图,在安装目录的bin文件下建立一个.bat文件。输入:“nlin ...
用户145710 2011-5-13 17:19
【转载】逻辑综合器的故事
span class="t" href="tag.php?name=FPGA" _tag(event)       FPGA设计流程中,逻辑综合的过程非常重要。 由于HDL代码的多样性,逻辑综合的质量对最终 ...
用户1609127 2011-5-13 15:39
第四章 关于仿真对象和激励文件
第四章 关于仿真对象和激励文件 有关仿真对象和激励文件的“缘”真是长长的一条直线 ... 仿真对象就是我们用Quartus II 之类软件建立的模块。反之激 ...
用户1609127 2011-5-13 15:35
嗯~就这样先把
最近编辑的几张笔记是用来给新手或者丧尸(徘徊者)简单的扫盲。 笔记的内容回绕着: “什么是仿真” “编译的要点” “modelsim应该用到什么程度” “ ...
用户404775 2011-5-12 23:03
FPGA SOPC nios uc/GUI V3.90a 的移植
一、硬件配置 (1)SDRAM,PLL 50MHz,CFI FLASH 二、详细内容待更新,实验进行中。
wdzfd 2011-5-12 19:56
[转]亚稳态分析
1,简介 这篇文章是我对 电子 设计 中,亚稳态问题的一种分析和总结。文章通过对数字 电路 中器件的工作机制的介绍,引出亚稳态问题的发生机制。并通过对亚稳态 ...
特权ilove314 2011-5-12 09:32
《爱上FPGA开发——特权和你一起学NIOS2》目录
爱上FPGA开发——特权和你一起学NIOS2 卷首语 真理必叫你们得以自由 第一章   海阔天空聊概念     1.1 CPU之软核与硬核     1.2 SOPC是什么 ...
用户1652771 2011-5-11 22:35
ModelSim-Altera 6.1g 破解
        破解 第三方仿真软件ModelSim-Altera 6.1g (Quartus II 8.0sp1) Web Edition 破解程序(详细见附件) attachment download ...
用户1460054 2011-5-11 16:09
xilinx-并口下载线原理图-pdf
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