-
用户302882
2011-5-22 23:03
-
nios添加头文件错误
-
最近在学FPGA 的NIOS,NIOSII IDE中出现这种错误,为什么呢?郁闷中! 这个是程序我是想测试SDRAM的,在sopc中添加了一个SDRAM 的控制 ...
-
-
用户1353638
2011-5-21 23:44
-
EDN博客之路
-
最近发现FPGA方面出的一本新书《深入浅出玩转FPGA》,全书大部分内容都拜读了。对作者的精神很是敬佩, 看得出来作者对技术相当的执着,能深入 ...
-
-
wrhwindboy
2011-5-21 07:06
-
基于FPGA的多种分频设计与实现,Verilog硬件描述语言,FPGA,半整数分频器
-
http://www.cnemb.com/bencandy-53-40095-1.htm 分频器是FPGA设计中使用频率非常高的基本单元之一。尽管目前在大部分设计中还广泛使用集成锁相环(如alte ...
-
-
wrhwindboy
2011-5-21 07:01
-
IC设计中逻辑综合的一般步骤及相关基本概念
-
http://www.52rd.com/Blog/Detail_RD.Blog_hitlsg_8398.html 综合概述 综合中的延迟及关键路径 图1中给出了常见的两个寄存器R1和R2之间的时序路径。R1和 ...
-
-
wrhwindboy
2011-5-21 06:58
-
华为_内部培训资料大全
-
http://www.cnttr.com/28719 1:华为_大规模逻辑设计指导书 资源: http://bbs.baishutang.cn/thread-6232-1-1.html 2:华为_FPGA设计流程指南 ...
-
-
wrhwindboy
2011-5-21 06:53
-
MSEE ASIC 面试题目总结
-
MSEE ASIC 面试题目总结 没啥大的框架,基本是面试完了以后记在本子上了。水平有限,凑合着看吧 :p Reference: A Circuits and Systems Perspective (3rd Edi ...
-
-
wrhwindboy
2011-5-21 06:50
-
序列检测器
-
序列检测器是时序数字电路中非常常见的设计之一。它的主要功能是:将一个指定的序列从数字码流中识别出来。接下来就以设计“01101”这个序列的检测器为例,说明Ve ...
-
-
wrhwindboy
2011-5-21 06:44
-
关于IIC总线
-
1、物理层 IIC用于将微控制器连接到系统的总线。它只使用两条线:串行数据线(SDL)用于数据传送,串行时钟线(SCL)用于指示什么时候数据线上是有效 ...
-
-
wrhwindboy
2011-5-21 06:43
-
IIC总线
-
即 I2C ,一种 总线 结构。 IIC 是作为 英特尔 IC 的互补,这种总线类型是由菲利浦半导体公司在八十年代初设计出来的,主要是用来连接整体电路( ICS ...
-
-
wrhwindboy
2011-5-21 06:42
-
IIC总线原理与设计
-
I2C总线原理及应用实例 I2C(Inter-Integrated Circuit)总线是一种由PHILIPS公司开发的两线式串行总线,用于连接微控制器及其外围设备。I2C ...
-
-
wrhwindboy
2011-5-21 06:41
-
初学者如何学习FPGA
-
随着半导体和嵌入式系统应用技术的高速发展,FPGA已经被广泛地应用于各行各业,无论是家用电器、智能玩具、数码产品,还是通信行业、工业自动化、汽车电子、医 ...
-
-
wrhwindboy
2011-5-21 06:40
-
约束、时序分析的概念
-
很多人询问关于约束、时序分析的问题,比如:如何设置setup,hold时间?如何使用全局时钟和第二全局时钟(长线资源)?如何进行分组约束?如何约束某部分组合逻 ...
-
-
wrhwindboy
2011-5-21 06:39
-
静态时序分析(Static Timing Analysis)基础及应用(2)
-
前言 在制程进入深次微米世代之后,晶片(IC)设计的高复杂度及系统单晶片(SOC)设计方式兴起。此一趋势使得如何确保IC品质成为今日所有设计从 ...
-
-
wrhwindboy
2011-5-21 06:37
-
静态时序分析(Static Timing Analysis)基础与应用(1)
-
前言 在制程进入深次微米世代之后,晶片(IC)设计的高复杂度及系统单晶片(SOC)设计方式兴起。此一趋势使得如何确保IC品质成为今日所有设计从业 ...
-
-
wrhwindboy
2011-5-21 06:36
-
基于FPGA的抢答器设计
-
抢答器在各类竞赛中的必备设备,有单路输入的,也有组输入方式,本设计以FPGA 为基础设计了有三组输入(每组三人),具有抢答计时控制,能够对各抢答小组成绩进行 ...
-
关闭
站长推荐
/3