FPGA/CPLD
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wrhwindboy 2011-6-11 09:22
我是一只IT小小鸟-连载1
作者序 2009 年 3 月的某个晚上,我跟侯磊同学在万柳宿舍卧谈。我们聊起初来北大软件学院时的志向与苦闷,我们梳理影响自己的人和事,说各自的实习感受 ...
用户1254810 2011-6-11 01:31
Lattice:“军备竞赛”成就差异化定位
“FPGA市场的竞争就像军备竞赛,同时也就给了Lattice创新和差异化的机会。我们的产品不需要实现如此高的速度,而是专门为低功耗而定制,适用于重点应用” ...
wrhwindboy 2011-6-10 21:17
对FPGA认识、学习和进阶
自从接触和认识FPGA以后,自由电子科技坚定的选择了FPGA器件作为我们创新和实现自身价值的承载平台,对此,我想从以下几个方面介绍一下。 1. 对FPGA的认识,为 ...
wrhwindboy 2011-6-10 21:15
FPGA学习的一些误区
作者:某人(摘自网络,不知道作者) 我常年担任多个有关FPGA学习研讨的QQ群管理员,长期以来很多新入群的菜鸟们总是在重复的问一些非常简单但是又让新手困 ...
wrhwindboy 2011-6-10 21:14
这是一篇很好的文章,学verilog的可以好好看看
这是一篇很好的文章,学verilog的可以好好看看 规范很重要 工作过的朋友肯定知道,公司里是很强调规范的,特别是对于大的设计(无论软件 还是硬件),不 ...
wrhwindboy 2011-6-10 21:10
FPGA牛人的经验谈
在 IC 工业中有许多不同的领域, IC 设计者的特征也会有些不同。在 A 领域的一个好的 IC 设计者也许会花很长时间去熟悉 B 领域的知识。在我们职业生涯的开始,我 ...
wrhwindboy 2011-6-10 21:09
FPGA\CPLD设计学习笔记
1、硬件设计基本原则 (1)、速度与面积平衡和互换原则:一个设计如果时序余量较大,所能跑的频率远高于设计要求,能可以通过模块复用来减少整个设计消耗的芯片面 ...
wrhwindboy 2011-6-10 20:50
DC synthesis script总结
1. synthesis library 设置相关: Set_target_library, set_symbol_library, set_link_library, Set_search_path, set_link_path ...
wrhwindboy 2011-6-10 20:48
ASIC/SoC后端设计作业流程剖析
      引言  众所周知,ASIC产品是从用硬件描述语言( verilog HDL ,VHDL)开始进行数字逻辑 电路设计 的,经过相关的仿真、综合出门级网表、 ...
wrhwindboy 2011-6-10 20:45
数字电路的设计环境(转帖)
转帖地址 http://blog.sina.com.cn/s/blog_495437290100a3ka.html 从07年三月份开始工作到现在一年多了,在这一年里换个几个地方,总体感觉各个地方的差别不 ...
wrhwindboy 2011-6-10 20:43
避免用组合逻辑产生时钟
今天看到一个问题如下:   在生成位流文件的时候,显示的警告如下:   Clock net u8/dout_not 0001 is sourced by a combinatorial pin.This is not good des ...
wrhwindboy 2011-6-10 20:40
做个精致的电子工程师【转】
今天是我24岁的生日,很想写篇文章纪念一下,稀里糊涂毕业15个月了,马马虎虎工作了,傻了吧叽失恋了,整天陪在电脑旁边,结果发现网络的世界还真是有种不一样的 ...
用户1609127 2011-6-10 13:19
Verilog HDL的礼物 - Verilog HDL扫盲文
目录 02 第0章 Verilog HDL语言扫盲文 03 0.01 各种的HDL语言 03 0.02 HDL语言的层次 03 0.03 RTL级和组合逻辑级 04 0.04 Verilog HDL语言真的那么难掌握? ...
用户337439 2011-6-7 11:46
多参量差压变送器DMP9051全超越国外产品上海诺莎机电推出0213919
DMP9051 多参量变送器:集 差压变送器、 温度变送器 、 压力变送器 、 流量积算仪与一体的新型变送器,可显示 工作 压力、 温度 、 瞬时 、 累 ...
用户320092 2011-6-7 11:33
基于D触发器的按键消抖程序(转)
//希望大家留下自己的想法,互相学习啊 reg   shifter; input pink; output pink_out; reg pink_out; always  ...
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