FPGA/CPLD
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用户303340 2011-2-21 17:05
testbench学习
标签: testbench    verilogHDL    书写testbench是数字电路设计中不可或缺的一项设计方法,主要是提供的是激励。尽管现在各种开发工具都通过绘 ...
用户113770 2011-2-21 15:26
FPGA提高fmax的方法
以前在设计FPGA时从来没有关注过fmax,因为很少碰到因为时序不满足导致系统无法正常工作。后来尽管在程序很大的时候会出现slack为负的情况,但是不影响系统的运 ...
用户1586347 2011-2-21 14:05
高速收发器基础
高速收发器是指100mb~1Gb传输,应用在系统的PHY层。主要由电路板走线,Fiber和CAT5作为介质。 两个子层: 1.物理编码子层(PCS):在物理介质上传输并行数 ...
用户1586347 2011-2-21 14:05
Implementing video systems
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用户1586347 2011-2-21 13:39
Quartus 10.1 新功能
两个重大改进: 1. 集成新的Qsys软件替代原有的SOPC 2. 新的Timing Closure 还有一个好的工具来开发DDRx内存:Enhanced external interface toolkit ...
用户1586347 2011-2-21 13:38
FPGA器件的高速IO系统设计
FPGA器件的高速IO系统设计 目的: 1. 电路板级信号完整性(SI)分析需求 2. 同步开关噪声(SSN)的产生原因与改善 3. 如何利用FPGA软件完成S ...
用户1586347 2011-2-21 11:56
Chip Planner
1.a display tool 2.working with assignment 3.performing ECO changes
用户1396350 2011-2-20 15:53
Testbench学习笔记(一)
书写testbench是数字电路设计中不可或缺的一项设计方法,主要是提供的是激励。尽管现在各种开发工具都通过绘制波形图的方法生成测试激励,测试书写的代码,但是 ...
用户1314788 2011-2-19 10:40
STM 中断与事件
STM32中外部中断与外部事件 这张图是一条外部中断线或外部事件线的示意图,图中信号线上划有一条斜线,旁边标志19字样的注释,表示这样的 ...
用户1631420 2011-2-18 21:51
起点
新的一年开始了。。   我的fpga之旅也随之展开,刚开始学,还有点摸不清头脑,很喜欢特权老师那句话   永远忠于年轻时的梦想! ...
用户1631420 2011-2-18 21:50
转用matlab生成mif文件
用MATLAB生成QUARTUS II的*.mif   做设计时经常要调用芯片内存。特别对于 ROM ,内存的初始化就显得比较重要。当然你完全可以手工在 QUART ...
用户160814 2011-2-18 15:23
altium designer做FPGA是碰到的问题?
如图问题,如何消除?感谢。
fuxiao123_401762695 2011-2-17 11:22
今天解决了一个很基础的问题
今天解决了一个很基础的问题 在论坛里看到有人提问如下代码报错: define plus 3'd0 `define minus 3'd1 `define band 3'd2 `define bor 3'd3 `define unegat ...
用户143688 2011-2-14 16:52
FPGA设计之复位系统的设计
FPGA的复位主要分为同步复位和异步复位两种,复位电平又分为高电平复位和低电平复位两种,那么我们系统设计中到底应该采用哪种复位设计呢? 根据Xilinx公司的 ...
用户143688 2011-2-14 15:55
用FPGA Editor提高设计效率(3)
这里简单介绍一下FPGA Editor中Probe在项目中的应用,一种简单而快速逻辑调试的方法。一般情况下电路板上都会把一些FPGA的管脚引出来作为GPIO来使用,方便以后 ...
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