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A SystemC Primer-附书中实例
所需E币:4
下载:0
大小:6.22MB
时间:2020.11.19
上传者:xgp416
ASystemCPrimer-附书中实例资源大小:6.22MB[摘要]systenC是电子设计世界中多个相互关联的“strees点”汇合的副产物。
systemc
primer
附书
实例
Synopsys Design Compiler® User Guide合成的概念和命令
所需E币:5
下载:4
大小:6.35MB
时间:2020.11.19
上传者:xgp416
DesignCompiler®UserGuide合成的概念和命令资源大小:6.35MB[摘要]设计编译器用户指南为设计编译器工具的用户提供基本的综合信息。本手册描述了合成的概念和命令,并给出了
synopsys
Design
compiler
user
guide
合成
概念
命令
考虑栅氧化层SBD,NBTI和MOSFET的SRAM稳定性分析
所需E币:0
下载:2
大小:6.35MB
时间:2020.11.19
上传者:xgp416
考虑栅氧化层SBD,NBTI和MOSFET的SRAM稳定性分析资源大小:6.35MB[摘要]对超薄栅氧化物,采用软击穿(SBD)技术广泛研究,但没有完全集成到电路可靠性模拟。使用一个6TSRAM单元作
考虑
栅氧化层
SBD
NBTI
mosfet
SRAM
稳定性分析
使用Synopsys Design Compiler进行ASIC芯片合成,编译
所需E币:3
下载:0
大小:3.9MB
时间:2020.11.19
上传者:xgp416
用SynopsysDesignCompiler进行ASIC芯片合成,编译资源大小:3.9MB[摘要]半导体行业有一个被证明的记录,即迅速将IC设计规模的参考降低到荒谬地无关紧要的地步。我们作为一个群体
使用
synopsys
Design
compiler
进行
ASIC
芯片
合成
编译
CPF-Si2 Common Power Format Specification
所需E币:0
下载:1
大小:2.41MB
时间:2020.11.19
上传者:xgp416
CPF-Si2CommonPowerFormatSpecification资源大小:2.41MB[摘要]芯片应用向消费性应用的转变,以及最新工艺技术的变化,使得power成为全球大多数芯片的主要设计标
CPFSi2
common
power
format
specification
3D IC堆叠技术
所需E币:4
下载:0
大小:13.29MB
时间:2020.11.19
上传者:xgp416
3DIC堆叠技术资源大小:13.29MB[摘要]前言个人电脑、手机、音乐播放器、游戏系统、相机和flash媒体等消费需求强劲,推动了电子系统市场的爆炸性增长。这些电子系统的设计和制造是通过将单个集成电
3d
ic
堆叠技术
Encounter使用说明.zip
所需E币:5
下载:0
大小:11.16MB
时间:2020.11.19
上传者:xgp416
Encounter使用说明资源大小:11.16MB[摘要]以一32位流水线加法器设计为例,需要的文件包括:综合后的网表netlist.v。综合后的约束文件netlist.sdc,注意需要将该文件中的端
encounter
使用
说明
Zip
数字IC DESIGN技术全局观
所需E币:5
下载:0
大小:4.1MB
时间:2020.11.19
上传者:xgp416
数字ICDESIGN技术全局观资源大小:4.1MB[摘要]•IC(IntegratedCircuit)–集成电路•ASIC(ApplicationSpecificIntegratedCircuit)–
数字
ic
Design
技术
全局
34 & 5000 SoC设计和验证电子书
所需E币:5
下载:1
大小:3.11MB
时间:2020.11.19
上传者:xgp416
34/5000SoC设计和验证电子书资源大小:3.11MB[摘要]本书是第一本记录和教授有关被称为硬件/软件联合验证的验证技术的重要信息的书。传统的嵌入式系统设计已经发展成为单片机设计,正在突破1M逻
34
5000
SoC
设计和验证
电子书
一种新型无芯PCB平面电感器研究_
所需E币:2
下载:2
大小:185.55KB
时间:2020.11.18
上传者:丸子~
一种新型无芯PCB平面电感器研究_
一种
新型无
pcb
平面
电感器
研究
利用Cadence_Allegro进行PCB级的信号完整性仿真
所需E币:2
下载:6
大小:139.45KB
时间:2020.11.18
上传者:丸子~
利用Cadence_Allegro进行PCB级的信号完整性仿真
利用
cadenceallegro
进行
pcb
信号完整性仿真
基于System C和UML的语音备忘器设计
所需E币:0
下载:1
大小:2.45MB
时间:2020.11.18
上传者:xgp416
基于SystemC和UML的语音备忘器设计资源大小:2.45MB[摘要]随着VLSI的集成度越来越高,设计也越趋复杂。传统的设计方法如原理图输入、HDL语言描述在进行复杂系统设计时,设计效率往往比较低
基于
system
uml
语音
备忘
设计
DC2008—license 制作和启动配置文件
所需E币:0
下载:1
大小:791.52KB
时间:2020.11.18
上传者:xgp416
DC2008—license制作和启动配置文件资源大小:791.52KB[摘要] DC2008—license制作和启动配置文件License制作是很最关键的,没有license软件肯定没法
DC2008
license
制作
启动
配置
文件
SOC设计与测试方法培训教材
所需E币:3
下载:1
大小:3.02MB
时间:2020.11.18
上传者:xgp416
SOC设计与测试方法培训教材资源大小:3.02MB[摘要]工程设计的角度来看: 缩减产品设计计划 产品迭代的时间不足 OComplex
SoC
设计
测试方法
培训
教材
Cadence_Tutoria
所需E币:3
下载:1
大小:1.1MB
时间:2020.11.18
上传者:xgp416
Cadence_Tutoria资源大小:1.1MB[摘要]您将创建一个8位加法器多表原理图。你将在图1和图2上创建4位的示意图。1打开一个名为“adder8”的新示意图和库“adder8”2。在[制作
CadenceTutoria
混合内存数据集资料 Hybrid Memory Cube Consortium
所需E币:4
下载:0
大小:4.77MB
时间:2020.11.18
上传者:xgp416
混合内存数据集资料HybridMemoryCubeConsortium
混合
内存
数据
资料
hybrid
memory
cube
consortium
一文了解综合与Design Compiler
所需E币:4
下载:0
大小:3.62MB
时间:2020.11.18
上传者:xgp416
一文了解综合与DesignCompiler资源大小:3.62MB[摘要]综合是前端模块设计中的重要步骤之一,综合的过程是将行为描述的电路、RTL级的电路转换到门级的过程;DesignCompiler是
一文
解综
Design
compiler
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