FPGA和CPLD-可编程逻辑器件-第336页-面包板社区

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用户1560945 2010-8-2 00:18: 【连载】NIOSII那些事儿--如何将程序下载到EPCSX中(十三); 黑金动力社区： http://www.heijin.org 声明：本文为原创作品，版权归本博文作者所有，如需转载，请注明出处简介 ...; 4404 7 0 7

用户1560945 2010-8-2 00:18: 【连载】NIOS II下关于无法进行寄存器方式操作PIO的问题解析（十四）; 黑金动力社区： http://www.heijin.org 声明：本文为原创作品，版权归本博文作者所有，如需转载，请注明出处 ...; 4485 5 0 5

用户1560945 2010-8-2 00:18: 【连载】NIOSII那些事儿--FLASH实验(十五); 黑金动力社区： http://www.heijin.org 声明：本文为原创作品，版权归本博文作者所有，如需转载，请注明出处这一节，我们来 ...; 6727 6 0 6

用户1560945 2010-8-2 00:17: 【连载】NIOSII那些事儿--对寄存器结构体的详细解析(十六); 黑金动力社区： http://www.heijin.org 声明：本文为原创作品，版权归本博文作者所有，如需转载，请注明出处这一节，我们针 ...; 4990 6 0 6

用户1560945 2010-8-2 00:17: 【连载】NIOSII那些事儿--基于AVALON总线的IP定制（十七）; 黑金动力社区： http://www.heijin.org 声明：本文为原创作品，版权归本博文作者所有，如需转载，请注明出处简介 NIOS ...; 8193 8 2 10

用户1560945 2010-8-2 00:16: 【连载】NIOSII那些事儿--定时器应用实例（十八）; 黑金动力社区： http://www.heijin.org 声明：本文为原创作品，版权归本博文作者所有，如需转载，请注明出处最近写了个小程序，动 ...; 5093 6 1 7

用户1560945 2010-8-2 00:16: 【连载】NIOSII那些事儿--USB设备模式（十九）; 黑金动力社区： http://www.heijin.org 声明：本文为原创作品，版权归本博文作者所有，如需转载，请注明出处简介这一节， ...; 5688 5 1 6

用户1560945 2010-8-2 00:14: 【连载】NIOSII那些事儿--LCD驱动及图片显示（二十一）; 黑金动力社区： http://www.heijin.org 声明：本文为原创作品，版权归本博文作者所有，如需转载，请注明出处简介 ...; 5773 7 0 7

用户1560945 2010-8-2 00:13: 【连载】NIOSII那些事儿--USB主机模式（二十）; 黑金动力社区： http://www.heijin.org 声明：本文为原创作品，版权归本博文作者所有，如需转载，请注明出处上一节，我们讲了 ...; 6687 7 0 7

用户1560945 2010-8-2 00:10: 【连载】【FPGA黑金开发板】NIOSII那些事儿--LCD中英文字符显示（二十二）; 黑金动力社区： http://www.heijin.org 声明：本文为原创作品，版权归本博文作者所有，如需转载，请注明出处这一节，我们在上 ...; 5080 7 0 7

用户1560945 2010-8-2 00:10: 黑金动力社区开通了，欢迎大家光临！; 黑金动力社区： http://www.heijin.org 　　为了让大家有一个更好的学习交流环境，我们花了很大的精力和财力开通了黑金开发板技术论坛，网址是： h ...; 19283 17 0 17

用户387953 2010-8-1 20:35: 三种16位乘法器的程序; 16位移位式乘法器 module multl16S(P,A,B); output P; input A; input B; reg p; reg temp; reg a; reg b; reg bitN; always @ (A or B) begin ...; 1703 4 0 4

用户1049668 2010-8-1 13:29: clock的处理（未完）; clock的处理 1. 概念： 1.1 clock tree：从一个clock源出发，clock网络经过多级buffer，到达每个时序器件的clk脚。为了保证从clock源到每个器件clk脚的延时相 ...; 10466 9 0 9

用户230340 2010-8-1 13:27: 动态扫描的数码管SlaveIP设计; 写一个简单的Avalon_MM Slave IP, 供初学者学习. 控制七段数码管显示,动态扫描, 每组4个数码管,共用数据线,一共两组. ...; 2018 10 0 10

用户211539 2010-8-1 13:05: FPGA时序约束--时序分析的基本概念; Timing analysis tells how a circuit will behave and how you want the design to behave(constraints paint picture of how design should operate, provide ...; 6861 7 2 9

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