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EDA/ IP/ 设计与制造

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半导体产业杂谈 2018-8-7 16:32: 3nm芯片工艺开发成本高达40亿美元，然而更大的麻烦却是……; "开发复杂芯片的成本可能高达15亿美元，而电源 / 性能效益却可能会下降。" 随着芯片制造商开始在市场上推进10nm/7nm技术，供应商也在为下一代3nm晶体管类 ...; 4043 21 0 2

3nm晶体管 nanosheet FET

半导体产业杂谈 2018-8-3 19:33: ASML出货5nm工艺的DUV光刻机，细说先进节点光刻技术及代工博弈 ... ... ...; 据外媒报道，光刻机霸主ASML（阿斯麦）已经开始出货新品Twinscan NXT:2000i DUV（NXT:2000i双工件台深紫外光刻机），可用于7nm和5nm节点。NXT:2000i将是NXE:340 ...; 19544 25 0 25

光刻机 ASML

用户1052844 2018-4-27 17:06: 【博客大赛】一个退休电子工程师的“芯”声; ...; 8731 28 6 20

liys59

忆轻狂 2018-4-19 14:13: 【博客大赛】防静电产线搭建; 以前年轻的时候，总喜欢挥斥方遒，现在年纪大了，正如编辑所说，拿着白菜的钱，操着 ** 的心，就没啥意义了，所以最近很少写时新技术的评论，反而多是入门级 ...; 3684 30 5 10

防静电

riverxian 2018-3-29 19:10: 2018慕尼黑电子展-4; 1628 18 0 18

riverxian 2018-3-29 19:02: 2018慕尼黑电子展-3; 1366 23 0 23

riverxian 2018-3-29 18:59: 2018慕尼黑电子展-2; 1268 29 0 29

riverxian 2018-3-29 18:10: 2018慕尼黑电子展图片-1; 1686 23 2 23

用户3877389 2018-2-26 15:41: 立创EDA开源工程ADC-CS1237模块电路设计分享; 这次要演示的开源工程是由技新电子提供的关于24位差分ADC模块。根据说明， PCB设计软件使用的是立创EDA，元件提供商由立创商城提供，电路板制造商是深圳嘉立 ...; 3597 22 0 22

立创EDA ADC模块电路设计开源工程

用户3875630 2017-11-28 11:56: CMOS图像传感器市场巨头林立，中国企业如何突出重围？; CMOS 图像传感器市场巨头林立，中国企业如何突出重围？随着科技全球化的进一步推进，以及世界范围内暴力、恐袭事件的频发， ...; 2136 19 1 2

cmos图像传感器国产芯片 SmartSens

用户1443747 2017-10-27 08:33: 故障维修:短路的排母; 同事拿来一块板，说测试有问题。我检查了一下，发现继电器控制有故障。驱动继电器的是ULN2003，12V继电器供电，继电器断开状态ULN2003端口处电压并不呈现12V， ...; 1743 11 0 11

故障器件失效

用户1443747 2017-10-26 08:46: 工作流程的必要性; 昨天吃过晚饭，趴在床上翻手机。接到嘉立创小哥的电话，说打样的板子有条线没连上，他已经帮我连上了。打开电脑下载文件，运行Design Rule Check，果然 ...; 1403 8 0 8

随笔 pcb

用户1818348 2017-10-2 23:21: Altium拾遗; 版本：v13.0 批量修改元器件封装 1.在原理图界面下，使用右键--find similar功能筛选出需要修改封装的元件。 2.ctrl+a将这些元件全部选中 3.在右下 ...; 1609 14 1 3

altium pcb

用户3861365 2017-8-22 18:24: 在设计前期选择更好的架构，避免在后期出现时序收敛问题; 今天，系统芯片（SoC）的架构非常复杂，不论是什么项目，由于它们很复杂，设计团队之间会产生问题。例如，在芯片设计过程的前期，当总体设计师对一项设计 ...; 1660 15 0 15

芯片设计 SoC 互联IP

少有人走的路 2017-7-18 06:47: IC设计经典面试大题汇总（三）; 问：请从多个角度介绍一下FPGA和ASIC的特点和各自的异同点？答：下面从定义、开发流程、特点三方面进行阐述。 FPGA 叫现场可编程门阵列，是一种基 ...; 1959 26 0 26

博客大赛 ASIC

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