coyoo的文章-第19页-面包板社区

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coyoo 2013-2-4 14:02: 【博客大赛】TI产生负电压的电源模块使用问题; TI 产生负电压的电源模块使用问题王敏志概述 2013 年开年项目新一批板子制作完成并焊接好就要开始调试了，再测试各种 ...; 3693 23 3 26

博客大赛 linear ptn78000aah ptn78000wah ltm8023

coyoo 2013-2-3 20:04: 【博客大赛】FPGA设计之自动化; FPGA 设计之自动化王敏志概述所谓自动化设计，就是在逻辑设计流程中，有些过程需要反复进行，比如编 ...; 2376 16 0 16

fpga altera 自动化博客大赛

coyoo 2013-2-1 11:49: 【博客大赛】ModelSim使用问题一例; 本人一直致力于应用自动化ModelSim仿真流程，最近由于项目需要，调整Transceiver的使用。将之前笔者这方只做发送修改为增加一路接收通道，在 ...; 3098 17 0 17

modelsim 博客大赛

coyoo 2013-1-24 15:30: 【博客大赛】ECO使用问题记录; Altera的QuartusII软件支持用户手动修改设计，一般在设计调试阶段需要更改很小部分的时候可以利用QII软件里的工具ECO来进行手动修改，修改后不 ...; 1930 20 1 21

altera 博客大赛 eco

coyoo 2013-1-8 17:50: 【博客大赛】基于FPGA的TDC那些事之三大难题; 基于 FPGA 的 TDC 那些事之三大难题王敏志概述利用逻辑来实现 TDC 功能面临几个难题，本文主要探讨其中最重要的 ...; 5432 30 1 31

fpga 博客大赛 tdc

coyoo 2013-1-4 18:30: 【博客大赛】PLL那些事之乘除因子; PLL 那些事之乘除因子王敏志概述 PLL 的基本概念可以在 ALTERA 的官方网站上找到详细的说明，这里 ...; 1840 12 4 16

altera pll 博客大赛乘除因子

coyoo 2013-1-3 16:36: 【博客大赛】再谈ALTERA FIFO的读写控制; 再谈 ALTERA FIFO 的读写控制王敏志概述之前写过相同标题的文章，最近修改工程的时候翻看之前的文 ...; 5541 14 2 16

fpga altera fifo 博客大赛

coyoo 2012-12-26 14:05: 同步设计; 同步设计的概念整个系统只有一个时钟，最多还有一些派生时钟。系统中大多存储元件都是时钟沿敏感元件（寄存器），而不是电平沿敏感的元件（锁存器）。 ...; 1274 18 0 18

fpga 同步设计

coyoo 2012-12-12 09:53: 基于FPGA的TDC设计测试结果; 基于ALTERA的FPGA的TDC设计调试已经告一段落，测试结果比较满意，附图是最新的测试结果：需要总结的内容很多，有时间再慢慢总结。 ...; 3740 21 4 25

fpga tdc

coyoo 2012-12-3 13:10: NIOSII 使用点滴; 在使用niosii有一些问题以及一些体会，摘录在此： 1、 NIOSII IDE写C代码的时候一行末尾斜杠“\”代表一句代码中本行写不完，两行代码或多行代码是 ...; 6742 10 1 11

fpga altera

coyoo 2012-12-3 13:10: Modelsim 仿真Altera器件; 1、从QII6.0开始支持从后台调用ModelSim进行仿真，具体步骤有以下几步： a、先在setting中EDA Tool Settings下选Simulation指定ModelSim的版本 ...; 3223 12 0 12

modelsim

coyoo 2012-12-3 13:09: Altera FPGA双功能脚使用; 1、忘记从哪个QII版本开始，当要使用配置引脚作IO的时候，必须更改设置；因为现在的默认设置这些引脚都为输入三态，所以使用之前必须更改。 ...; 3426 13 0 13

fpga altera

coyoo 2012-12-3 13:09: Altera高速Transceiver-GXB使用; GXB应用点滴体会 1、StratixGX GXB时钟注意事项 1）、REFCLK from Transceiver block0 and Transceiver block4 does not drive the I ...; 10182 10 4 14

fpga altera

coyoo 2012-12-3 13:07: VHDL写的同步FIFO(已调试通过的原代码); ------------------------------------------------------------------------------------------ -- Designer : Jerry Wang -- ...; 5076 10 1 11

fpga altera

coyoo 2012-12-3 13:07: PRBS验证; 在高速设计中为了测试高速串行通道传输的误码率，通常通过发送PRBS码来进行测试。对于PRBS的原理以及PRBS码的产生这里不做描述，今天主要论述 ...; 6636 12 1 13

fpga altera

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