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DDR设计系列——DDR的原理和时序
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时间:2022.12.19
上传者:fzyiye
DDR设计系列——DDR的原理和时序
ddr
设计
系列
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原理
时序
BGA设计规则——含BGA器件的PCB布局布线经验
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时间:2022.12.19
上传者:fzyiye
BGA设计规则——含BGA器件的PCB布局布线经验
BGA
设计规则
BGA
器件
pcb
布局布线
经验
BGA设计规则——Metric_Pitch_BGA_and_Micro_BGA
所需E币:2
下载:0
大小:651.24KB
时间:2022.12.19
上传者:fzyiye
BGA设计规则——Metric_Pitch_BGA_and_Micro_BGA_Routing_Solutions_Paper
BGA
设计规则
MetricPitchBGAandMicroBGA
BGA设计规则——Metric BGA Routing
所需E币:2
下载:0
大小:444.8KB
时间:2022.12.19
上传者:fzyiye
BGA设计规则——MetricBGARouting
BGA
设计规则
metric
BGA
routing
BGA走线规则
所需E币:2
下载:0
大小:180.2KB
时间:2022.12.19
上传者:fzyiye
BGA走线规则学习资料。
BGA
走线规则
Allegro设计——模型添加与规则设置
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大小:871.59KB
时间:2022.12.19
上传者:fzyiye
Allegro设计——模型添加与规则设置
allegro
设计
模型
添加
规则
设置
PCB设计——滤波电容放置
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时间:2022.12.19
上传者:fzyiye
Allegro中PCB设计——滤波电容放置
pcb
设计
滤波电容
放置
Cadence-Concept-HDL&Allegro原理图与PCB设计
所需E币:2
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大小:11.09MB
时间:2022.12.19
上传者:fzyiye
Cadence-Concept-HDL&Allegro原理图与PCB设计
CadenceConceptHDLAllegro
原理图
pcb
设计
Cadence+SPB16.2入门
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大小:1.98MB
时间:2022.12.19
上传者:fzyiye
Cadence+SPB16.2入门教程
CadenceSPB162
入门
Allegro学习
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时间:2022.12.19
上传者:fzyiye
Allegro学习笔记
allegro
学习
Allegro输出光绘文件规范——学习资料
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时间:2022.12.19
上传者:fzyiye
Allegro输出光绘文件规范
allegro
输出
光绘文件
规范
学习
资料
Allegro15.X培训教材——学习资料
所需E币:2
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大小:2.91MB
时间:2022.12.19
上传者:fzyiye
Allegro15.X培训教材
ALLEGRO15X
培训
教材
学习
资料
如何实现SSD系统级的可靠性
所需E币:1
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大小:359.59KB
时间:2022.12.19
上传者:kaokaohe
讲述关于如何实现SSD系统级的可靠性,RAID的各种原理等
SSD可靠性
DDR4 PCB设计规范 及设计要点
所需E币:1
下载:3
大小:1.01MB
时间:2022.12.19
上传者:dancai
DDR4PCB设计规范及设计要点DDR4管脚定义解释LAYOUT详细指南
ddr4
pcb
设计
规范
设计要点
华为内部的PCB规范参考
所需E币:2
下载:10
大小:290.85KB
时间:2022.12.12
上传者:搬砖人
huawei内部的PCB规范参考,仅供参考
华为
pcb
规范
参考
数字定时: 时钟信号、抖动、迟滞和眼图.pdf
所需E币:3
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大小:363.77KB
时间:2022.12.07
上传者:大大银河
数字定时:时钟信号、抖动、迟滞和眼图.pdf
数字
定时
时钟信号
抖动
迟滞
眼图
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电子产品设计EMC风险评估 415页 高清书签版.pdf
所需E币:3
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大小:120.63MB
时间:2022.12.07
上传者:大大银河
电子产品设计EMC风险评估415页高清书签版.pdf
电子产品设计
emc
风险评估
415页
高清
书签版
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