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shenzhenghao1984_379129130 2015-7-14 08:48: 过孔基础知识与差分过孔设计; 在一个高速印刷电路板 (PCB) 中，通孔在降低信号完整性性能方面一直饱受诟病。然而，过孔的使用是不可避免的。在标准的电路板上，元器件被放置在顶层，而差分对 ...; 1238 22 0 22

PCB 信号完整性差分过孔

用户1484351 2015-7-13 13:30: 过孔基础知识与差分过孔设计; 在一个高速印刷电路板 (PCB) 中，通孔在降低信号完整性性能方面一直饱受诟病。然而，过孔的使用是不可避免的。在标准的电路板上，元器件被放置在顶层，而差分对 ...; 1846 24 1 25

PCB 信号完整性差分过孔

用户1578945 2015-7-11 15:05: 来看看那些人气爆高的硬件产品,都是怎么死的？; 刹那间，似乎这个世界到处都是创业者，满地的智能硬件，花不出去钱的风投，但是，是时候为硬件创业泼点冷水了，要知道：硬件狗的任何一个失误都是需要老板几十上 ...; 974 19 0 19

工艺硬件众筹

用户1720811 2015-7-7 20:50: PCB元件布局的一些失败“经验”; 经过了一周翻来覆去的布局尝试，终于算是初步把元件布局定下来，要准备开始布线了。这一段时间很是煎熬，由于毫无经验所以基本上做了多次无用功 ...; 1395 11 4 15

pcb 元件布局

用户1666179 2015-7-2 17:32: 评论：@Tangsy's Blog 博客中提到的“【新手学习Cadence16.3】自己的Allegro16.3的学...”; 很实用，推荐给大家; 418 1 0 1

用户613470 2015-7-2 15:57: 评论：@123 博客中提到的“你的运放会振荡吗？”; 受益匪浅！; 920 23 0 23

shenzhenghao1984_379129130 2015-7-1 09:06: PCB设计布局规则与技巧; PCB布局规则 1、在通常情况下，所有的元件均应布置在电路板的同一面上，只有顶层元件过密时，才能将一些高度有限并且发热量小的器件，如贴片电阻、贴片电容、 ...; 1355 18 0 18

布线 PCB设计

shenzhenghao1984_379129130 2015-7-1 09:06: 利用FIR滤波器去除传输线效应; 网络串行解串器(SERDES)的串行数据输出速度已经高达28Gbps，并且还在继续发展。在如此高数据速率的条件下，即使很短的PCB走线也会起到传输线的作用，进而通过衰 ...; 1230 24 0 24

网络分析仪采样示波器传输线效应低通滤波

用户1720811 2015-6-30 20:20: PCB绘制前的一些准备和遇到的问题; 今天开始了一点点的PCB制作，进行了一些前期工作，有一点体会和经验以及会遇到的一些常见问题。首先，如果没有固定尺寸要求，没必要先把外框画出来，可 ...; 1035 10 1 11

绘制pcb的准备

bitao1983_395643617 2015-6-27 22:49: 你设计的PCB EMI达标了吗？; 电子设备的电子信号和处理器的频率不断提升，电子系统已是一个包含多种元器件和许多分系统的复杂设备。高密和高速会令系统的辐射加重，而低压和高灵敏度会使系 ...; 2113 24 1 25

EMI PCB设计

用户1648762 2015-6-26 14:16: PCB材料之玻璃纤维布; 2015-06-25 叶剑兵，蒋修国信号完整性信号完整性 http://mp.weixin.qq.com/s?__biz=MzA5NTExMDQ4OA==mid=208108014idx=1sn=aaf2153893aa00eb ...; 5188 17 0 17

pcb 设计 am 信号完整性 a

用户1720811 2015-6-25 22:13: 向Altium Designer迈出第一步; 最近自己开始第一次原理图的设计，并且开始画元件的PCB封装，在这个过程中突显自己初学者的问题了，有以下问题做个总结： 1.所采用的芯片不能实现功能， ...; 3245 11 0 11

pcb designer altium

吴川斌 2015-6-11 23:31: [视频]智能家居DIY智能百叶窗帘控制器–来至Make上的项目分享; 阳光是我们的好朋友，为我们带来了光明，也为我们带来了温暖，在寒冷的时候，你总是希望阳光能多一点照射进来，当你在阅读的时候，你总是希望屋子是敞亮的。然 ...; 1538 19 2 21

可穿戴

吴川斌 2015-6-11 23:26: Cadence Allegro 如何关闭铺铜(覆铜)shape的显示和设置shape显示模式–allegro; Cadence Allegro 画完PCB 铺完铜箔(覆铜)后，如果需要再对PCB进行布线检查或调整，总感觉那些shape好碍眼，Allegro 的铺铜 shape 能否设置得像 pads 一样，默认 ...; 1973 15 0 15

allegro

吴川斌 2015-6-11 23:21: [转]如何局部增加SMT製程中的錫膏或焊錫量; 今天的電子工業真的是越來越發達，隨著電子零件越作越小，產品也跟著越來越薄，就像一開始的黑金剛大手機，到如今可以放在手腕上的微型手機，這些都是拜SMD電子 ...; 2215 19 0 19

pcb 高速设计

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