FPGA和CPLD-可编程逻辑器件-第166页-面包板社区

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用户1444007 2013-11-14 00:16: Xilinx All Programmable SoC Zynq-7000 总结(3); Xilinx All Programmable SoC Zynq-7000 总结(3) Iyoyoo@2013.11.14 Xilinx于2011年3月成功推出全球首款集成ARM双核Cotex A9处理器的 ...; 2165 22 2 24

arm xilinx soc zynq 可编程 zc702

用户958476 2013-11-13 19:51: IIC数据抓包仪; 最近用FPGA做了一采集IIC数据包的小仪器，其实市面上很多逻辑分析仪也有这样的功能，但是逻辑分析仪存在采样深度不足的问题，我做的这个小东西可以实时侦 ...; 1619 6 2 8

iic 数据抓包仪

用户436273 2013-11-13 14:23: 串行通信之时钟; 近日看了crazy的博文关于uart分频的思想，觉得不错。原理是根据dds。但也有些地方是不太明白，特做个备份。原文如下：一、为啥要说任意分频 ...; 1223 12 0 12

serial com

wdzfd 2013-11-10 18:52: FPGA一体化高级设计方法; 尽管 FPGA 为嵌入式设计带来了强大的功能与灵活性，但额外的开发流程也给设计工作增加了新的复杂性和限制问题。整合传统的硬件-FPGA-软件设计流程并充分利用 ...; 2032 15 0 15

fpga一体化高级设计方法

用户451634 2013-11-7 10:54: 基础篇：Verilog语法二; 大家好，有段时间没来更新博客，主要是近期在忙着做培训相关的事情。现在我们主要学习Verilog语法知识，请大家注意学习Verilog的语法需要结 ...; 801 8 0 8

单片机 fpga dsp arm 博客大赛

用户450906 2013-11-6 23:25: 新手感悟; 从学数电开始我接触到了VHDL然后对FPGA 慢慢的有了了解，说实话，刚开始的时候真的像白痴一样什么都不懂，在官网上面看了个把星期的视频，然后发现自己还是什 ...; 783 8 1 9

fpga

用户450790 2013-11-6 20:49: Modelsim的几种小技巧，超好用！; 利用 modelsim 模板建立 testbench l Modelsim 提供了很多 testbench 模板，我们直接拿过来用可以减少工作量。首先先确定当前状态 ...; 5036 12 0 12

modelsim，wave波形查看

coyoo 2013-11-6 13:52: 【博客大赛】还在为学习枯燥的VHDL而烦恼吗？为何不结合Quartus一起学习; 我们通过一个小小的例子来学习VHDL程序设计，同时温习Quartus II工程开发，一举两得。这个小小的例子最小目标就是要告诉大家怎么使用IF-THEN ...; 2698 16 9 25

altera vhdl quartus 博客大赛

coyoo 2013-11-6 11:03: 【博客大赛】标题档博客，关于Quartus II执行TCL脚本; 今天做了一个实验，发现从Quartus II的Tools菜单下执行TCL脚本，如果TCL脚本里调用了其它TCL脚本，那么所有的TCL脚本就必须放在工程目录下，否则被调用的TCL ...; 1912 10 0 10

博客大赛 tcl

用户450790 2013-11-5 17:09: modelsim中，do文件的写法（转载）; 这篇文章写得很好，是我在博客园里看到的，在此想向 pupil_小龙致敬了，全面介绍了do文件的写法和步骤，对我们来说够用了，平时用GUI操作的，现在可以依照下 ...; 2071 13 1 14

modelsim，do文件

用户451606 2013-11-5 14:15: 【博客大赛】EDA工具Quartus II的安装以及安装破·解文件; 安装QuartusII6.0软件 PC 机系统配置要求: 1. CPU在奔腾II400MH以上,内存在512M以上； 2. 大于1GB的安装空间； 3. Win2 ...; 2350 8 7 15

vhdl quartusii eda 博客大赛安安装

用户1629897 2013-11-4 23:10: 研一上学期目标; 特权同学苦练基本功：1：datesheet要看原版2，开发工具要熟练3，焊接功底要扎实4，坚持写技术文档。研一上学期目标：基于我的主要任务是给师兄们所 ...; 762 6 0 6

设计开发 verilog 验证

wiliamzhou_446210705 2013-11-1 23:29: 分频实验——占空比为50%的奇分频; 分频实验应该是FPGA/CPLD实验中的最基础的实验（本人应该比流水灯还基础），而占空比为50%的奇分频相较于偶分频有一些难点。本文以占 ...; 2947 19 0 19

分频

用户432823 2013-10-31 18:00: 评论：@ivfaith 博客中提到的“信号同步（打2拍）”; 信号同步2拍; 798 5 0 5

用户432823 2013-10-31 17:44: 评论：@书写点滴博客中提到的“NIOS II常用函数整理【转】”; 谢谢博主的整理; 639 7 0 7

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