FPGA和CPLD-可编程逻辑器件-第164页-面包板社区

 

FPGA/CPLD

首页 FPGA/CPLD

用户427466 2013-11-25 08:30: Those days，Never fade ——“那些年，我们拿下了FPGA”温情回归; 好久没写博文了，北京的节奏还真是快，都是处于一个忙的状态，忙着学习、忙着生活、忙着总结，只是偶尔来这里看看，和大家交流些疑问，每 ...; 2006 14 9 23

fpga altera verilog xilinx

用户440448 2013-11-25 01:02: 【博客大赛】 2.1 Latches--锁存器和 FlipFlops--触发器 part1２; 让我们来看D Latch怎么解决问题的。写成块图就是。那么进行分析吧。注意这里有个CLK就是clock--时钟，当然就是随时间变化的0和1的输入啦。还记得 ...; 1267 18 4 22

问题分析时钟博客大赛触发 a

用户440448 2013-11-25 01:02: 【博客大赛】 2.2 4bit寄存器与商业级触发器; 上一节的答案分别是22和46，做出来了么。这一小节如果仔细阅读过上一小部分，大家一看标题心里就差不多有感觉了。４位输入和４位输出：时钟CLK是并联 ...; 1204 22 0 22

博客大赛 iantum2锁存器

用户443437 2013-11-24 21:38: 同步时序电路的延时; 同步时序电路的延时：同步时序设计中电路延时最常用的设计方法是用分频或倍频的时钟或者同步计数器完成所需延时。换句话来说，同步时序电路的延时被当做 ...; 1572 14 0 14

fpga

用户443437 2013-11-24 20:41: 逻辑分析仪; 逻辑分析仪逻辑分析仪是利用时钟从测试设备上采集和显示数字信号的仪器，最主要作用在于时序判定。由于逻辑分析仪不像 ...; 847 8 1 9

fpga

用户1650420 2013-11-23 13:36: 评论：@在路上博客中提到的“串口RS232通信程序（Verilog）”; verilog; 598 6 1 7

用户443437 2013-11-22 10:48: 异步电路与同步电路的异同; 一.异步电路 1.电路的核心逻辑用组合电路实现，比如异步的FIFO/RAM读写信号，地址译码等电路。 2.电路的主要信号，输出信号等并不依赖于任何一个时钟 ...; 726 7 0 7

fpga

用户443437 2013-11-19 22:13: FPGA的硬件设计思想; 学习FPGA，一定要有硬件设计思想。在软件编程的时候，比如1秒钟能实现5次乘法运算，那系统要求1秒钟实现50次乘法运算怎么办，我们会尽可能的优化代码，让代 ...; 994 10 0 10

fpga

用户443437 2013-11-19 22:08: FPGA编程的真正含义; 由真值表和D触发器构成。改变真值表的值就改变了逻辑功能，再通过和D触发器组合来实现任何时序逻辑。实际上就是去修改这些真值表和连接关系，使他们组成一 ...; 882 11 0 11

fpga

用户1718712 2013-11-19 16:46: 评论：@LIU_XF 博客中提到的“关于 modelsim仿真时出现No objects found ...”; 以前就遇到过这个问题，不记得怎么解决的啦。赞博主; 730 4 0 4

用户445193 2013-11-19 10:57: 亚稳态; 亚稳态：是指触发器无法在某个规定时间段内达到一个可确认的状态。当一个触发器进入亚稳态时，既无法预测该单元的输 ...; 1093 13 0 13

电路时钟系统触发

用户445193 2013-11-19 10:55: FPGA的“可编程”使你迷惑吗？; 任何一个硬件工程师对FPGA都不会陌生，就好比C语言对于软件工程师来说是必修课程一样，只要是电子相关专业的学生，都要学习可编程逻辑这门课程。FPGA的英文 ...; 2173 18 5 23

fpga 设计电路编程工程师

用户445193 2013-11-19 10:53: FPGA的“可编程”使你迷惑吗？; 任何一个硬件工程师对FPGA都不会陌生，就好比C语言对于软件工程师来说是必修课程一样，只要是电子相关专业的学生，都 ...; 844 15 0 15

fpga 设计电路编程工程师

用户1701511 2013-11-18 22:03: 评论：@wind330's Blog 博客中提到的“【转】FPGA的“可编程”使你迷惑吗？”; LIHAI; 887 14 0 14

用户442058 2013-11-18 19:25: modelsim仿真ISE工程时出现# ** Error: (vlog-19) Failed to access library 'rtl_work' at "; 转载自 FPGA乐园 http://blog.sina.com.cn/s/blog_6e394a3d0101722o.html 通常情况下一台电脑上即装有ISE，又装有quartus ii且二者的仿真 ...; 3034 15 0 15

quartus modelsim 仿真 ise

1 ... 160 161 162 163164165 166 167 ... 500 / 500 页下一页

关闭站长推荐

上一条

/3

下一条