FPGA和CPLD-可编程逻辑器件-第160页-面包板社区

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用户1701511 2013-12-20 22:11: 评论：@ kane18's Blog——追求真理，知行合一博客中提到的“关于按键消抖的理解：【基于特权FPGA教程第9讲】”; 帅气！！; 1438 21 0 21

用户1431377 2013-12-19 23:23: xilinx V5 gtp 的使用摸索; 最近在摸索 V5的 rocket io 的使用，主要收获如下 1 GTP 时钟 GTP 的时钟源可以有三种提供方式 1, 相邻的 GT ...; 4834 29 3 32

fpga xilinx i/o rocket

用户425250 2013-12-19 18:51: 评论：@在路上博客中提到的“脉冲边沿检测（Verilog）”; 学习了~; 651 8 0 8

特权ilove314 2013-12-17 20:24: 以太网，FPGA就一定能搞定系列之芯片测试; 以太网，FPGA 就一定能搞定系列之芯片测试本系列博文节选自特权同学的FPGA开发电子书《SF-CY3 FPGA套件开发指南》。最新设计文档下载地址：http://p ...; 2987 13 0 13

fpga 以太网

用户427466 2013-12-17 16:56: 【赠书活动】第一批获奖名单，活动仍在继续……; 在大家的支持和关心下，我们的第一批获奖名单终于浮出水面（获奖名单见下面链接），非常感谢大家对这本书的关注，也希望大家多多分 ...; 1195 14 2 16

fpga altera verilog xilinx

用户427211 2013-12-17 12:46: 【博客大赛】基于modelsim的正弦信号发生器的Rom仿真; 大学的一个课程设计，再次让我接触到了modelsim，本来就是新手。由于各种原因又中断了FPGA的学习，再次拿起时有一种极好的亲切感，一切有得重来， ...; 3586 16 0 16

rom modelsim 数据仿真博客大赛

用户1721897 2013-12-17 10:04: 评论：@特权's Blog——永远忠于年轻时的梦想！博客中提到的“以太网，FPGA就一定能搞定系列之概述篇”; 看看; 878 8 0 8

用户443437 2013-12-17 10:04: 带宽与位宽; 带宽带宽通常指信号所占据的频带宽度；在被用来描述信道时，带宽是指能够有效通过该信道的信号的最大频带宽度。对于模拟信号而言，带宽又称为频宽 ...; 1461 11 0 11

fpga

特权ilove314 2013-12-15 21:40: 以太网，FPGA就一定能搞定系列之概述篇; 以太网，FPGA就一定能搞定系列之概述篇本系列博文节选自特权同学的FPGA 开发电子书《SF-CY3 FPGA 套件开发指南》。最新设计文档下载地 ...; 5669 20 3 23

fpga 以太网

用户1322817 2013-12-14 22:44: 关于FPGA对SDRAM的按列读写问题; 大家好，我现在用一片FPGA来驱动SDRAM，按照ALTERA官方提供的SDR SDRAM驱动，已经能够实现对SDRAM的读写，特别是page模式。我现在能够实现按页读写，从sd ...; 1031 11 0 11

fpga

用户1716248 2013-12-14 11:16: 评论：@coyoo's Blog 博客中提到的“【博客大赛】高级设计第一章时序优化实例之并行化结构”; ..; 928 27 0 27

用户1668914 2013-12-14 10:35: ISE工具和它生成的文件; 在ISE系列软件中，CPLD/FPGA设计的实现主要包括转换(Translate)、映射(Map)、布局布线(PlaceRoute)和时间参数提取(Timing)等几个方面。 1.转换 ...; 1225 19 0 19

文件 ise工具

用户1668914 2013-12-14 10:33: Xilinx ISE 各类文件简述 -- EDIF（转）; 2010-08-25 10:54:42 | 分类： EDA | 标签： | 字号大中小订阅说到LPM（Library of Par ...; 4976 20 0 20

xilinx ise edif 文件简述

用户1668914 2013-12-14 10:25: GSM给您解释解释XILINX Implement的选项的含义（完成）; 原文地址： http://bbs.21ic.com/icview-286494-1-1.html 所谓实现（Implement）是将综合输出的逻辑网表翻译成所选器件的底层模块与硬件原语 ...; 1825 17 0 17

fpga xilinx ise软件使用

用户514241 2013-12-13 12:35: a-x-i; aa; 801 9 0 9

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