FPGA和CPLD-可编程逻辑器件-第158页-面包板社区

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coyoo 2014-1-13 16:04: 《深入理解Altera FPGA 应用设计》新鲜出炉啦; 新书《深入理解Altera FPGA 应用设计》已经出版啦！！！！; 3178 18 3 21

新书

用户442058 2014-1-12 09:58: 【way to timing closure】PART5 结语; 关于前一段时间优化电路速度工作的总结到这里就结束了。其实之前还打算通过使用位置约束，将各个模块约束在较小的范围内，以使 EDA 软件实现出更优化的电 ...; 958 20 0 20

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用户442058 2014-1-12 09:57: 【way to timing closure】PART4 高速电路的设计方法; 在上一个部分中，说明了几种自己总结的利于设计出高速电路的代码风格。这里其实暗含着下面这样的场景：电路已经设计好了，而且已经很棒，只是需要用风格 ...; 1501 19 0 19

fpga 时序收敛

特权ilove314 2014-1-10 20:03: 以太网，FPGA就一定能搞定系列之UDP传输实例; 以太网，FPGA就一定能搞定系列之UDP传输实例本系列博文节选自特权同学的FPGA开发电子书《SF-CY3 FPGA套件开发指南》。最新设计文档下载地址：htt ...; 13015 19 3 22

fpga 以太网

用户443437 2014-1-10 01:36: 对SDRAM的时序（初始化阶段）有了一个新的理解; SDRAM需要初始化也许很多人都不知道，在其SDRAM芯片内部有一个逻辑控制单元，并且有一个模式寄存器（MR，mode register）为其提供控制参数。如图1所示。 ...; 2460 14 2 16

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用户443437 2014-1-9 17:58: FPGA的功耗问题; FPGA器件的一个比较特别的现象是其上电瞬间的电流比较大，有时候甚至大于芯片正常工作的电流，这是因为FPGA内部的逻辑和互连线资源（SRAM工艺）在上电的瞬间 ...; 1008 8 0 8

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coyoo 2014-1-8 16:32: 【博客大赛】时序优化之寄存器平衡实例; 我们知道在组合逻辑之间插入寄存器可以优化设计的时序，而如果只是调整寄存器的位置来优化实现，这种技术被称为寄存器平衡。《高级设计》一书中 ...; 1986 20 2 22

博客大赛时序优化寄存器平衡

coyoo 2014-1-8 10:10: 【博客大赛】PET符合电路逻辑实现思考; 笔者在PET电子学基础一文中的最后提到了PET电子学一个关键技术就是符合电路，当前实现该电路多采用逻辑器件，如FPGA，来实现。图1为上一篇博文最 ...; 2626 20 0 20

博客大赛 pet 符合

用户1605978 2014-1-6 13:07: 博客第一天之序言; 最近一直有写点东西的想法，希望通过博客的形式来对自己的点滴做一个简单的记录，一方面可以方便自己以后查看问题所在；另一方面也可以给其他的人做一个借 ...; 1109 29 1 30

问题博客简单错误

用户443926 2014-1-5 22:54: 评论：@davidchaning's Blog 博客中提到的“FPGA永远在路上之-FPGA中的延时处理”; FPGA延时; 547 2 0 2

特权ilove314 2014-1-5 19:23: 以太网，FPGA就一定能搞定系列之IPRAW模式通信; 以太网，FPGA就一定能搞定系列之IPRAW模式通信本系列博文节选自特权同学的FPGA开发电子书《SF-CY3 FPGA套件开发指南》。最新设计文档下载地址：h ...; 6255 22 0 22

fpga 以太网

coyoo 2014-1-4 12:19: 【博客大赛】电路改版思考; 站在“爱你一世”的开端，回首整个“爱你一生”，发现这一年似乎只干了两件事情，第一件是电路板最终定型（第四版），每次改版可都是RMB啊，痛 ...; 2549 13 3 16

博客大赛

1053683568_507245520 2014-1-3 21:02: 【博客大赛】自己定制DPRAM的读写操作; DPRAM的读写操作下面是本人写的DPRAM的读写操作，自己定制DPRAM，不用altera FPGA 内部自带的IP core，选择的存储器块类型是M9K（对于不同类型的存储器 ...; 3924 14 11 25

博客大赛 dpram 读写操作读写冲突结果分析

coyoo 2014-1-3 10:22: 赠书活动现已隆重开场; 赠书活动地址： http://group.ednchina.com/GROUP_MES_14596_3000003220_5000013907.HTM 欢迎大家踊跃参与，让我们一起在“爱你一生”之后 ...; 1683 11 5 16

fpga altera

用户442058 2014-1-1 12:50: 【way to timing closure】PART1 引子; 原来的引子不知道为什么不见了，补上。第一次做比较大型的设计，结果真的很悲剧。布局布线以后，静态时序分析的结果和自己 ...; 1666 17 4 21

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