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GXB应用点滴体会 1、StratixGX GXB时钟注意事项 1)、REFCLK from Transceiver block0 and Transceiver block4 does not drive the I ...
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2012-12-3 13:06
看了ilove的异步复位同步释放博文有感
在博文中特权TX介绍说“Altera推荐的双层叠复位方式”,并且提供了基于Verilog的源代码。 最近设计中有异步复位,就直接 ...
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学习Cadence软件-前期准备(Concept HDL)
最近在学习Cadence软件,光原理图人家就分别有Capture、Concept等,PCB软件也有Allegro和Layout。 在网上找了些资料,先储备点知识,以备查询。 1 ...
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2012-12-3 13:05
HDL转换工具
HDL语言转换工具,比如AHDL转VHDL或者Verilog以及VHDL与Verilog之间转换 1、这个工具就是将AHDL转换成VHDL和Verilog的:https://static.assets-stash. ...
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2012-12-3 13:05
参考实例
收集一些经过验证的参考实例 1、第一个上NIOSII的例子,包含了以下实例:a、对SDRAM定制控制;b、用户自制核挂靠NIOS核(IIC、VGA等):part1https ...
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关于Assert、Deassert等几个概念
读E文经常会碰到一些关键术语,平时都没有特别留意,最近在拜读Sunburst上关于异步FIFO的paper的时候发现里面大量使用了assert、de-assert等。 ...
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coyoo
2012-12-3 13:04
DDR SDRAM控制器研究
Board:Altera CycloneIII Starter 开发板 DDR SDRAM器件:PSC(台湾力晶)A2S56D40CTP-G5PP(DDR4MX16X4BANKS)-32MBytes-256Mb。由于PSC产品不提供 ...
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2012-12-3 13:04
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概述: 总结一些使用QuartusII软件的小经验,有些技巧性的东西很久不用或者不是经常用到很容易就忘掉,等到用到再到处查找确实 ...
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coyoo
2012-12-3 13:02
谈谈Altera FPGA的配置
不管Xilinx还是Altera,FPGA的配置模式或者方法多样,尤其是Altera器件,什么AS模式、PS模式、FPP模式、AP模式等等。一般逻辑设计者可能不会关 ...
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2012-12-3 13:02
关于Receiver中Byte Ordering的设置
Altera的Transciever中的Byte Ordering设置用的较少,但是在现实调试中经常发现Reciever接收到的数据会字节颠倒,甚至于字节混乱,虽然Altera在T ...
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