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coyoo
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coyoo
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BAR空间扫描子程序学习(TSK_BAR_SCAN)
前面博文有介绍在仿真测试功能代码里前面几步分别是设置仿真时间(以防止仿真被无休止挂起)、系统初始化(等待复位被释放以及链路链接ok)、BAR空间初始化等等 ...
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coyoo
2019-8-8 12:46
原创
学习PCI配置空间(TSK_TX_TYPE0_CONFIGURATION_READ)
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coyoo
2019-8-8 12:37
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什么是Xilinx的PCIe仿真模型?
这里所说的Xilinx PCIe仿真模型是指在例化PCIe核时候其自动生成的参考时自动产生的仿真模型,用户可以用此模型来仿真其PCIe设计。这里着重学习为仿真endpoint提 ...
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coyoo
2019-8-7 13:38
原创
Xilinx的PCIe仿真模型学习
使用Xilinx的PCIe的时候,例化示例都会自动生成仿真模型,同时官网提供的基于xapp1052的参考设计,也同时提供仿真BMD的仿真模型。即所谓的下行端口模型(downst ...
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coyoo
2019-8-6 11:21
原创
BMD64与BMD128比较
结合排查之前pio_writeReadBack_test0测试出现的问题,需要参考前人写的相关博客,大部分都是基于BMD64,而我的示例是基于BMD128。 pio_writeReadBack_test0测 ...
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BMD
时序
coyoo
2019-8-5 16:49
原创
仿真Xilinx的PCIe时使用pio_writeReadBack_test0测试问题分析
Xilinx的参考设计仿真给出RP模型下3个测试函数,前两个仿真都通过,只有pio_writeReadBack_test0测试默认的MEM32写和读回的时候,写入和读回的数据不匹配,写入 ...
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Xilinx
PCIe
仿真
coyoo
2019-8-2 17:43
原创
BMD参考设计层次结构(7x)
xapp1052给出的7x参考设计层次结构是基于PIO的,没有更新BMD,下面是我依据PIO层次结构手动 修改到BMD设计: xilinx_pcie_2_1_ep_7x | |--pci ...
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coyoo
2019-8-2 13:39
原创
收集一些自己对PCIe仿真Test Bench的理解
1. board.RP.tx_usrapp.TSK_SIMULATION_TIMEOUT( XXX ) . 这个函数在仿真的时候被调用, XXX 指定了仿真完成的时间,所以这个时间要设置的足 ...
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PCIe
仿真
TestBench
coyoo
2019-8-1 13:59
原创
Xilinx PCIe仿真问题(1)Transceiver高阻
前面一篇博文讲用ModelSim仿真vivado工程的时候,工程用的xapp1052的参考设计。在仿真的时候,发现PCIe对应的8个高速串口一直位置高阻态。这个问题今天貌似找到 ...
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PCIe仿真
coyoo
2019-7-29 14:21
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用ModelSim仿真Vivado建立的工程
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2019-7-29 13:53
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ModelSim64_10.7的安装和使用
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