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coyoo
2019-8-8 12:46
原创
学习PCI配置空间(TSK_TX_TYPE0_CONFIGURATION_READ)
PCI总线定义了两类配置请求,一个是Type00h配置请求,另一个是Type 01h配置请求。 其中HOST主桥或者PCI桥使用Type 00h配置请求,访问与HOST主桥或者PCI桥直 ...
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配置空间
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coyoo
2019-8-8 12:37
原创
什么是Xilinx的PCIe仿真模型?
这里所说的Xilinx PCIe仿真模型是指在例化PCIe核时候其自动生成的参考时自动产生的仿真模型,用户可以用此模型来仿真其PCIe设计。这里着重学习为仿真endpoint提 ...
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coyoo
2019-8-7 13:38
原创
Xilinx的PCIe仿真模型学习
使用Xilinx的PCIe的时候,例化示例都会自动生成仿真模型,同时官网提供的基于xapp1052的参考设计,也同时提供仿真BMD的仿真模型。即所谓的下行端口模型(downst ...
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Xilinx
PCIe
仿真
coyoo
2019-8-6 11:21
原创
BMD64与BMD128比较
结合排查之前pio_writeReadBack_test0测试出现的问题,需要参考前人写的相关博客,大部分都是基于BMD64,而我的示例是基于BMD128。 pio_writeReadBack_test0测 ...
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BMD
时序
coyoo
2019-8-5 16:49
原创
仿真Xilinx的PCIe时使用pio_writeReadBack_test0测试问题分析
Xilinx的参考设计仿真给出RP模型下3个测试函数,前两个仿真都通过,只有pio_writeReadBack_test0测试默认的MEM32写和读回的时候,写入和读回的数据不匹配,写入 ...
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Xilinx
PCIe
仿真
coyoo
2019-8-2 17:43
原创
BMD参考设计层次结构(7x)
xapp1052给出的7x参考设计层次结构是基于PIO的,没有更新BMD,下面是我依据PIO层次结构手动 修改到BMD设计: xilinx_pcie_2_1_ep_7x | |--pci ...
3993
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coyoo
2019-8-2 13:39
原创
收集一些自己对PCIe仿真Test Bench的理解
1. board.RP.tx_usrapp.TSK_SIMULATION_TIMEOUT( XXX ) . 这个函数在仿真的时候被调用, XXX 指定了仿真完成的时间,所以这个时间要设置的足 ...
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PCIe
仿真
TestBench
coyoo
2019-8-1 13:59
原创
Xilinx PCIe仿真问题(1)Transceiver高阻
前面一篇博文讲用ModelSim仿真vivado工程的时候,工程用的xapp1052的参考设计。在仿真的时候,发现PCIe对应的8个高速串口一直位置高阻态。这个问题今天貌似找到 ...
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PCIe仿真
coyoo
2019-7-29 14:21
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用ModelSim仿真Vivado建立的工程
安富利的人说使用Vivado自己的仿真器进行仿真,可是对于新手来说,还是觉得用ModelSim仿真比较自由一点。在Vivado的工程设置里可以修改目标仿真器,我们可以选 ...
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coyoo
2019-7-29 13:53
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ModelSim64_10.7的安装和使用
Xilinx的PCIe仿真需要ModelSim版本至少10.5以上,所以下了个10.7的64位版本,安装的时候没法用之前的10.1或6.5的破解器进行破解,跟同事要了个10.5的破解器,完 ...
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ModelSim64
coyoo
2019-7-26 14:17
原创
试着新建一个vivado项目
new启动新建项目 给新建的工程命名(默认名字好像是project_1),并指定工程存放路径,默认选择为工程创建子目录: 由于是第一次学习vivado,新建 ...
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新建vivado工程
coyoo
2019-7-25 16:27
原创
VIVADO2019下载及安装(最终安装的是2018.3)
Xilinx官网下载东西都需要注册一个账号,很久之前的账号忘记了密码,也找不回密码,索性重新注册了一个账号,但是提示还是不能下载,每次都是返回到登陆界面。 ...
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VIVADO下载安装使用
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2019-7-16 14:51
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