FPGA和CPLD-可编程逻辑器件-第106页-面包板社区

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用户1740962 2015-3-24 13:48: 基于FPGA和AD1836的I2S接口设计; 　　引言　　 AD1836 是ADI公司新推出的一款高性能的单片声码器，适用于数字音频系统。它采用5V供电，数字接口输入输出电平为LVTTL电平，可以直接和一般 ...; 1317 15 0 15

FPGA AD1836 I2S接口

用户1740962 2015-3-24 13:47: 基于FPGA的IIC接口设计; 　　 EDN博客精华文章作者： ilove314 基于FPGA的IIC接口设计　　这个设计做的比较痛苦，前前后后利用业余时间调试了应该是不下一个星期了。咬咬 ...; 907 9 0 9

verilog FPGA IIC接口

用户1740962 2015-3-24 13:47: verilog 实现任意分频方法; EDN博客精华文章作者： likee 在verilog程序设计中，我们往往要对一个频率进行任意分频，而且占空比也有一定的要求这样的话，对于程序有一定的要求，l ...; 987 19 0 19

verilog FPGA

用户1740962 2015-3-24 13:47: (多图) 基于FPGA的自然对数变换器的设计与实现; 　　引言　　在需要硬件实现对数运算的场合，其精度和速度是必须考虑的问题。目前硬件实现对数变换的方法主要有查表法、泰勒公式展开法和线性近似法。查 ...; 1529 14 0 14

算法 FPGA 对数变换器 CORD

用户1740962 2015-3-24 13:47: (多图) 基于FPGA的高阶QAM调制器的实现; 　　 1 引言　　多电平正交幅度调制MQAM(Multilevel QuadratureAmplitude Modulation)是一种振幅和相位相结合的高阶调制方式，具有较高的频带利用率和较 ...; 956 21 0 21

FPGA QAM调制器 MPSK

用户1740962 2015-3-24 13:47: (多图) 基于Verilog的顺序状态逻辑FSM的设计与仿真; 　　硬件描述语言Verilog为数字系统设计人员提供了一种在广泛抽象层次上描述数字系统的方式，同时，为计算机辅助设计工具在工程设计中的应用提供了方法。该语言 ...; 1310 17 0 17

Verilog 顺序状态逻辑 FSM

用户1740962 2015-3-24 13:46: 基于CPLD的电器定时开关控制系统设计; 　　随着当今社会工作和生活节奏的加快，人们对许多电器、仪器、设备的自动化要求也越来越高，但现有的许多电器还不具备定时开启和关闭功能，许多需要在固定时 ...; 858 15 0 15

按键扫描控制系统 CPLD 电器定时开关

用户1740962 2015-3-24 13:46: 不同的verilog代码风格看RTL视图之一; 　　 EDN博客精华文章作者： ilove314 不同的verilog代码风格看RTL视图之一　　刚开始玩CPLD/FPGA开发板的时候使用的一块基于EPM240T100的板子，a ...; 1421 14 0 14

verilog FPGA RTL视图 EPM240T100

用户1740962 2015-3-24 13:46: (多图) 基于FPGA的空间存储器的纠错系统; 　　1、引言　　阿尔法磁谱仪(Alpha Magnetic Spectrometer，AMS)实验室是丁肇中博士领导的由美、俄、德、法、中等16个国家和地区共300多名科学家参加的 ...; 821 15 0 15

FPGA 空间存储器纠错系统 VerilogHDL

用户1740962 2015-3-24 13:45: (多图) 基于FPGA的UART接口开发; 　　设计背景　　串口即通用异步收发器（UART，Universal Asynchronous Receiver Transmitter）。串行通信具有传输线少、成本低、可靠性高等优点，所以系 ...; 878 18 0 18

串口调试 FPGA UART接口

用户1740962 2015-3-24 13:45: (多图) 基于FPGA的小数分频器的实现; 　　频率合成技术是现代通讯系统的重要组成部分，他将一个高稳定和高准确度的基准频率，经过四则运算，产生同样稳定度和基准度的频率。分频器是集成电路中最基 ...; 918 16 0 16

FPGA Verilog 小数分频器

用户1740962 2015-3-24 13:44: (多图) 基于FPGA的相检宽带测频系统的设计; 　　在电子测量技术中，频率测量是最基本的测量之一。常用的测频法和测周期法在实际应用中具有较大的局限性，并且对被测信号的计数存在±1个字的误差。而在直接 ...; 849 17 0 17

FPGA Quartus 相检宽带测频模拟仿真

用户1740962 2015-3-24 13:44: 混合使用阻塞/非阻塞语句; 　　 EDN博客精华文章作者： tanghtctc 混合使用阻塞/非阻塞语句　　verilog语言的一个难点就是阻塞语句和非阻塞语句。一般来说，always语句块中 ...; 2186 23 0 23

verilog 阻塞 Quartus

用户1740962 2015-3-24 13:43: Verilog串口通讯设计; 　　1 串口通信基本特点　　随着多微机系统的应用和微机网络的发展，通信功能越来越显得重要。串行通信是在一根传输线上一位一位地传送信息.这根线既作 ...; 934 14 0 14

串口 FPGA Verilog SP3485

用户1740962 2015-3-24 13:43: (多图) 4级流水线方式的32位全加器; 　　 EDN博客精华文章作者： tengjingshu 　　之前一篇博文（流水线加法器设计（Verilog））介绍了2级流水线4位全加器，本来目的是和之前不运用流水线 ...; 1981 25 0 25

流水线 CPLD Verilog

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